基于DSP和DDS的商品防窃监视器扫频信号源
1 引言
商品防窃监视器（electronic article surveillance）简称eas，是目前超市普遍使用的安检防窃设备。其原理是由发射电路产生7.8mhz~8.8mhz的扫频信号，该信号由近场天线发射，当天线附近有标签存在时（标签为高q值的lc振荡回路，谐振中心频率为7.8mhz），标签发出谐振电磁波信号，该信号被eas接收天线接收，经解调、放大和数字化处理后，最终发出报警信息。传统的扫频信号发生电路通常包含变容二极管组成的lc振荡回路，通过周期性地改变二极管的偏压来改变振荡频率。由于分立元件参数的一致性差，振荡频率难以精确控制，频率变化的线性度、扫频宽度等诸多指标也受到元件性能的严格约束。在数字化技术飞速发展的今天，由直接数字频率合成（dds）技术产生所需要的信号波形，是eas扫频信号发生电路发展的趋势。笔者采用ad公司的ad9834型dds实现扫频信号合成，同时，考虑到信号的高速频率变化特点，需使用数字信号处理器（dsp）对ad9834进行控制。笔者采用ti公司的tms320vc5410型数字信号处理器（以下简称c5410）。下面介绍这些器件的特点及电路实现方法。
2 tms320vc5410和ad9834简介
本设计要求c5410通过多通道缓冲串行口向ad9834发送命令和数据，由ad9834产生eas系统需要的扫频信号。c5410是ti公司生产的新一代低功耗tms320c5000系列定点数字信号处理器，它有3个高速、全双工、多通道缓冲串行口（mcbsp），每个串行口可以支持128个通道，速度可达100mb/s。该系列提供的mcbsp支持多种串行通信的方式和协议，可以根据用户的不同需要进行配置。多通道缓冲串行口遵循spi协议是以主从方式工作的，这种模式通常有1个主设备和1个或多个从设备，其接口包括以下4种信号：串行数据输入（也称为主进从出或miso）；串行数据输出（也称为主出从进或mosi）；串行移位时钟（也称为sck）；从使能信号（也称为ss）。mcbsp的时钟停止模式与spi协议兼容，当mcbsp处于时钟停止模式时，发送器和接收器是内部同步的。
ad9834的原理框图如图1所示。它使用的dds技术是一种利用正弦信号相位线性增加的原理直接由数字累加和数/模转换合成所需频率的技术。ad9834主要由数控振荡器（nco）、相位调制器、正弦查询表rom和1个10位d/a转换器组成。数控振荡器和相位调制器主要由2个频率选择寄存器、1个相位累加器、2个相位偏移寄存器和1个相位偏移加法器构成，它的最高工作频率可达50mhz。
ad9834的频率控制字由式（1）求得
式中，0《δphase《228-1，fmclk最高可达50mhz，它是由高稳定度晶体振荡器获得或由其他器件编程提供，用来同步整个合成器的各个组成部分。
相位控制字由式（2）求得
δp=kx2π/4096 （2）
式中，0
3 系统设计思想
传统的eas扫频信号产生电路使用了压控振荡集成电路。通过改变外围变容二极管的直流偏压可以使扫频信号的频率范围控制在8．2mhz±0.5mhz。当采用全数字频率合成时，由于数字信号的非连续性，不可能产生连续的扫频信号，只能产生台阶性变化的扫频信号，即1个单频点持续一段时间后增加4，，再跳跃到另1个单频点，因此，如果扫频信号的扫频范围为8.2mhz±-o.5mhz，将该lmhz频率跨度等分为32个频点，于是相邻频点之间的频率间隔δf=1mhz/31=0.0323mhz。如果扫频信号的扫频周期为 180hz（即5.6ms），则每个频点占用的时间为δt=5.6ms/3l=181pμs。该δt又分为二部分，第一部分△t1为振荡时间，即单频率波形持续时间；第二部分δt2为延时等待时间，在这段时间内理论上没有波形输出。在实际应用中可通过动态改变△t2在δt中所占的比例以控制eas的发射功率，对系统很有用。如果每个单频率波形持续时间（频率振荡时间）△t1=10μs，则每个单频率波形的延时等待时间δt2=（5.6-0.01x32）/31=170.3μs。多通道缓冲串行口发送1个单频率字只需71μs左右，能够完成控制字和频率字的发送，而且还能够在此时间内完成复杂的计算 。图2为180hz周期内完成的32频点扫频信号波形示意图。其中，每个频点展开后都是频率一定的正弦波，每个周期内32频点扫频信号的频率范围都是从7．7mhz到8．7mhz台阶性变化。
4 硬件设计方案和软件实现
4．1 硬件设计方案
基于上述设计思想的硬件连接方案如图3所示，包括c5410、10mhz晶体振荡器、ad9834及滤波放大电路。由于ad9834的电源电压在2．3v到5．5v范围内可选，c5410的电源电压为3．3v。所以在连接时无需电平转换。10mhz晶体振荡器向c5410提供输入时钟。初始化c5410使其工作频率为100mhz，因为只有此时才能使其定时器周期寄存器从tout引脚输出50mhz时钟信号。该时钟信号输出到ad9834的mclk脚，作为ad9834的工作时钟。理论分析指出：输出信号的相位噪声取决于时钟信号的相位噪声，在输出信号频率不变的情况下，输入时钟信号频率越高，相位噪声恶化越小。
滤波放大电路对ad9834输出的扫频波信号进行进一步滤波处理和幅度放大，以滤除高频信
号干扰和噪声，将信噪比控制在允许范围内。由于杂波信号干扰，从ad9834出来的扫频信号在没有滤波的情况下含有丰富的高频成分，采用rc或lc无源滤波电路处理后可以得到一组以8．2mhz为中心频率，扫频范围在7．7mhz~8．7mhz的较为清晰的扫频波。具体实现方案是先通过由1只去耦电容器和1只电阻器组成的rc回路滤掉由：dds输出的扫频信号中的高频成分，然后使用带有电感器的复式滤波电路（可以选择lc滤波电路），经电感器滤波后不但负载电流及电压的脉动减小，而且波形也变得平滑，l、c的具体值可由f=1/（lc）1/2求得，其中f=8.7mhz，滤波电路如图4所示。由于ad9834的输出信号幅度最大只有o．8v，所以需将其幅值放大才能作为扫频信号源，在系统中可由1个高速运算放大器实现。
由于该电路是高速数，模混合电路，因此电磁兼容性能非常重要。特别是dsp和dds共用1个电源，使得器件的工作信号通过电源线传输形成干扰。通常必须在电源接入处并人大容量的电解电容器和钽电容器，滤除低频噪声。还应该在每个器件的电源引脚处接1只0．01pf一0．1pf的去耦电容器。
4．2 软件实现
软件的流程如图5所示，主要包括复位、初始化、写频率字和控制字等部分。
初始化部分包括对dsp多通道缓冲串行口的初始化及其配置和对ad9834写入控制字，应设置多通道缓冲串行口工作模式和dds的sleep、re-set、signpib、hlb等位。在该系统设计中，ad9834采用串行控制比特位方式选择相位、频率寄存器；pin/sw=0．选择控制字模式；fsei=0，选择使用频率寄存器0（freq0）；d13=0，将28位的频率寄存器分成2个14位的寄存器工作，且频率字的高14位和低14位可以独立改变。由于系统要求在上电后立即工作，故将ad9834的reset引脚接低电平。必要时，也可以由系统中的其他模块如cpid控制dds启动。sdata、sclk和fsync 3个引脚向ad9834中写数据和控制字。当fsync=0时，表示正向ad9834写入1个新字，并将在下1个scl．k的下降沿读人第1位，其余的位在随后的sclk的下降沿读入，经过16个sclk下降沿后，置 fsync=1，实现了dsp对ad9834的控制。
由于将c5410的mcbsp配置为时钟停止模式，串口接收控制寄存器spcrl的时钟停止模式位clkstp和串口引脚控制寄存器pcr的发送时钟极性位clkxp配置为clkstp=11，clkxp=1（时钟开始于下降沿，有延时），因此，发送时钟模式引脚设为内部时钟输出（bclkx=i）；采样率发生器时钟源来自cpu时钟（clksm=i）；发送帧同步模式引脚设置为输出（fsxm=1）；发送帧同步极性引脚设置为低电平有效（fsxp=1）；发送时钟极性设置为下降沿采样 （clkxp=1）；数据发送和接收延时时间为l位（rdatdly=xdatdly=01b）；采样率发生器时钟的降频因子为49（clkgdv=49）。因为16xbaud rateclkout ／1+clkgdv为100/49，所以mcbsp的采样率发生器产生2mhz的时钟信号。
下面是通过mcbsp口向ad9834传送频率为8．2mhz的频率字和控制字的程序段： l
程序设计中应该注意的重点就是对发送和接收准备好位的查询，如果在程序中没有查询或者查询的地点不对，则程序在单步运行时可能会正确发送和接收数据，但是当全速运行时，由于速度较高，因而不能进行正确的数据收发。正确的查询应该是在数据发送前查询spcrl或spcr2中的rrdy位或xrdy位，当rrdy位或xrdy位为0时，表明尚未接收或发送完数据，一直查询到rrdy位或xrdy位为1，表明上一组数据已接收或发送完毕，可以进行下一组数据的接收或发送。
5 结束语
由dds技术产生的扫频信号源不仅频率稳定、信号精度高、抗干扰能力强，而且由于它是在计算机控制下直接实现的，因而易于实现智能化处理。无论是实用电路还是测量仪器，凡是需要产生扫频信号的地方，原则上都可以使用dds技术。在频率迅速变化的场合，dds中寄存器更新的速度有时会成为关键指标，这时必须使用高速电路和高速串行口，由合理的硬件设计和软件流程来实现预期设计目标。
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ad9834的频率控制字由式（1）求得
式中，0《δphase《228-1，fmclk最高可达50mhz，它是由高稳定度晶体振荡器获得或由其他器件编程提供，用来同步整个合成器的各个组成部分。
相位控制字由式（2）求得
δp=kx2π/4096 （2）
式中，0
3 系统设计思想
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由于该电路是高速数，模混合电路，因此电磁兼容性能非常重要。特别是dsp和dds共用1个电源，使得器件的工作信号通过电源线传输形成干扰。通常必须在电源接入处并人大容量的电解电容器和钽电容器，滤除低频噪声。还应该在每个器件的电源引脚处接1只0．01pf一0．1pf的去耦电容器。
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软件的流程如图5所示，主要包括复位、初始化、写频率字和控制字等部分。
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由于将c5410的mcbsp配置为时钟停止模式，串口接收控制寄存器spcrl的时钟停止模式位clkstp和串口引脚控制寄存器pcr的发送时钟极性位clkxp配置为clkstp=11，clkxp=1（时钟开始于下降沿，有延时），因此，发送时钟模式引脚设为内部时钟输出（bclkx=i）；采样率发生器时钟源来自cpu时钟（clksm=i）；发送帧同步模式引脚设置为输出（fsxm=1）；发送帧同步极性引脚设置为低电平有效（fsxp=1）；发送时钟极性设置为下降沿采样 （clkxp=1）；数据发送和接收延时时间为l位（rdatdly=xdatdly=01b）；采样率发生器时钟的降频因子为49（clkgdv=49）。因为16xbaud rateclkout ／1+clkgdv为100/49，所以mcbsp的采样率发生器产生2mhz的时钟信号。
下面是通过mcbsp口向ad9834传送频率为8．2mhz的频率字和控制字的程序段： l
程序设计中应该注意的重点就是对发送和接收准备好位的查询，如果在程序中没有查询或者查询的地点不对，则程序在单步运行时可能会正确发送和接收数据，但是当全速运行时，由于速度较高，因而不能进行正确的数据收发。正确的查询应该是在数据发送前查询spcrl或spcr2中的rrdy位或xrdy位，当rrdy位或xrdy位为0时，表明尚未接收或发送完数据，一直查询到rrdy位或xrdy位为1，表明上一组数据已接收或发送完毕，可以进行下一组数据的接收或发送。
5 结束语
由dds技术产生的扫频信号源不仅频率稳定、信号精度高、抗干扰能力强，而且由于它是在计算机控制下直接实现的，因而易于实现智能化处理。无论是实用电路还是测量仪器，凡是需要产生扫频信号的地方，原则上都可以使用dds技术。在频率迅速变化的场合，dds中寄存器更新的速度有时会成为关键指标，这时必须使用高速电路和高速串行口，由合理的硬件设计和软件流程来实现预期设计目标。
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