赛灵思推出Vivado设计套件HLx版本，助力SoC和FPGA以及打造可复用的平台
赛灵思公司推出 vivado 设计套件 hlx 版本，为all programmable soc 和 fpga以及打造可复用的平台提供了全新超高生产力设计方法。新版 hlx 包括 hl 系统版本、hl 设计版本和 hl webpack 版本。所有 hlx 版本均包括带有 c/c++ 库的 vivado 高层次综合 （hls）、vivado ip 集成器 （ipi）、logiccore ip 子系统以及完整的 vivado 实现工具套件，使主流用户能够方便地采用生产力最高、最先进的c 语言和 ip设计流程。结合最新 ultrafast 高级生产力设计方法指南，相比采用传统方法而言，用户可将生产力提升 10-15 倍。全新hlx 版本将作为 vivado 设计套件的免费升级版提供。
为创建和编程可复用的平台工作带来超高生产力 过去 3 年来，赛灵思前沿客户率先采用基于 c 语言和 ip的设计技术与方法，并推动有关技术和方法不断完善，走向成熟，这些成熟的技术和方法现已纳入 hlx 版本中，实践证明有望将生产力提升 10-15 倍。为了实现这一超高生产力，客户采用了如下全部或部分设计技术与方法：1） 基于 c 语言的设计和优化再利用；2） ip 子系统的复用；3） 集成自动化；4） 加速设计收敛。
有别于将大部分设计精力用在设计流程后端的传统 rtl 设计，基于 c 和 ip 的设计可以支持广泛的优化设计复用，以加速更出色的微型架构的创建和快速探索更多设计的可能性，而且还能取代易出错的手动 c 到 rtl 转换，避免在集成基于 c 语言和 rtl 的 ip时浪费时间和出错，并可大幅缩短验证时间。利用高层次抽象，客户发现他们能够快速获得整体同样出色甚至更好的结果质量（性能、功耗和利用率）。
为了支持这些高生产力的设计流程，全新hlx 各版本均包括 vivado hls、vivado ipi、logiccore ip 子系统和完整的 vivado 实现工具套件。此外，赛灵思及其联盟生态系统还在不断扩展特定市场的 c 语言库，诸如针对视频和图像处理的 opencv，以及面向汽车驾驶员辅助系统 （adas） 和数据中心应用的机器学习等。赛灵思的全新 logicore ip 子系统是一种高度可配置的、专为特定市场量身定制的构建模块，其集成了多达 80 个不同的 ip 核、软件驱动程序、设计范例和多种测试平台。新型 ip 子系统可用于以太网、pcie、视频处理、图像传感器处理以及 otn 开发。这些 ip 子系统采用 amba axi 4 互联协议、ieee p1735 加密和 ip-xact 等业界标准，可与赛灵思及其联盟成员提供的 ip 实现互操作，并加速集成。
基于 c 的 ip 和预封装的 ip 子系统相结合，能利用 vivado ipi 实现集成自动化。vivado ipi 的集成自动化提供了具有器件和平台感知的互动开发环境。该环境可支持关键 ip 接口的智能自动连接、一键式 ip 子系统生成、实时 drc，以及接口更换通知，同时还具备强大的调试功能。具有平台感知的智能功能可对 zynq soc 和 mpsoc 处理系统预先配置适当的外设、驱动程序和存储器映射，以便支持目标开发板。设计团队现在能够针对 arm 处理系统和高性能 fpga 逻辑快速识别、重用并集成软硬件 ip 核。
赛灵思公司设计方法市场营销高级总监 tom feist 指出：“全新hlx 版本设计套件提供了用于创建和编程可复用的 all programmable 平台的架构。我们所有的 vivado 套件均提供有高级工具、ip 和 ultrafast 设计方法，让我们的主流客户能够集中精力实现差异化价值，更快速地打造出更出色的设计。”
hlx 配合补充sdx 以创建并部署平台 hlx 可帮助硬件工程师加速 all programmable 平台的创建、修改和编程工作，并进一步完善了赛灵思专为软件和系统工程师量身定制的sdx 开发环境（sdsoc、sdaccel 和 sdnet）。sdx 系列开发环境能用 c、c++、opencl 和用于数据包处理的新兴 p4 语言的组合通过 hlx 生成的平台进行软件定义编程。hlx 和 sdx 代表了赛灵思设计实现解决方案的新时代，为用户借助zynq soc、mpsoc、asic 级 fpga 和 3d ic 等新一代 all programmable 器件开发更智能、互联互通的差异化系统提供强大支持。
供货情况 全新hlx升级版现已在 vivado 设计套件 2015.4 版本中提供，支持赛灵思 7 系列、ultrascale 和 ultrascale+ 器件。下载最新版，敬请访问：china.xilinx.com/download。如需了解更多信息，敬请观看 vivado quicktake 视频，注册参加培训，并充分利用 ultrafast 设计方法指南（适用于 vivado 设计套件）以及最新 ultrafast 高效生产力设计方法指南（适用于 vivado 设计套件）。
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有别于将大部分设计精力用在设计流程后端的传统 rtl 设计，基于 c 和 ip 的设计可以支持广泛的优化设计复用，以加速更出色的微型架构的创建和快速探索更多设计的可能性，而且还能取代易出错的手动 c 到 rtl 转换，避免在集成基于 c 语言和 rtl 的 ip时浪费时间和出错，并可大幅缩短验证时间。利用高层次抽象，客户发现他们能够快速获得整体同样出色甚至更好的结果质量（性能、功耗和利用率）。
为了支持这些高生产力的设计流程，全新hlx 各版本均包括 vivado hls、vivado ipi、logiccore ip 子系统和完整的 vivado 实现工具套件。此外，赛灵思及其联盟生态系统还在不断扩展特定市场的 c 语言库，诸如针对视频和图像处理的 opencv，以及面向汽车驾驶员辅助系统 （adas） 和数据中心应用的机器学习等。赛灵思的全新 logicore ip 子系统是一种高度可配置的、专为特定市场量身定制的构建模块，其集成了多达 80 个不同的 ip 核、软件驱动程序、设计范例和多种测试平台。新型 ip 子系统可用于以太网、pcie、视频处理、图像传感器处理以及 otn 开发。这些 ip 子系统采用 amba axi 4 互联协议、ieee p1735 加密和 ip-xact 等业界标准，可与赛灵思及其联盟成员提供的 ip 实现互操作，并加速集成。
基于 c 的 ip 和预封装的 ip 子系统相结合，能利用 vivado ipi 实现集成自动化。vivado ipi 的集成自动化提供了具有器件和平台感知的互动开发环境。该环境可支持关键 ip 接口的智能自动连接、一键式 ip 子系统生成、实时 drc，以及接口更换通知，同时还具备强大的调试功能。具有平台感知的智能功能可对 zynq soc 和 mpsoc 处理系统预先配置适当的外设、驱动程序和存储器映射，以便支持目标开发板。设计团队现在能够针对 arm 处理系统和高性能 fpga 逻辑快速识别、重用并集成软硬件 ip 核。
赛灵思公司设计方法市场营销高级总监 tom feist 指出：“全新hlx 版本设计套件提供了用于创建和编程可复用的 all programmable 平台的架构。我们所有的 vivado 套件均提供有高级工具、ip 和 ultrafast 设计方法，让我们的主流客户能够集中精力实现差异化价值，更快速地打造出更出色的设计。”
hlx 配合补充sdx 以创建并部署平台 hlx 可帮助硬件工程师加速 all programmable 平台的创建、修改和编程工作，并进一步完善了赛灵思专为软件和系统工程师量身定制的sdx 开发环境（sdsoc、sdaccel 和 sdnet）。sdx 系列开发环境能用 c、c++、opencl 和用于数据包处理的新兴 p4 语言的组合通过 hlx 生成的平台进行软件定义编程。hlx 和 sdx 代表了赛灵思设计实现解决方案的新时代，为用户借助zynq soc、mpsoc、asic 级 fpga 和 3d ic 等新一代 all programmable 器件开发更智能、互联互通的差异化系统提供强大支持。
供货情况 全新hlx升级版现已在 vivado 设计套件 2015.4 版本中提供，支持赛灵思 7 系列、ultrascale 和 ultrascale+ 器件。下载最新版，敬请访问：china.xilinx.com/download。如需了解更多信息，敬请观看 vivado quicktake 视频，注册参加培训，并充分利用 ultrafast 设计方法指南（适用于 vivado 设计套件）以及最新 ultrafast 高效生产力设计方法指南（适用于 vivado 设计套件）。
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