Cadence扩展全新Virtuoso平台，提供优化系统设计并支持5nm及仿真驱动布线
中国上海，2018年 4月 11日– 楷登电子（美国 cadence公司，nasdaq： cdns）今日正式发布cadence® virtuoso®定制 ic设计平台的技术升级和扩展，进一步提高电子系统和 ic设计的生产力。新技术涉及virtuoso 系列几乎所有产品，旨在为系统工程师提供更稳健的设计环境和生态系统，助其实现并分析复杂芯片、封装、电路板和系统。
增强版 virtuoso系统设计平台
virtuoso平台 2018全新内容中，最重要的是去年发布且荣获奖项的 virtuoso system design platform，基于全面升级和扩展的virtuoso系统设计平台，设计师可以无缝编辑并分析最复杂的异构系统。封装、光电、ic模拟与 rf工程师皆可在同一个平台上操作并充分使用 virtuoso平台深具信任的完整设计应用。
新系统设计环境的核心是集合了多项新技术允许设计师在同一平台下对不同工艺不同技术的设计进行同步编辑。同时该系统设计平台与 cadence sip layout方案以及sigrity™ 分析技术实现无缝互联，为设计师提供完整的“芯片至电路板”设计工具。
virtuoso高阶节点设计与布局
全新发布的virtuoso 平台中，cadence采用了创新的高阶节点技术，实现从 22nm 到 5nm所有工艺的设计加速。通过与领先代工厂、生态系统合作伙伴及客户的紧密合作，cadence研发出可以利用创新方法自动管理工艺复杂度的先进技术，帮助设计师更加专注于设计目标。在电路设计和分析方面，针对finfet 设计开发的先进统计算法可以在设计早期发现工艺参量变化引起的电路性能波动，将工艺参量变化对设计影响的分析时间减少约20%。
布局设计方面，一种独特的多网格系统可以提取最新7nm 和5nm 工艺的复杂设计规则，同时允许设计师增加布局和布线技术的使用，大幅提升布局设计的生产力。在7nm 节点下，上述优化可将布局工作量减少3 倍以上。
virtuoso先进设计方法学与自动化
cadence研发了多项提升模拟设计和分析的技术。通过与cadence spectre®电路仿真器集成，并采用先进分析技术减少设计迭代，virtuoso模拟设计环境（ade）的仿真吞吐量提升高达 3 倍。virtuoso ade verifier也加入了专属新功能，汇集了跨领域电气规范，使实现标准合规（iso 26262 等标准）的难度降低了约 30%。
凭借保障电路完整性和性能的一系列专属设计技术，virtuoso布局环境正从“电气感知布局”进化为业界首个“电气和仿真驱动”的布局方式。全新仿真驱动布局可以解决关键电路和高阶节点设计中的许多电迁移（em）和寄生问题。为了提高布局的自动化水平，新环境加入了多项针对层次化版图规划的突破性技术，以及全新的布局和布线自动化技术，大幅提高布局设计生产力，并缩短布局时间。
鉴于当今芯片的复杂程度愈演愈烈，其中一个很大的设计难题是如何将布局任务在设计团队间进行合理分配。增强版virtuoso 平台加入了创新的并行实时团队设计编辑功能，允许团队对布局任务进行分配并探索各种假设情形。这一功能对设计规则检查（drc）的修改、芯片完成和人工布线都十分有用。
cadence预计，电气驱动布线和走线编辑、实时设计编辑与革命性设计规划技术的全新布局环境可以将生产力提升达 50%。
“在bosch，当我们设计关键任务的系统时，可靠性是我们的第一考量。我们对eda 工具的要求是，其不仅能帮助我们的工程师高效地设计、分析、布排电路，达到可靠性标准，而且还不能拖累项目的整体生产力，”bosch公司 eda 高级项目经理göran jerke 表示。“通过与cadence 的长期合作，我们在过去的电气感知布局和最新的电气驱动布局方面都取得了宝贵成果。”
“我们的目标是向客户提供最完整的解决方案，通过贯通芯片、封装、模组和电路板等各设计领域的无缝互联流程，帮助客户更好地设计并验证包括模拟、混合信号、rf和光电产品在内的各种异构系统，” cadence 公司资深副总裁兼定制ic 和pcb 事业部总经理tom beckley 表示。“全新virtuoso平台是在大获成功的virtuoso 电气感知设计布局套件基础之上开发而成的，它突破性的分析功能与电气驱动布局功能可以提升设计实现的可靠性。此外，它还能支持包括5nm 节点在内的最先进工艺技术。通过与领先代工厂、生态系统合作伙伴和客户展开合作，我们成功实现了定制和仿真设计方法学的大幅增强。”
关于楷登电子 cadence
cadence公司致力于推动电子系统和半导体公司设计创新的终端产品，以改变人们的工作、生活和娱乐方式。客户采用 cadence的软件、硬件、ip和服务，覆盖从半导体芯片到电路板设计乃至整个系统，帮助他们能更快速向市场交付产品。cadence公司创新的“系统设计实现” （sde）战略，将帮助客户开发出更具差异化的产品，无论是在移动设备、消费电子、云计算、汽车电子、航空、物联网、工业应用等其他的应用市场。cadence公司同时被财富杂志评选为“全球年度最适宜工作的100家公司”之一。
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新系统设计环境的核心是集合了多项新技术允许设计师在同一平台下对不同工艺不同技术的设计进行同步编辑。同时该系统设计平台与 cadence sip layout方案以及sigrity™ 分析技术实现无缝互联，为设计师提供完整的“芯片至电路板”设计工具。
virtuoso高阶节点设计与布局
全新发布的virtuoso 平台中，cadence采用了创新的高阶节点技术，实现从 22nm 到 5nm所有工艺的设计加速。通过与领先代工厂、生态系统合作伙伴及客户的紧密合作，cadence研发出可以利用创新方法自动管理工艺复杂度的先进技术，帮助设计师更加专注于设计目标。在电路设计和分析方面，针对finfet 设计开发的先进统计算法可以在设计早期发现工艺参量变化引起的电路性能波动，将工艺参量变化对设计影响的分析时间减少约20%。
布局设计方面，一种独特的多网格系统可以提取最新7nm 和5nm 工艺的复杂设计规则，同时允许设计师增加布局和布线技术的使用，大幅提升布局设计的生产力。在7nm 节点下，上述优化可将布局工作量减少3 倍以上。
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凭借保障电路完整性和性能的一系列专属设计技术，virtuoso布局环境正从“电气感知布局”进化为业界首个“电气和仿真驱动”的布局方式。全新仿真驱动布局可以解决关键电路和高阶节点设计中的许多电迁移（em）和寄生问题。为了提高布局的自动化水平，新环境加入了多项针对层次化版图规划的突破性技术，以及全新的布局和布线自动化技术，大幅提高布局设计生产力，并缩短布局时间。
鉴于当今芯片的复杂程度愈演愈烈，其中一个很大的设计难题是如何将布局任务在设计团队间进行合理分配。增强版virtuoso 平台加入了创新的并行实时团队设计编辑功能，允许团队对布局任务进行分配并探索各种假设情形。这一功能对设计规则检查（drc）的修改、芯片完成和人工布线都十分有用。
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“在bosch，当我们设计关键任务的系统时，可靠性是我们的第一考量。我们对eda 工具的要求是，其不仅能帮助我们的工程师高效地设计、分析、布排电路，达到可靠性标准，而且还不能拖累项目的整体生产力，”bosch公司 eda 高级项目经理göran jerke 表示。“通过与cadence 的长期合作，我们在过去的电气感知布局和最新的电气驱动布局方面都取得了宝贵成果。”
“我们的目标是向客户提供最完整的解决方案，通过贯通芯片、封装、模组和电路板等各设计领域的无缝互联流程，帮助客户更好地设计并验证包括模拟、混合信号、rf和光电产品在内的各种异构系统，” cadence 公司资深副总裁兼定制ic 和pcb 事业部总经理tom beckley 表示。“全新virtuoso平台是在大获成功的virtuoso 电气感知设计布局套件基础之上开发而成的，它突破性的分析功能与电气驱动布局功能可以提升设计实现的可靠性。此外，它还能支持包括5nm 节点在内的最先进工艺技术。通过与领先代工厂、生态系统合作伙伴和客户展开合作，我们成功实现了定制和仿真设计方法学的大幅增强。”
关于楷登电子 cadence
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