实战经验 | BlueNRG-X 原理图参数说明（附资料下载端口）
关键词：bluenrg-1, bluenrg-2, bluenrg-lp/lps
目录预览
1、前言
2、bluenrg-1/-2 的原理图参数说明及设计注意事项
3、bluenrg-lp/lps 的原理图参数说明及设计注意事项
4、小结
01
前言
为了让客户在原理图设计阶段少走弯路，我这里结合客户评估和设计阶段常遇到的问题，整理了一下 bluenrg-1/-2 相关设计及注意事项以备客户解惑用。
02
bluenrg-1/-2 的原理图参数说明及设计注意事项
2.1. bluenrg-1/-2 原理图及参数如下：
通过断点和单步调试，我们发现出现问题的指令如下所示：
图1.idb007v1_schematic
图2.idb008v2_schematic
表1. 基于 bluenrg-1/2 板子的元器件说明
2.2. 原理图设计注意事项：
1. c4 的取值只能是 150nf 或者 220nf，否则会影响系统的稳定。
2. 设计成 smps on 的是时候，d1 中的 pin1 和 pin2 之间焊接一颗电感，该电感的具体要求如下：标称值为 10 uh 或 4.7 uh ，但 dcr 务必小于 1ohm 且额定电流必须大于 100 ma。
3. rxd/txd 必须接到 dio11 和 dio08 pin，否则后续将无法使用 rf flash utility 工具和 bluenrg gui 工具。
4. 这里的 l1=2nh，l5=3.9nh 建议保留,这有助于抑制最后通道的杂散并减少晶体和rf 信号间的相互影响。
5. 建议预留 anatest0 pin 和 anatest1 pin 的测试点，以便后续测试高速晶体的启振时间。
6. dio7 建议通过 100kohm 电阻接地并预留测试点：为强制执行 updater 代码(参见预先编程的引导加载程序)，建议将 io7 引脚拉高并硬件复位设备。
03
bluenrg-lp/lps 的原理图参数说明及设计注意事项
3.1. bluenrg-lp 原理图及参数如下：
图3.idb011v1_schematic
图4.idb011v2_schematic
3.2. bluenrg-lps 原理图及参数说明如下：
图5.idb012v1_schematic
表2. 基于 bluenrg-lp/lps 板子的元器件说明
3.3. 原理图设计注意事项：
1. cap 的取值只能是 150nf 或者 220nf，否则会影响系统的稳定。
2. 设计成 smps on 的是时候，d1 中的 pin1 和 pin2 之间焊接一颗电感，该电感的具体要求如下：标称值为 10 uh 或 2.2 uh 或 1.5uh，但 dcr 务必小于 1ohm 且额定电流必须大于 100 ma。
表3.smps bom information
3. 对于 bluenrg-lp 芯片 rxd/txd 必须接到 pa8 和 pa9 pin，而对于 bluenrglps 芯片 rxd/txd 必须接到 pb0 和 pa1 pin。否则，后续将无法使用 rf flash utility 工具和 bluenrg gui 工具。
4. 实际应用中 q1(32khz 晶体)可以省略，q2(32mhz 晶体)需符合 fnom=32mhz，ftol建议选择±20ppm， pd 不要超过 100uw，cl 选用 6~8pf 的。
5. 建议预留 vcap 和 pb6 pin 的测试点，以便后续测试高速晶体的启振时间。
6. pa10 建议预留测试点。
04
小结
为方便客户、代理 fae 更好地理解 demo 板的原理图，以便客户项目顺利进行， 以及方便后续的测试和调试，这里特意分享以上章节针对不同 demo 板的原理图和设计事项做了说明。
更多内容，欢迎点击下方“阅读原文”，免费下载“lat1235 bluenrg-x原理图参数说明”。
完整内容请点击“阅读原文”下载原文档。
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1、前言
2、bluenrg-1/-2 的原理图参数说明及设计注意事项
3、bluenrg-lp/lps 的原理图参数说明及设计注意事项
4、小结
01
前言
为了让客户在原理图设计阶段少走弯路，我这里结合客户评估和设计阶段常遇到的问题，整理了一下 bluenrg-1/-2 相关设计及注意事项以备客户解惑用。
02
bluenrg-1/-2 的原理图参数说明及设计注意事项
2.1. bluenrg-1/-2 原理图及参数如下：
通过断点和单步调试，我们发现出现问题的指令如下所示：
图1.idb007v1_schematic
图2.idb008v2_schematic
表1. 基于 bluenrg-1/2 板子的元器件说明
2.2. 原理图设计注意事项：
1. c4 的取值只能是 150nf 或者 220nf，否则会影响系统的稳定。
2. 设计成 smps on 的是时候，d1 中的 pin1 和 pin2 之间焊接一颗电感，该电感的具体要求如下：标称值为 10 uh 或 4.7 uh ，但 dcr 务必小于 1ohm 且额定电流必须大于 100 ma。
3. rxd/txd 必须接到 dio11 和 dio08 pin，否则后续将无法使用 rf flash utility 工具和 bluenrg gui 工具。
4. 这里的 l1=2nh，l5=3.9nh 建议保留,这有助于抑制最后通道的杂散并减少晶体和rf 信号间的相互影响。
5. 建议预留 anatest0 pin 和 anatest1 pin 的测试点，以便后续测试高速晶体的启振时间。
6. dio7 建议通过 100kohm 电阻接地并预留测试点：为强制执行 updater 代码(参见预先编程的引导加载程序)，建议将 io7 引脚拉高并硬件复位设备。
03
bluenrg-lp/lps 的原理图参数说明及设计注意事项
3.1. bluenrg-lp 原理图及参数如下：
图3.idb011v1_schematic
图4.idb011v2_schematic
3.2. bluenrg-lps 原理图及参数说明如下：
图5.idb012v1_schematic
表2. 基于 bluenrg-lp/lps 板子的元器件说明
3.3. 原理图设计注意事项：
1. cap 的取值只能是 150nf 或者 220nf，否则会影响系统的稳定。
2. 设计成 smps on 的是时候，d1 中的 pin1 和 pin2 之间焊接一颗电感，该电感的具体要求如下：标称值为 10 uh 或 2.2 uh 或 1.5uh，但 dcr 务必小于 1ohm 且额定电流必须大于 100 ma。
表3.smps bom information
3. 对于 bluenrg-lp 芯片 rxd/txd 必须接到 pa8 和 pa9 pin，而对于 bluenrglps 芯片 rxd/txd 必须接到 pb0 和 pa1 pin。否则，后续将无法使用 rf flash utility 工具和 bluenrg gui 工具。
4. 实际应用中 q1(32khz 晶体)可以省略，q2(32mhz 晶体)需符合 fnom=32mhz，ftol建议选择±20ppm， pd 不要超过 100uw，cl 选用 6~8pf 的。
5. 建议预留 vcap 和 pb6 pin 的测试点，以便后续测试高速晶体的启振时间。
6. pa10 建议预留测试点。
04
小结
为方便客户、代理 fae 更好地理解 demo 板的原理图，以便客户项目顺利进行， 以及方便后续的测试和调试，这里特意分享以上章节针对不同 demo 板的原理图和设计事项做了说明。
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