如何使用纯FPGA来实现嵌入式视觉方案
嵌入式视觉是当今科技最激动人心的领域之一。
关于使用zynq soc的嵌入式视觉应用，热心群众们说的太多，我就不赘述了。今天我们换一个新的视角，来看看如何使用纯fpga来实现嵌入式视觉方案。
这篇文章，将带你了解如何使用digilent nexys video artix-7 fpga多媒体音视频开发板来实现一个简单的hdmi输入/输出视频处理系统。特别是如果你是一名新手，通过本文，你会对基于fpga的视频处理有更多基本的理解。
坦白说，digilent nexys video开发板可能是市面上性价比最高的音视频处理fpga口袋实验室了。作为一款专用于音视频处理教学以及视频和视觉应用原型开发的评估板，此板搭载了xilinxartix-7系列中资源最大的器件aritx-7 xc7a200t fpga。
今天我们就来介绍一下如何使用nexys video来实现一个简单的hdmi输入/输出视频处理系统。先来看下此板所集成的支持视频接收、处理和生成/输出的下列i/o和外设接口：
hdmi输入
hdmi输出
显示输出端口
以太网
uart
usb
512mb ddrsdram
线路输入（line in）/麦克输入/耳机输出/线路输出（line out）
fmc
使用vhdl与rtl方法，要创建一个简单的图像处理流水线，我们需要实现如下架构：
监控处理器（本例中采用xilinx artix-7 fpga实现的microblaze软核risc处理器）用于监控与用户接口间的通信并根据应用的要求配置图像处理流水线。在本例这个简单的架构中，hdmi输入口接收的数据从原始的并行格式的视频数据、hsync和vsync转换为axi streaming（axis）格式。我们想要将数据转换成axis格式是因为vivado提供多个使用这种数据格式的图像处理ip。如果我们使用vivado hls来创建我们自己的图像处理模块，那么能够支持axis接口也很重要。
microblaze处理器需要支持如下外围设备：
axi uart –支持系统的通信和控制
axi timer – 使microblaze可以实时运行事件
microblaze调试模块–支持microblaze的调试
microblaze本地存储–连接到dlmb和ilmb（数据&指令本地存储总线）
我们将使用存储接口生成器来创建与板上sdram对接的ddr接口。这个接口和sdram创建了一个公共的存储框架，可以访问图像处理管道以及使用axi interconnect访问监控处理器。
创建一个简单的图像处理流水线需要使用如下ip：
dvi2rgb – digilent提供的hdmi输入ip
rgb2dvi – digitlent提供的hdmi输出ip
video in to axi4-stream – 将并行视频输入转换为axi streaming协议（vivado ip）
axi4-stream to video out – 将axi-stream转换为并行视频输出（vivado ip）
video timing controller input – 检测输入视频流参数（vivado ip）
video timing controller output – 生成输出视频流时序参数（vivado ip）
video direct memory access – 支持图像写入和从ddr sdram读出
视频处理链的核心是vdma，我们借助它来将图像移动到ddr内存中。
上图展示了ip如何将流式数据转换为读和写管道中内存映射的数据。两个vdma通道都提供了在流式数据和内存映射数据之间转换的能力。写通道支持流到内存映射的转换而读通道提供内存映射到流的转换。
当把所有这些集中到vivado中创建初始的基本系统，我们得到了如下架构，这是nexys video hdmi示例提供的。
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dvi2rgb – digilent提供的hdmi输入ip
rgb2dvi – digitlent提供的hdmi输出ip
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axi4-stream to video out – 将axi-stream转换为并行视频输出（vivado ip）
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上图展示了ip如何将流式数据转换为读和写管道中内存映射的数据。两个vdma通道都提供了在流式数据和内存映射数据之间转换的能力。写通道支持流到内存映射的转换而读通道提供内存映射到流的转换。
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