Adam Taylor玩转MicroZed系列，第75部分：放置约束
by adam taylor
在先前的博客中我们研究过i/o约束，下一个合乎逻辑的步骤就是研究如何在我们的设计中用fpga进行放置和布线约束。使用放置约束的原因如下：为了帮助实现时序，或者为了在设计中提供块与块之间的隔离。在深入开展这个话题之前，有一些术语需要我们定义：
? bel——逻辑中允许网表元素放置在一个片中的基本元素。
? loc——在设备中放置网表元素的特定位置
? pblock——物理模块——用来把逻辑模块限制到fpga中的某一个区域去。
loc允许你在设备中定义出一个片或一个其它位置。bel约束允许你定位到一个比loc更细的粒度，并且找出片中要使用的特定触发器。而pblocks可以用来把逻辑组合到一起，并且当我们想进行局部重新配置的时候，也可以用它们来定义逻辑区。点击阅读更多精彩内容
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? loc——在设备中放置网表元素的特定位置
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