超全面！SPI通信协议详解
什么是spi？
spi的英文全称为serial peripheral interface，顾名思义为串行外设接口。spi是一种同步串行通信接口规范，主要应用于嵌入式系统中的短距离通信。该接口由摩托罗拉在20世纪80年代中期开发，后发展成了行业规范。
spi简介？
spi是一种高速的、全双工的、同步的通信总线，并且至多仅需使用4根线，节约了芯片的管脚，spi主要应用于eeprom、flash、adc、dac等芯片，还有数字信号处理器和数字信号解码器之间。spi设备之间采用全双工模式通信，是一个主机和一个或者多个从机的主从模式。主机负责初始化帧，这个数据传输帧可以用于读与写两种操作，片选线可以从多个从机选择一个来响应主机的请求。spi接口定义如下表：由上表也可以看出当spi设备间通信时，数据线应该是mosi连接mosi，miso连接miso，sclk与sclk相连，而不是像串口那样tx、rx进行反接。当只有单一spi从机设备时，如果从机设备允许的话，可直接将cs/ss线固定在低电平。然而类似于max1242这款需要cs/ss线的下降沿来触发的芯片，则必须将cc/ss线与主机相连。如下图，为一主一从连接方式。
对于多个从机设备时，则每个从机都需要一根cs/ss线来与主机相连，从而达到主机能与任一从机通信的目的。如下图，为一主多从的连接方式。大多数从机设备都有着三态逻辑的特性，因此当设备未被选中时，它们的miso信号线会变成高阻抗状态（电气断开）。没有三态输出的设备则需外接三态缓冲器才能与其他的从机设备共享spi总线。
数据传输
在spi通信中，spi主机设备以从机设备支持的频率通过sclk线给到spi从机设备，这点也意味着从机是无法主动向主机发送数据的，只能主机轮询向从机发或者从机设备主动通过一个io口来告知主机数据到达。在spi每个时钟周期内，都会进行一次全双工数据的传输。主机通过mosi线上发送1bit时，从机也会在读取到之后通过miso线发送1bit数据出去。这说明，即使只进行单工通信，也会保持此通信顺序。spi传输通常涉及到两个给定了字长的移位寄存器。例如在主机、从机中的8bit的移位寄存器。它们以虚拟环形拓扑连接，数据通常先从最高有效位被移出。在时钟沿，主机和从机都移出1bit数据从传输线上给到对方。在下一个时钟边沿来到时，双方的接收器再对传输线上的该bit进行采样，并将其设置为移位寄存器的新的最低有效位。在寄存器位被移出和移入后，主机和从机交换了寄存器值。如果需要交换更多数据，则重新加载移位寄存器并重复该过程。传输可以持续任意数量的时钟周期。完成后，主机停止切换时钟信号。如下图，为主从机之间的交互时的移位寄存器示意图。其中上图的通信流程如下：
1. spi主机首先现将ss或cs线拉低，以此来告知spi从机通信开始。2. 主机通过发送sclk时钟信号，来告知从机即将进行的读写操作。这里的sclk时钟信号是由spi的模式来决定是高电平还是低电平有效的，这点在稍后会进行介绍。3. 主机(master)将要发送的数据写到发送数据缓存区(memory)，缓存区经过移位寄存器(0~7)，串行移位寄存器通过mosi信号线将字节一位一位的移出去传送给从机，同时miso接口接收到的数据经过移位寄存器一位一位的移到接收缓存区。4. 从机(slave)也将自己的串行移位寄存器(0~7)中的内容通过miso信号线返回给主机。同时通过mosi信号线接收主机发送的数据，这样，两个移位寄存器中的内容就被交换。
spi通信的4种工作模式
spi通信中有4种不同的操作模式，不同的从机设备可能在出厂时就被设置好了某种模式，并且无法更改。但是spi通信必须处于同一种模式下才能进行。因此我们应该对自己手里的spi主机设备进行模式的配置，也就是通过cpol(时钟极性)和cpha(时钟相位)来控制spi主设备的通信模式，具体如下：时钟极性(cpol)定义了sclk时钟线空闲状态时的电平：1. cpol=0，即sclk=0，表示sclk时钟信号线在空闲状态时的电平为低电平，因此有效状态为高电平。2. cpol=1，即sclk=1，表示sclk时钟信号线在空闲状态时的电平为高电平，因此有效状态为低电平。时钟相位(cpha)定义了数据位相对于时钟线的时序(即相位)：1. cpha=0，即表示输出(out)端在上一个时钟周期的后沿改变数据，而输入(in)端在时钟周期的前沿(或不久之后)捕获数据。输出端保持数据有效直到当前时钟周期的尾部边缘。对于第一个时钟周期来说，第一位的数据必须在时钟前沿之前出现在mosi线上。也就是一个cpha=0的周期包括半个时钟空闲和半个时钟置位的周期。2. cpha=1，即表示输出(out)端在当前时钟周期的前沿改变数据，而输入(in)端在时钟周期的后沿(或不久之后)捕获数据。输出端保持数据有效直到下一个时钟周期的前沿。对于最后一个时钟周期来说，从机设备在片选信号消失之前保持miso信号线有效。也就是一个chpa=1的周期包括半个时钟置位和半个时钟空闲的周期。注意：此处的前沿和后沿的意思表示在每个周期中第一个出现的边沿和最后一个出现的边沿。总的来说则为：当时钟为正向时钟时，时钟线的上升沿为前沿，时钟的下降沿为后沿，反之。如下表，为spi通信的4种模式：下图显示了时钟极性和相位的时序图。红线表示时钟的前沿，蓝线表示时钟的后沿。
spi协议的优缺点
spi的优点在于它有着比i2c更高的吞吐量，不被最大时钟速度所限制，可实现潜在的高速、极为简单的硬件接口，外围电路使用的上拉电阻是比i2c协议更少的，这意味着它具有比i2c的功耗更低、从机的时钟来源来自主机设备，无需新增精密振荡器、从机不需要唯一的地址、相对于并行接口而言，使用的引脚数目大大减少等优点。但同时有着一定的缺点，例如spi没有带内寻址、当使用多个不同模式的从机设备时，主机设备切换模式时重新初始化，会使得访问从机设备速度变慢、spi从机设备没有硬件流控，只能通过主机自主的延迟下个时钟周期到来的时间、仅能在短距离通信等缺点。但能在避免spi的缺点的方向来应用spi的话，spi的优点让它远远优于其他协议。's
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spi简介？
spi是一种高速的、全双工的、同步的通信总线，并且至多仅需使用4根线，节约了芯片的管脚，spi主要应用于eeprom、flash、adc、dac等芯片，还有数字信号处理器和数字信号解码器之间。spi设备之间采用全双工模式通信，是一个主机和一个或者多个从机的主从模式。主机负责初始化帧，这个数据传输帧可以用于读与写两种操作，片选线可以从多个从机选择一个来响应主机的请求。spi接口定义如下表：由上表也可以看出当spi设备间通信时，数据线应该是mosi连接mosi，miso连接miso，sclk与sclk相连，而不是像串口那样tx、rx进行反接。当只有单一spi从机设备时，如果从机设备允许的话，可直接将cs/ss线固定在低电平。然而类似于max1242这款需要cs/ss线的下降沿来触发的芯片，则必须将cc/ss线与主机相连。如下图，为一主一从连接方式。
对于多个从机设备时，则每个从机都需要一根cs/ss线来与主机相连，从而达到主机能与任一从机通信的目的。如下图，为一主多从的连接方式。大多数从机设备都有着三态逻辑的特性，因此当设备未被选中时，它们的miso信号线会变成高阻抗状态（电气断开）。没有三态输出的设备则需外接三态缓冲器才能与其他的从机设备共享spi总线。
数据传输
在spi通信中，spi主机设备以从机设备支持的频率通过sclk线给到spi从机设备，这点也意味着从机是无法主动向主机发送数据的，只能主机轮询向从机发或者从机设备主动通过一个io口来告知主机数据到达。在spi每个时钟周期内，都会进行一次全双工数据的传输。主机通过mosi线上发送1bit时，从机也会在读取到之后通过miso线发送1bit数据出去。这说明，即使只进行单工通信，也会保持此通信顺序。spi传输通常涉及到两个给定了字长的移位寄存器。例如在主机、从机中的8bit的移位寄存器。它们以虚拟环形拓扑连接，数据通常先从最高有效位被移出。在时钟沿，主机和从机都移出1bit数据从传输线上给到对方。在下一个时钟边沿来到时，双方的接收器再对传输线上的该bit进行采样，并将其设置为移位寄存器的新的最低有效位。在寄存器位被移出和移入后，主机和从机交换了寄存器值。如果需要交换更多数据，则重新加载移位寄存器并重复该过程。传输可以持续任意数量的时钟周期。完成后，主机停止切换时钟信号。如下图，为主从机之间的交互时的移位寄存器示意图。其中上图的通信流程如下：
1. spi主机首先现将ss或cs线拉低，以此来告知spi从机通信开始。2. 主机通过发送sclk时钟信号，来告知从机即将进行的读写操作。这里的sclk时钟信号是由spi的模式来决定是高电平还是低电平有效的，这点在稍后会进行介绍。3. 主机(master)将要发送的数据写到发送数据缓存区(memory)，缓存区经过移位寄存器(0~7)，串行移位寄存器通过mosi信号线将字节一位一位的移出去传送给从机，同时miso接口接收到的数据经过移位寄存器一位一位的移到接收缓存区。4. 从机(slave)也将自己的串行移位寄存器(0~7)中的内容通过miso信号线返回给主机。同时通过mosi信号线接收主机发送的数据，这样，两个移位寄存器中的内容就被交换。
spi通信的4种工作模式
spi通信中有4种不同的操作模式，不同的从机设备可能在出厂时就被设置好了某种模式，并且无法更改。但是spi通信必须处于同一种模式下才能进行。因此我们应该对自己手里的spi主机设备进行模式的配置，也就是通过cpol(时钟极性)和cpha(时钟相位)来控制spi主设备的通信模式，具体如下：时钟极性(cpol)定义了sclk时钟线空闲状态时的电平：1. cpol=0，即sclk=0，表示sclk时钟信号线在空闲状态时的电平为低电平，因此有效状态为高电平。2. cpol=1，即sclk=1，表示sclk时钟信号线在空闲状态时的电平为高电平，因此有效状态为低电平。时钟相位(cpha)定义了数据位相对于时钟线的时序(即相位)：1. cpha=0，即表示输出(out)端在上一个时钟周期的后沿改变数据，而输入(in)端在时钟周期的前沿(或不久之后)捕获数据。输出端保持数据有效直到当前时钟周期的尾部边缘。对于第一个时钟周期来说，第一位的数据必须在时钟前沿之前出现在mosi线上。也就是一个cpha=0的周期包括半个时钟空闲和半个时钟置位的周期。2. cpha=1，即表示输出(out)端在当前时钟周期的前沿改变数据，而输入(in)端在时钟周期的后沿(或不久之后)捕获数据。输出端保持数据有效直到下一个时钟周期的前沿。对于最后一个时钟周期来说，从机设备在片选信号消失之前保持miso信号线有效。也就是一个chpa=1的周期包括半个时钟置位和半个时钟空闲的周期。注意：此处的前沿和后沿的意思表示在每个周期中第一个出现的边沿和最后一个出现的边沿。总的来说则为：当时钟为正向时钟时，时钟线的上升沿为前沿，时钟的下降沿为后沿，反之。如下表，为spi通信的4种模式：下图显示了时钟极性和相位的时序图。红线表示时钟的前沿，蓝线表示时钟的后沿。
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