基于PC104嵌入式平台的MAX1308AD数据采集系统设计与实现
1 引言
随着微电子技术和网络的发展，人们对网络的认识日益深入。网络终端产品也越来越受到人们的关注，嵌入式操作系统的应用也得到了前所未有的发展。pc104是一种嵌入式平台，它与ibm的pc机兼容，具有灵活的可扩展性，其小巧的尺寸非常适合嵌入式系统的应用。
本文基于pcm-3350型pc104嵌入式开发平台，最高采集速度可达1msps,分辨率为12bit,能够进行通道扫描采集和单通道采集的数据采集系统。
2 数据采集系统设计
数据采集系统主要由放大电路、光藕隔离电路、带采样保持器的ad模数转换器、时钟电路、cpld控制电路、数据缓存（fifo）等部分组成，总结构框图如图1所示：
图1 总结构框图
2.1 a/d转换数据采集电路
a/d转换选用max1308ad芯片，它是一种采样速率最高可达1msps，分辨率为12bit的采集芯片，多达8个通道的同时采样，+5v模拟电源，+3v至+5v数字电源，其硬件系统连接如图2所示：
图2 max1308ad硬件连接
2.2 fifo存储电路
fifo电路芯片选用idt公司的idt7203，它是一个双端口的存储缓冲芯片，有2048×9 的存储结构，12ns 的高速存取时间，结构简单便于操作，内部读、写指针在先进先出的基础上可进行数据的自动写入和读出。
2.3 cpld控制电路设计
cpld（epm7160stc100-6）的设计是本采集系统的核心，它能够对pc104地址总线进行译码，所产生的逻辑控制信号对各个单元的工作状态起控制作用。
数据的读取可以采用查询的方式。在pc104 isa部分，用到isa的16位数据总线d[0..15]。a[0..9]是pc104的地址总线;iow和ior是对指定设备的读写信号;aen是允许dma控制地址总线、数据总线及读写命令线进行dma传输及对存储器和io设备的读写。系统工作流程如图3所示：
图3 系统工作流程
数据采集系统的工作逻辑框图如图4所示：
图4 数据采集系统的逻辑框图
其中，地址译码、控制器：只有地址选中该模块时，a/d 才能工作，同时使pc104工作在16位数据线方式，a0到a3分别控制着转换通道的选择;启动触发器和中断响应寄存器都位于状态控制器内部;读数据寄存器：当fifo不为空，在fifo中的转换结果直接进人数据总线，第12位到15位 由cpld提供，使数据与其相等再进入16位数据总线，完成整个转换过程。
2.4 采集卡的地址分配
由于该数据采集卡是作为pc104的标准外设进行工作的。pc104规定，外设的操作地址为a[9:0],在系统软件设计中要防止地址冲突。pc104中使用a0～a9地址位来表示i/o端口地址，即可有1024个口地址，前512个供系统板使用，后512个供扩充插槽使用，当a9=0时表示为系统板上的口地址;当a9=1时表示扩充插槽接口卡上的口地址[2]。
采集卡的基地址分配和译码地址分配见表1，本文设计的数据采集卡的地址范围是：2e0h—2f7h，不会发生地址冲突。
表1：数据采集卡的地址分配及译码
3 pc104平台
pc104平台硬件采用pc/104总线标准结构设计的产品pcm一3350主板。它是研华新一代高速低耗pc/104系列的代表产品。控制器模块包括一个主控32位微处理器单元，具有32mram和内置的非易失存储器用于数据和程序存储，提供vga，lcd显示器接口;该模块还具有一系列标准通讯口从而提供多种通讯方式，包括串行通讯（rs232，rs485）、以太网等以及一个pc104总线接口。
4 软件设计
本系统中，根据固态盘的特点，操作系统软件采用dos6.22，以tuborc 2.o作为开发环境，应用程序采用c语言和汇编语言相结合来实现除此在编写软件时，首先要设置好i/0板卡的基地址，再根据基地址来确认其他外围寄存器端口地址，包括读写端口、控制字和通道选择等地址。
5 结束语
数据采集技术是信息科学的重要组成部分，已广泛应用于国民经济和国防建设的各个领域，并且随着科学技术的发展，数据采集技术将有广阔的发展前景。本文基于pc104的嵌入式平台，采用max1308ad转换芯片，设计了一个16通道，最高采集速度可达1msps， 分辨率为12bit的数据采集系统，由于其小型化易携带的特点，此数据采集系统可方便地用于野外作业。
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随着微电子技术和网络的发展，人们对网络的认识日益深入。网络终端产品也越来越受到人们的关注，嵌入式操作系统的应用也得到了前所未有的发展。pc104是一种嵌入式平台，它与ibm的pc机兼容，具有灵活的可扩展性，其小巧的尺寸非常适合嵌入式系统的应用。
本文基于pcm-3350型pc104嵌入式开发平台，最高采集速度可达1msps,分辨率为12bit,能够进行通道扫描采集和单通道采集的数据采集系统。
2 数据采集系统设计
数据采集系统主要由放大电路、光藕隔离电路、带采样保持器的ad模数转换器、时钟电路、cpld控制电路、数据缓存（fifo）等部分组成，总结构框图如图1所示：
图1 总结构框图
2.1 a/d转换数据采集电路
a/d转换选用max1308ad芯片，它是一种采样速率最高可达1msps，分辨率为12bit的采集芯片，多达8个通道的同时采样，+5v模拟电源，+3v至+5v数字电源，其硬件系统连接如图2所示：
图2 max1308ad硬件连接
2.2 fifo存储电路
fifo电路芯片选用idt公司的idt7203，它是一个双端口的存储缓冲芯片，有2048×9 的存储结构，12ns 的高速存取时间，结构简单便于操作，内部读、写指针在先进先出的基础上可进行数据的自动写入和读出。
2.3 cpld控制电路设计
cpld（epm7160stc100-6）的设计是本采集系统的核心，它能够对pc104地址总线进行译码，所产生的逻辑控制信号对各个单元的工作状态起控制作用。
数据的读取可以采用查询的方式。在pc104 isa部分，用到isa的16位数据总线d[0..15]。a[0..9]是pc104的地址总线;iow和ior是对指定设备的读写信号;aen是允许dma控制地址总线、数据总线及读写命令线进行dma传输及对存储器和io设备的读写。系统工作流程如图3所示：
图3 系统工作流程
数据采集系统的工作逻辑框图如图4所示：
图4 数据采集系统的逻辑框图
其中，地址译码、控制器：只有地址选中该模块时，a/d 才能工作，同时使pc104工作在16位数据线方式，a0到a3分别控制着转换通道的选择;启动触发器和中断响应寄存器都位于状态控制器内部;读数据寄存器：当fifo不为空，在fifo中的转换结果直接进人数据总线，第12位到15位 由cpld提供，使数据与其相等再进入16位数据总线，完成整个转换过程。
2.4 采集卡的地址分配
由于该数据采集卡是作为pc104的标准外设进行工作的。pc104规定，外设的操作地址为a[9:0],在系统软件设计中要防止地址冲突。pc104中使用a0～a9地址位来表示i/o端口地址，即可有1024个口地址，前512个供系统板使用，后512个供扩充插槽使用，当a9=0时表示为系统板上的口地址;当a9=1时表示扩充插槽接口卡上的口地址[2]。
采集卡的基地址分配和译码地址分配见表1，本文设计的数据采集卡的地址范围是：2e0h—2f7h，不会发生地址冲突。
表1：数据采集卡的地址分配及译码
3 pc104平台
pc104平台硬件采用pc/104总线标准结构设计的产品pcm一3350主板。它是研华新一代高速低耗pc/104系列的代表产品。控制器模块包括一个主控32位微处理器单元，具有32mram和内置的非易失存储器用于数据和程序存储，提供vga，lcd显示器接口;该模块还具有一系列标准通讯口从而提供多种通讯方式，包括串行通讯（rs232，rs485）、以太网等以及一个pc104总线接口。
4 软件设计
本系统中，根据固态盘的特点，操作系统软件采用dos6.22，以tuborc 2.o作为开发环境，应用程序采用c语言和汇编语言相结合来实现除此在编写软件时，首先要设置好i/0板卡的基地址，再根据基地址来确认其他外围寄存器端口地址，包括读写端口、控制字和通道选择等地址。
5 结束语
数据采集技术是信息科学的重要组成部分，已广泛应用于国民经济和国防建设的各个领域，并且随着科学技术的发展，数据采集技术将有广阔的发展前景。本文基于pc104的嵌入式平台，采用max1308ad转换芯片，设计了一个16通道，最高采集速度可达1msps， 分辨率为12bit的数据采集系统，由于其小型化易携带的特点，此数据采集系统可方便地用于野外作业。
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