关于Virtex和Kintex UltraScale架构的FPGA和Vivado开发工具的机构要点
小编关于virtex和kintex ultrascale架构的fpga和vivado开发工具的一些主要的看点：
• 基于ultrascale架构的fpga实现数据传输机制是通过将高性能的并行专用io接口和高速的串行收发器结合起来实现的，ultrascale架构的串行收发器传送数据的速率能够达到16.3gbps，满足主流的串行协议要求，当然传输速率也能够达到32.75gbps，允许25g+比特位的地板设计，而且相对以前的收发器而言，能够大大降低每比特位传输的功耗。ultrascale架构的fpga芯片中的收发器都兼容pcie3.0和pcie4.0，专用的pcie集成模块支持pcie3.0 x8型端口和根端口的设计需求。
• ultrascale架构包含了功能强大的可重配置时钟管理电路，主要包括时钟综合，缓存模块和布局组件，共同协作组成了高性能的时钟框架，能够满足各种设计的要求。这个时钟网络允许在fpga内部灵活的对时钟信号进行布局布线，来降低时钟偏差、功耗和延迟，将时钟信号的传输误差降到最小。
• 与以往的fpga相比，ultrascale架构的fpga中的时钟分割和门控间隔技术能够提供对时钟功耗的额外控制。
• 如今的fpga结构包含很多组件，例如可配置逻辑块(clb),clb中又包含六输入查找表(luts)和触发器;带有27x18乘法器的dsp;36kbit的块ram存储单元，支持内置fifo和ecc。此外还有很多的逻辑功能，clb支持移位寄存器，乘法器和进位逻辑，也能将lut配置成分布式存储模块，当可配置的高效的块ram资源不够时，这将是一个非常好的弥补方法。dsp组件也进行了更新强化，支持96比特位宽的xor(异或)功能，支持27比特位的超前进位加法器和30比特位宽的输入信号，dsp部分能够独立完成很多功能，包括乘累加、乘加和模式识别等运算。
• ultrascale架构包含了几种流行的通信协议的集成模块。例如在kintex和virtex ultrascale系列的器件中集成了支持pcie、100g以太网和150g interlaken协议的多功能集成模块。
• 除了通信协议外，每个i/o模块包含了一个可编程存储器的phy，通过mig(存储器接口生成器)工具实现功能配置。
ultrascale架构和优化后的vivado开发工具的推出，xilinx为开发人员提供了高效率的解决方案，大大缩减了开发周期。
• vivado ip封装器和ip核目录采用ip-xact标准，这个标准时由spirit consortium创建的，已经成为封装、集成和重复使用ip核的标准结构，vivado ip封装器可以将约束文件、测试激励文件和说明文档集成在一起，用于扩展你自己的ip核目录，可以保存问你自己的本地文件或者存放在一个共享的网络驱动器上。
• vivado ip核目录允许开发人员将他们自己的ip核与xilinx和第三方提供的ip核放在一起管理，这样采用一致的易于使用的方式，所有ip核可以再不同的设计团队之间共享使用。
• vivado ip核集成器(ipi)采用以ip核为中心的设计流程，这样可以加快系统集成的时间，将系统的各部分组件更快更容易的集成在一起，形成一个系统。使用内部交互的图像化用户界面，ipi提供智能自动连接ip核接口，一键生成ip子系统和强大的调试功能，让设计开发人员能够以快速简单容易的方式将他们ip核目录里面的ip核连接集成在一起。
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• ultrascale架构包含了功能强大的可重配置时钟管理电路，主要包括时钟综合，缓存模块和布局组件，共同协作组成了高性能的时钟框架，能够满足各种设计的要求。这个时钟网络允许在fpga内部灵活的对时钟信号进行布局布线，来降低时钟偏差、功耗和延迟，将时钟信号的传输误差降到最小。
• 与以往的fpga相比，ultrascale架构的fpga中的时钟分割和门控间隔技术能够提供对时钟功耗的额外控制。
• 如今的fpga结构包含很多组件，例如可配置逻辑块(clb),clb中又包含六输入查找表(luts)和触发器;带有27x18乘法器的dsp;36kbit的块ram存储单元，支持内置fifo和ecc。此外还有很多的逻辑功能，clb支持移位寄存器，乘法器和进位逻辑，也能将lut配置成分布式存储模块，当可配置的高效的块ram资源不够时，这将是一个非常好的弥补方法。dsp组件也进行了更新强化，支持96比特位宽的xor(异或)功能，支持27比特位的超前进位加法器和30比特位宽的输入信号，dsp部分能够独立完成很多功能，包括乘累加、乘加和模式识别等运算。
• ultrascale架构包含了几种流行的通信协议的集成模块。例如在kintex和virtex ultrascale系列的器件中集成了支持pcie、100g以太网和150g interlaken协议的多功能集成模块。
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• vivado ip核集成器(ipi)采用以ip核为中心的设计流程，这样可以加快系统集成的时间，将系统的各部分组件更快更容易的集成在一起，形成一个系统。使用内部交互的图像化用户界面，ipi提供智能自动连接ip核接口，一键生成ip子系统和强大的调试功能，让设计开发人员能够以快速简单容易的方式将他们ip核目录里面的ip核连接集成在一起。
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