FPGA上的引脚和区域约束语法介绍
引脚和区域约束也就是loc约束（location）。定义了模块端口和fpga上的引脚的对应关系。
那么我们应该怎么写呢？
loc有固定语法：
inst “instance_name” loc = location; #location可以是多个合法位置，用逗号隔开。这种多位置约束是在布线的时候布线器选择一个进行布线。
范围定位语法：
inst “instance_name” loc = location:location［soft］;
使用loc完成端口定义语法：
net “top_module_port” = “chip_port”; #loc的语句存在优先级，连线具有最高优先级
loc有较多属性，对引脚约束位置，clbs，slice，tbuf，块ram，硬核乘法器，全局时钟（gclkbuf0，gclkpad0），dll，dcm等。
loc的常用定位语句：
inst “instance_name” loc = p12; #将io引脚分给实例信号
inst “instance_name” loc = cln_r3c5; #将逻辑置于3行，5列的clb中的任何一个slice。
别的定位语句也就是把后面的loc的位置改为mult18x18_x0y6（位置为乘法器mult18x18的xy网格的（0，6）），clb_r4c5.s1，clb_r4c6.*定义的是触发器置于4行5列clb和4行6列的clb中最右端的slice中。
现在再看一下引脚约束文件，发现这个应该有一个专门的做芯片的一个方向，那就是布线。
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