Verilog代码封装后门访问
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关于仿真里的后门访问，之前的文章《三分钟教会你spinalhdl仿真中的后门读写》中有做过介绍，其针对的都是针对以spinalhdl中的代码进行的后门访问。今天来看看当封装了verilog blackbox时，在spinalhdl仿真中如何进行后门访问verilog代码。
blackbox代码封装
考虑下面的blackbox代码封装：
这里我们封装了一个blackbox a，在demo中进行例化。如果我们在仿真时如果想要后门访问模块a中的sum，那么直接访问肯定是不行的，这里就需要对blackbox a稍进行修改：
这里需要在a中例化一个sum变量并标注为simpublic，同时在rtl代码中就sum需添加/* verilator public */（注意是添加在分号前)。这样我们可以在仿真中访问a中的sum：
仿真中可以正常访问a中的sum：
[progress] verilator compilation done in 4112.984 ms
[progress] start demo test simulation with seed 129114326
data_out=4ainst.sum=5
多层blackbox
考虑下面的blackbox:
在blackbox a中其封装的模块a中有例化了模块b，如果我们想要访问模块b中的sum，那么除了要在sum行添加/* verilator public */外还需要对blackbox a添加待访问sum的层次结构：
在仿真时可以访问b_inst中的sum变量：
[progress] start demo test simulation with seed 574035638
data_out=4ainst.b_inst.sum=5
[done] simulation done in 5.223 ms
写在最后
这里的仿真均采用的是verilator，关于vcs小伙伴们可以自行探索。
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blackbox代码封装
考虑下面的blackbox代码封装：
这里我们封装了一个blackbox a，在demo中进行例化。如果我们在仿真时如果想要后门访问模块a中的sum，那么直接访问肯定是不行的，这里就需要对blackbox a稍进行修改：
这里需要在a中例化一个sum变量并标注为simpublic，同时在rtl代码中就sum需添加/* verilator public */（注意是添加在分号前)。这样我们可以在仿真中访问a中的sum：
仿真中可以正常访问a中的sum：
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[progress] start demo test simulation with seed 129114326
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在blackbox a中其封装的模块a中有例化了模块b，如果我们想要访问模块b中的sum，那么除了要在sum行添加/* verilator public */外还需要对blackbox a添加待访问sum的层次结构：
在仿真时可以访问b_inst中的sum变量：
[progress] start demo test simulation with seed 574035638
data_out=4ainst.b_inst.sum=5
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写在最后
这里的仿真均采用的是verilator，关于vcs小伙伴们可以自行探索。
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