A／D转换器AD7262芯片介绍
主要特点
ad7262具有高速低功耗同步采样，最高可达1 ms／s。其内部集成的可编程放大器pga有14种放大增益可供选择。两组比较器a、b和c、d用作电机控制或各种电极传感器的运算器。其中比较器a和b具有低功耗特点，比较器c和d具有高速特点。双通道差分输入同时采样和a／d转换，输入阻抗大于1 gω。单电源+5 v供电。pga增益为2,-3 db带宽为1．7 mhz，信噪比snr为73 db；其增益为32时，信噪比为66 db。输入直流漏电流±0．001μa，失调漂移为2．5μv／℃。带有串行外设接口spi，兼容qspi，microwire，dsp。该器件具有多种节能模式，动态匹配所需内部模块，具有寄存器控制和引脚驱动两种工作方式。
引脚功能
avcc：模拟电源输入端，4．75～5．25 v；
ca_cbvcc／cc_cdvcc：比较器的电源输入端，2．7～5．25 v；
ca_cb_gnd／cc_cd_gnd：比较器的地输入端；
va+/va-,vb+／vb-：a／d转换器a和b通道的差分模拟输入端；
vrefa／vrefb：a／d转换器a和b通道的基准电压输入输出端；
sclk：串行时钟，spi通讯时钟，也是a／d转换过程的时钟源；
cal：初始化内部失调校准逻辑输入；
pd2：节能模式选择逻辑输入；
pd1：节能模式选择逻辑输入；
pd0／din：节能模式选择逻辑输入，同时在寄存器控制模式下为数据输入端；
cs：片选输入端；
ca+/ca-,cb+/cb-：比较器a和b的差分输入端；
cc+／cc-，cd+/cd-：比较器c和d的差分输入端；
agnd：模拟地输入端；
dgnd：数字地输入端；
couta～coutd：比较器cmos推拉输出，使用vdrive时，为数字输出端；
douta／doutb：a／d转换串行数据输出端；
g0～g3：增益倍数逻辑输入端，当全为低电平时，为寄存器控制工作方式；
vdrive：逻辑电源输入端，2．7～5．25 v；
refsel：基准电压选择端，高电平使用内部基准电压，低电平使用外部基准电压。
内部结构
图1为ad7262的内部结构图。两路差分信号通过各自的pga同步采样放大后，进入跟踪保持器，此时由控制逻辑控制2个12位的逐次逼近型a／d转换器实现模拟数字转换，最后由输出驱动器分别串行驱动输出至douta和doutb。
在引脚驱动方式下，g0～g3必须至少有一个高电平。外接的g0～g3决定pga的放大倍数。pd2～pd0 3个端口电平控制其内部比较器和12位的a／d转换器各模块的使用或关闭。在寄存器控制方式下，pd2，pd1，g0～g3全为低电平。pd0／din为数据输入端，用于写入相关控制寄存器，动态配置放大倍数、校准和节能模式。ad7262以2的补码输出转换结果。
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