怎样去设计一种基于FPGA的以太网数据传输硬件？
以太网数据传输硬件设计实现
系统方案设计
1.1 设计思想
本文研究的是基于fpga的以太网的mac层数据处理，目的是能广泛应用于多种嵌入式网络设备的前端设计，如网络视频监控设备、ip数字电视设备、家庭智能设备等。根据fpga的可重复擦写编程的特点，采用fpga可以方便对设备的升级和维护。本文为了设计能满足于各种不同的以太网网络环境，和增强系统的可移植性，采取了一系列的措施。
首先，考虑到以太网高速而又庞大的数据量，尤其是载有音视频流的1000m网络，以及开发的成本问题，我们引入了一种针对普通产品开发的xilinx芯片——spartan系列。fpga具有并行执行的特点，相对于其他器件在数据处理上具有明显的速度上的优势，同时spartan系列fpga拥有几百kb甚至几千kb的块ram资源，可用于数据的缓存，完全可以满足于1000m以太网数据量的要求。在fpga的系统设计开发中，常常会采用某些具有特定功能的ip核以提高系统开发的效率，减少成本。考虑到开发周期和设计要求，本系统设计方案采用xilinx公司的tri mode ethernet mac ip核实现对mac数据的主要处理工作，该ip核支持多种工作模式，同时用户可以根据要求实现自定义配置。其次，为了实现网络的ip地址和mac地址的自动映射，本系统还增加了对arp数据包的解析和arp应答功能的设计。除此之外，为了提高系统的通用性，物理芯片需能够支持1000/100/10m以太网、双工/半双工工作模式以及1000m光纤的接入。
1.2 系统功能
根据以述的设计思想，为了满足大部分设备对以太网的mac数据处理的需求，确定了本系统设计的功能如下：
(1)支持10m/100m/1000m以太网；
(2)支持双工/半双工；
(3)crc校验和帧长度校验；
(4)mac地址滤波；
(5)支持arp解析；
(6)支持rj45标准网口和sfp插口的输入；
(7)支持i2c接口用户配置。
1.3 系统总体结构设计
根据上述技术指标及设计思想，图3-1给出了本系统的总体结构框图。本系统可分为五大模块：以太网数据转换电路、phy接口模块、mac核心处理模块、用户配置模块和用户数据接口模块。
图3-1系统总体结构框图
（1）以太网数据交换电路
以太网数据交换电路，主要功能是实现双绞线或光纤电缆的以太网物理层数据与mac层数据的转换，为fpga提供处理的mac数据源和送出fpga的上传mac数据，是传输介质和fpga数据交流的桥梁。
（2）phy接口模块
phy接口模块，可分为接收phy和发送phy接口两个子模块，实现接收数据和发送数据的同步。
（3）mac核心处理模块
根据以上设计思想，mac数据的核心处理模块直接采用xilinx的tri mode ethernet mac ip核，可以完成mac地址滤波、数据crc和长度校验、封装mac数据帧格式等基本功能，对接受的数据进行相应的好坏标记和对上传的数据进行封装标记。
（4）用户配置模块
用户配置模块主要是实现主控系统正确地完成对ip核寄存器和系统地址信息（ip地址和mac地址）的配置，同时实时地监控ip核的工作状态。该模块可分为i2c接口和ip核配置两个子模块，i2c接口子模块采用400kb/s的i2c总线协议，模拟从设备i2c时序；ip核配置子模块模拟ip核host配置时序，以实现对ip核寄存器的配置。
（5）用户数据接口模块
用户数据接口模块涉及对通过ip核处理后的接收数据帧和待上传的数据包两部分数据的处理以及arp功能的实现，可分为接收数据用户接口、上传数据用户接口、arp解析与应答三个子模块。
芯片的选取
2.1 物理层芯片选择
以太网物理层的处理工作大多数直接采用专业的物理层芯片来完成，完成数据的物理层编解码和收发功能。目前，物理层芯片的生产商以国外为主，如marvell、ns、broadcom公司等，其主流产品为100/10m和1000m物理层芯片，随着以太网的速率的提高，万兆物理层芯片也被广泛应用于光纤以太网。国内对芯片的研发起步比较晚，华为、中兴、天津中晶微电子等企业近些年也推出了不少的产品，但是技术还有待发展。
88e1111芯片是marvell公司alaska系列的一款千兆以太网收发器，主要应用于10base-t、100base-tx、1000base-t的以太网，采用cmos工艺，能实现基于cat5非屏蔽双绞线标准的以太网物理层数据的收发。88e1111支持多种mac接口模式，有gmii/mii、rgmii、sgmii、tbi和rtbi，是一款应用广泛的以太网物理层芯片。
88e1111芯片采用了marvell公司的vct（virtual cable tester，虚拟电缆测试仪）功能，可以使用时域反射技术远程测试电缆故障，减少了设备应答和服务请求的次数，同时还能通过vct检测线缆潜在的问题和线缆的开路、短路或阻抗不匹配问题，准确度能达到一米。另外，88e1111芯片具有先进的混合信号处理能力，可以以1gbps的速率完成自适应均衡、消除反射或串扰、数据恢复、误码纠正等功能，是一款抗噪声能力强的低功耗以太网物理层芯片。
88e1111芯片中嵌入了一个可选的1.25ghzserdes（并串转换/串并转换器），可以直接与光纤收发器连接，实现1000base-x光纤标准与1000base-t双绞线标准传输媒体的转换。通过选择，88e1111可以通过rj45接口接入1000base-t双绞线网络或sfp（小型可插拔）模块接入光纤网络，分别如图3-2和3-3所示。
图3-2 88e1111接入双绞线网络
图3-3 88e1111接入光纤网络
除了以上所述，88e1111芯片还支持光纤与铜线自动检测、网络连接的自动协商、可编程的led驱动等功能，方便了用户对以太网接入的开发。
根据本文系统设计的功能的要求，以太网物理层芯片需满足同时支持rj45和sfp两种接口，10base-t、100base-tx、1000base-t标准双绞线和千兆光纤介质的传输，半双工和双工切换的工作模式。marvell公司的以太网物理层芯片88e1111，采用0.13μm的cmos工艺，是一款低成本、低功耗的千兆以太网物理层芯片，足以满足系统设计的要求
2.2 fpga主芯片选择
在fpga的开发设计中，fpga芯片的选取非常重要，不合理的选取会导致一系列的后续设计问题，甚至会失败；合理的选取不仅避免设计问题，而且可以提高系统的性价比，延长产品的生命周期。通常，fpga芯片选取需从芯片的供货商和开发工具的支持、电气接口标准、硬件资源、速度等级、温度等级、封装形式、价格七个方面入手。
（1）供货商和开发工具的支持
目前，主要的fpga供应商有xilinx公司、altera公司、lattice公司和actel公司等，fpga的发展迅速，器件的淘汰率随之提高，为了延长产品的生命周期，最好选择货源比较足的主流器件。
从开发工具来看，xilinx公司的ise和altera公司的quartusⅱ，更新及时、功能强大、界面友好，支持本公司所有器件的设计开发和很多第三方软件的应用，如synplify pro、modlesim等，能将器件的性能发挥到最佳。因此，一般在没有特殊要求情况下，器件从这两家公司中选取。
虽然altera公司的开发智能程度相对xilinx公司要高一些，但xilinx公司具有更强的硬件功能，通过ip核的使用可以达到更高的效率。目前，xllinx公司的主流器件有spartan-3、spartan-3a/3adsp/3an、virtex-4lx、virtex-4sx、virtex-4fx、virtex-5lx、virtex-5sx、virtex-5fx、spartan-6和virtex-6等系列，其中spartan-3系列主要应用于逻辑设计；spartan-3a/3adsp/3an主要应用于简单数字信号处理，virtex-4lx和virtex-5lx系列主要应用于高速逻辑设计，virtex-4sx和virtex-5sx系列主要应用于高速复杂数字信号处理，virtex-4fx和virtex-5fx系列主要应用于嵌入式系统。本设计只需要对mac数据帧做简单的逻辑处理和缓存等等，spartan-3系列器件足以满足这一需求。
（2）芯片的电气接口标准
目前，数字电路的电气接口标准非常多，在某些大型的系统设计中常常需要同时支持多种电气接口标准。本设计中的fpga的接口电气标准只采用了lvcmos2.5v和lvcmos3.3v，xilinx公司的绝大部分器件均能够满足。
（3）硬件资源
硬件资源是fpga芯片选取的重要指标，包括逻辑资源、i/o资源、布线资源、存储器资源和某些底层内嵌功能单元和内嵌专用硬核等。在fpga设计中，i/o资源和逻辑资源的需求是最需要重点考虑的问题。逻辑资源一般要求消耗的资源不超过70%，主流fpga器件中，逻辑资源都比较丰富，比较容易选择。i/o资源需要注意的是避免过度的消耗，因为过度的消耗可能会导致fpga负荷过重，器件发热量过大，以影响器件的速度性能、工作稳定性和寿命，设计中也要充分考虑器件的散热问题。另外，局部布线资源也要充足，以免影响电路的运行速度。在一些特殊场合，特别是数据量比较大的情况下，还得考虑存储器资源，如bram或lut资源。还有锁相环、dsp等底层内嵌功能单元或内嵌专用硬核可以根据具体的设计作为参考需求。
（4）速度等级
对于芯片速度等级的选取，有一个基本原则：在满足应用需求的情况下，尽量选择速度等级低的芯片。因为速度等级高的芯片更容易产生信号反射，增加价格成本，延长开发周期。本设计的主时钟最高位125m，xc3s400芯片具有-4和-5两个速度等级，-4等级的最高可以达到250m，为节约成本，选取的芯片采用-4等级。
硬件电路设计
3.1 以太网变换电路设计
以太网数据变换电路，实现的是以太网传输媒介上的物理层数据与mac层数据的转换，为fpga提供待处理的mac数据源和输出待上传的mac数据，本设计主要是选择物理层专业芯片88e1111完成这一功能，其电路设计包括以下几个方面：
（1）电源与时钟电路设计
88e1111芯片支持两种电平：2.5v和 1.0v，有时也可用1.2v代替1.0v。如图3-4所示为芯片的电源电路图，phy_vddio采用 2.5v，为芯片i/o引脚供电，与芯片引脚vddo、vddoh、vddox相连；phy1_avdd提供内部模拟逻辑电平，为2.5v，与avdd引脚相连；phy1_dvdd提供内部数字逻辑电平
图3-488e1111芯片电源电路
为1.0v，与dvdd引脚相连。为了提高电源的稳定性，电源phy_vddio、
phy1_avdd、phy1_dvdd需接入一些滤波电容，以减少电源噪声。
88e1111芯片对数据的处理需要有一个参考时钟，一般通过xat1引脚输入25m或125m的参考时钟，或通过xat1和xat2直接接一个晶振。本设计采用xat1引脚输入25m的时钟，以减少晶振的使用数量，如图3-5所示，clk_25m_phy1与xat1引脚相连，提供25m的时钟；为了保证电路的可调性，同时在xat1和xat2的两端添加一个晶振，作为参考时钟的备用方案。
图3-588e1111芯片时钟电路
（2）配置电路设计
在88e1111的芯片设计中，器件物理地址、phy操作模式、自动协商模式、mdi（media dependent interface，媒介相关接口）交叉功能、phy接口模式等的配置需通过芯片config0~config6引脚硬件配置来实现，config0~config6引脚配置位映射关系表和各配置寄存器的定义描述分别如表3-3和表3-4所示。
在硬件电路设计中，config0~config6配置位的选择通常是通过与led输出引脚、vddo或者vss引脚的连接来完成的，其各引脚与配置位的映射关系如表3-5所示。
为了方便开发设计，本设计将芯片地址设置为00000，屏蔽pause帧，同时使能mdi交叉连接、光纤与铜线接入自动识别、能量检测功能，其自动协商支持所有网路模式；125mhz的数据发送的参考时钟由fpga提供，125mhz时
表3-3config0~config6引脚配置位映射关系表
引脚 bit[2] bit[1] bit[0]
config0 phyadr[2] phyadr[1] phyadr[0]
config1 ena_pause phyadr[4] phyadr[3]
config2 aneg[3] aneg[2] aneg[1]
config3 aneg[0] ena_xc dis_125
config4 hwcfg_mode[2] hwcfg_mode[1] hwcfg_mode[0]
config5 dis_fc dis_sleep hwcfg_mode[3]
config6 sel_twsi int_pol 75/60ohm
表3-4各配置寄存器定义描述
配置寄存器 定义描述
phyadr[4:0] 器件的物理地址，在mdc/mdio配置模式下，表示器件五位的物理件地址；在i2c配置模式下，表示器件物理地址phyaddr[4:0]，phyaddr[6:5]固定为10。
ena_pause pause 帧使能信号，高有效；同时影响寄存器 4 的默认值
aneg[3:0] 自动协商模式配置寄存器 ，10/100/1000base-t模式下由aneg[3:0]配置决定，而1000base-x模式下由aneg[3:2]配置决定，具体的配置映射关系可参考88e1111芯片手册。
ena_xc 交叉连接使能信号，1时mdi交叉功能有效，反之则无效。
dis_125 125mhz时钟使能信号，0使能。
hwcfg_mode[3:0] 硬件配置模式，决定了phy接口模式，常用的有：1000base-x模式下rgmii为0011；1000base-x模式下gmii 为0111；10/100/1000base-t模式下rgmii为1011；10/100/1000base-t模式下rgmii为1111；其他的模式配置可参考88e1111芯片手册
dis_fc 光纤与铜线接入自动识别使能信号，0有效。
dis_sleep 能量检测使能信号，0有效。
sel_twsi 寄存器配置模式选择，0表示采用mdc/mdio配置模式，1表示采用i2c配置模式。
int_pol 中断电平值，0表示高电平中断，1表示低电平中断。
75/60 ohm 终端电阻匹配选择信号，主要用于光纤接入模式下，0采用 50ohm，1采用75ohm。
表3-5各引脚与配置位的映射关系
引脚 bit[2:0]
vddo 111
led_link10 110
led_link100 101
led_link1000 100
led_duplex 011
led_rx 010
led_tx 001
vss 000
钟输出设置为无效；ipqam项目的cpu对从设备的寄存器配置采用的是i2c总线方式，因此88e1111需配置成i2c从模式；phy接口采用gmii/mii模式，减少fpga对时钟的时序要求。因此，如图3-6配置电路图所示，默认情况下将config0~config6引脚分别配置为000、000、111、111、111、001、110。但是为了系统的升级维护，对config1、config4、config5、config6引脚设置了配置保留值，根据不同的需求本系统可以支持pause帧的传输、rgmii的phy 接口、mdc/mdio寄存器配置等工作模式。
图3-6 88e1111配置电路
（3）rj45接口和sfp接口电路设计
本系统支持普通双绞线和光纤两种媒介接入方式，双绞线的接入采用通用的rj45接口，其电路图如图3-7所示，88e1111芯片的四对mdi引脚直接与hx5008nl芯片的四对td引脚相连，实现与rj45接口的连接，完成双绞线与88e1111芯片的数据交换；光纤的接入采用sfp接口，其电路图如图3-8所示，88e1111芯片的s_in±引脚与sfp接口芯片的rd±引脚相连，接收光纤电缆上的数据；s_out±引脚与td±引脚相连，完成本地的数据的输出；同时sfp接口芯片采用i2c配置模式，与系统设计一致。
图3-7 rj45接口电路
图3-8 sfp接口电路
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系统方案设计
1.1 设计思想
本文研究的是基于fpga的以太网的mac层数据处理，目的是能广泛应用于多种嵌入式网络设备的前端设计，如网络视频监控设备、ip数字电视设备、家庭智能设备等。根据fpga的可重复擦写编程的特点，采用fpga可以方便对设备的升级和维护。本文为了设计能满足于各种不同的以太网网络环境，和增强系统的可移植性，采取了一系列的措施。
首先，考虑到以太网高速而又庞大的数据量，尤其是载有音视频流的1000m网络，以及开发的成本问题，我们引入了一种针对普通产品开发的xilinx芯片——spartan系列。fpga具有并行执行的特点，相对于其他器件在数据处理上具有明显的速度上的优势，同时spartan系列fpga拥有几百kb甚至几千kb的块ram资源，可用于数据的缓存，完全可以满足于1000m以太网数据量的要求。在fpga的系统设计开发中，常常会采用某些具有特定功能的ip核以提高系统开发的效率，减少成本。考虑到开发周期和设计要求，本系统设计方案采用xilinx公司的tri mode ethernet mac ip核实现对mac数据的主要处理工作，该ip核支持多种工作模式，同时用户可以根据要求实现自定义配置。其次，为了实现网络的ip地址和mac地址的自动映射，本系统还增加了对arp数据包的解析和arp应答功能的设计。除此之外，为了提高系统的通用性，物理芯片需能够支持1000/100/10m以太网、双工/半双工工作模式以及1000m光纤的接入。
1.2 系统功能
根据以述的设计思想，为了满足大部分设备对以太网的mac数据处理的需求，确定了本系统设计的功能如下：
(1)支持10m/100m/1000m以太网；
(2)支持双工/半双工；
(3)crc校验和帧长度校验；
(4)mac地址滤波；
(5)支持arp解析；
(6)支持rj45标准网口和sfp插口的输入；
(7)支持i2c接口用户配置。
1.3 系统总体结构设计
根据上述技术指标及设计思想，图3-1给出了本系统的总体结构框图。本系统可分为五大模块：以太网数据转换电路、phy接口模块、mac核心处理模块、用户配置模块和用户数据接口模块。
图3-1系统总体结构框图
（1）以太网数据交换电路
以太网数据交换电路，主要功能是实现双绞线或光纤电缆的以太网物理层数据与mac层数据的转换，为fpga提供处理的mac数据源和送出fpga的上传mac数据，是传输介质和fpga数据交流的桥梁。
（2）phy接口模块
phy接口模块，可分为接收phy和发送phy接口两个子模块，实现接收数据和发送数据的同步。
（3）mac核心处理模块
根据以上设计思想，mac数据的核心处理模块直接采用xilinx的tri mode ethernet mac ip核，可以完成mac地址滤波、数据crc和长度校验、封装mac数据帧格式等基本功能，对接受的数据进行相应的好坏标记和对上传的数据进行封装标记。
（4）用户配置模块
用户配置模块主要是实现主控系统正确地完成对ip核寄存器和系统地址信息（ip地址和mac地址）的配置，同时实时地监控ip核的工作状态。该模块可分为i2c接口和ip核配置两个子模块，i2c接口子模块采用400kb/s的i2c总线协议，模拟从设备i2c时序；ip核配置子模块模拟ip核host配置时序，以实现对ip核寄存器的配置。
（5）用户数据接口模块
用户数据接口模块涉及对通过ip核处理后的接收数据帧和待上传的数据包两部分数据的处理以及arp功能的实现，可分为接收数据用户接口、上传数据用户接口、arp解析与应答三个子模块。
芯片的选取
2.1 物理层芯片选择
以太网物理层的处理工作大多数直接采用专业的物理层芯片来完成，完成数据的物理层编解码和收发功能。目前，物理层芯片的生产商以国外为主，如marvell、ns、broadcom公司等，其主流产品为100/10m和1000m物理层芯片，随着以太网的速率的提高，万兆物理层芯片也被广泛应用于光纤以太网。国内对芯片的研发起步比较晚，华为、中兴、天津中晶微电子等企业近些年也推出了不少的产品，但是技术还有待发展。
88e1111芯片是marvell公司alaska系列的一款千兆以太网收发器，主要应用于10base-t、100base-tx、1000base-t的以太网，采用cmos工艺，能实现基于cat5非屏蔽双绞线标准的以太网物理层数据的收发。88e1111支持多种mac接口模式，有gmii/mii、rgmii、sgmii、tbi和rtbi，是一款应用广泛的以太网物理层芯片。
88e1111芯片采用了marvell公司的vct（virtual cable tester，虚拟电缆测试仪）功能，可以使用时域反射技术远程测试电缆故障，减少了设备应答和服务请求的次数，同时还能通过vct检测线缆潜在的问题和线缆的开路、短路或阻抗不匹配问题，准确度能达到一米。另外，88e1111芯片具有先进的混合信号处理能力，可以以1gbps的速率完成自适应均衡、消除反射或串扰、数据恢复、误码纠正等功能，是一款抗噪声能力强的低功耗以太网物理层芯片。
88e1111芯片中嵌入了一个可选的1.25ghzserdes（并串转换/串并转换器），可以直接与光纤收发器连接，实现1000base-x光纤标准与1000base-t双绞线标准传输媒体的转换。通过选择，88e1111可以通过rj45接口接入1000base-t双绞线网络或sfp（小型可插拔）模块接入光纤网络，分别如图3-2和3-3所示。
图3-2 88e1111接入双绞线网络
图3-3 88e1111接入光纤网络
除了以上所述，88e1111芯片还支持光纤与铜线自动检测、网络连接的自动协商、可编程的led驱动等功能，方便了用户对以太网接入的开发。
根据本文系统设计的功能的要求，以太网物理层芯片需满足同时支持rj45和sfp两种接口，10base-t、100base-tx、1000base-t标准双绞线和千兆光纤介质的传输，半双工和双工切换的工作模式。marvell公司的以太网物理层芯片88e1111，采用0.13μm的cmos工艺，是一款低成本、低功耗的千兆以太网物理层芯片，足以满足系统设计的要求
2.2 fpga主芯片选择
在fpga的开发设计中，fpga芯片的选取非常重要，不合理的选取会导致一系列的后续设计问题，甚至会失败；合理的选取不仅避免设计问题，而且可以提高系统的性价比，延长产品的生命周期。通常，fpga芯片选取需从芯片的供货商和开发工具的支持、电气接口标准、硬件资源、速度等级、温度等级、封装形式、价格七个方面入手。
（1）供货商和开发工具的支持
目前，主要的fpga供应商有xilinx公司、altera公司、lattice公司和actel公司等，fpga的发展迅速，器件的淘汰率随之提高，为了延长产品的生命周期，最好选择货源比较足的主流器件。
从开发工具来看，xilinx公司的ise和altera公司的quartusⅱ，更新及时、功能强大、界面友好，支持本公司所有器件的设计开发和很多第三方软件的应用，如synplify pro、modlesim等，能将器件的性能发挥到最佳。因此，一般在没有特殊要求情况下，器件从这两家公司中选取。
虽然altera公司的开发智能程度相对xilinx公司要高一些，但xilinx公司具有更强的硬件功能，通过ip核的使用可以达到更高的效率。目前，xllinx公司的主流器件有spartan-3、spartan-3a/3adsp/3an、virtex-4lx、virtex-4sx、virtex-4fx、virtex-5lx、virtex-5sx、virtex-5fx、spartan-6和virtex-6等系列，其中spartan-3系列主要应用于逻辑设计；spartan-3a/3adsp/3an主要应用于简单数字信号处理，virtex-4lx和virtex-5lx系列主要应用于高速逻辑设计，virtex-4sx和virtex-5sx系列主要应用于高速复杂数字信号处理，virtex-4fx和virtex-5fx系列主要应用于嵌入式系统。本设计只需要对mac数据帧做简单的逻辑处理和缓存等等，spartan-3系列器件足以满足这一需求。
（2）芯片的电气接口标准
目前，数字电路的电气接口标准非常多，在某些大型的系统设计中常常需要同时支持多种电气接口标准。本设计中的fpga的接口电气标准只采用了lvcmos2.5v和lvcmos3.3v，xilinx公司的绝大部分器件均能够满足。
（3）硬件资源
硬件资源是fpga芯片选取的重要指标，包括逻辑资源、i/o资源、布线资源、存储器资源和某些底层内嵌功能单元和内嵌专用硬核等。在fpga设计中，i/o资源和逻辑资源的需求是最需要重点考虑的问题。逻辑资源一般要求消耗的资源不超过70%，主流fpga器件中，逻辑资源都比较丰富，比较容易选择。i/o资源需要注意的是避免过度的消耗，因为过度的消耗可能会导致fpga负荷过重，器件发热量过大，以影响器件的速度性能、工作稳定性和寿命，设计中也要充分考虑器件的散热问题。另外，局部布线资源也要充足，以免影响电路的运行速度。在一些特殊场合，特别是数据量比较大的情况下，还得考虑存储器资源，如bram或lut资源。还有锁相环、dsp等底层内嵌功能单元或内嵌专用硬核可以根据具体的设计作为参考需求。
（4）速度等级
对于芯片速度等级的选取，有一个基本原则：在满足应用需求的情况下，尽量选择速度等级低的芯片。因为速度等级高的芯片更容易产生信号反射，增加价格成本，延长开发周期。本设计的主时钟最高位125m，xc3s400芯片具有-4和-5两个速度等级，-4等级的最高可以达到250m，为节约成本，选取的芯片采用-4等级。
硬件电路设计
3.1 以太网变换电路设计
以太网数据变换电路，实现的是以太网传输媒介上的物理层数据与mac层数据的转换，为fpga提供待处理的mac数据源和输出待上传的mac数据，本设计主要是选择物理层专业芯片88e1111完成这一功能，其电路设计包括以下几个方面：
（1）电源与时钟电路设计
88e1111芯片支持两种电平：2.5v和 1.0v，有时也可用1.2v代替1.0v。如图3-4所示为芯片的电源电路图，phy_vddio采用 2.5v，为芯片i/o引脚供电，与芯片引脚vddo、vddoh、vddox相连；phy1_avdd提供内部模拟逻辑电平，为2.5v，与avdd引脚相连；phy1_dvdd提供内部数字逻辑电平
图3-488e1111芯片电源电路
为1.0v，与dvdd引脚相连。为了提高电源的稳定性，电源phy_vddio、
phy1_avdd、phy1_dvdd需接入一些滤波电容，以减少电源噪声。
88e1111芯片对数据的处理需要有一个参考时钟，一般通过xat1引脚输入25m或125m的参考时钟，或通过xat1和xat2直接接一个晶振。本设计采用xat1引脚输入25m的时钟，以减少晶振的使用数量，如图3-5所示，clk_25m_phy1与xat1引脚相连，提供25m的时钟；为了保证电路的可调性，同时在xat1和xat2的两端添加一个晶振，作为参考时钟的备用方案。
图3-588e1111芯片时钟电路
（2）配置电路设计
在88e1111的芯片设计中，器件物理地址、phy操作模式、自动协商模式、mdi（media dependent interface，媒介相关接口）交叉功能、phy接口模式等的配置需通过芯片config0~config6引脚硬件配置来实现，config0~config6引脚配置位映射关系表和各配置寄存器的定义描述分别如表3-3和表3-4所示。
在硬件电路设计中，config0~config6配置位的选择通常是通过与led输出引脚、vddo或者vss引脚的连接来完成的，其各引脚与配置位的映射关系如表3-5所示。
为了方便开发设计，本设计将芯片地址设置为00000，屏蔽pause帧，同时使能mdi交叉连接、光纤与铜线接入自动识别、能量检测功能，其自动协商支持所有网路模式；125mhz的数据发送的参考时钟由fpga提供，125mhz时
表3-3config0~config6引脚配置位映射关系表
引脚 bit[2] bit[1] bit[0]
config0 phyadr[2] phyadr[1] phyadr[0]
config1 ena_pause phyadr[4] phyadr[3]
config2 aneg[3] aneg[2] aneg[1]
config3 aneg[0] ena_xc dis_125
config4 hwcfg_mode[2] hwcfg_mode[1] hwcfg_mode[0]
config5 dis_fc dis_sleep hwcfg_mode[3]
config6 sel_twsi int_pol 75/60ohm
表3-4各配置寄存器定义描述
配置寄存器 定义描述
phyadr[4:0] 器件的物理地址，在mdc/mdio配置模式下，表示器件五位的物理件地址；在i2c配置模式下，表示器件物理地址phyaddr[4:0]，phyaddr[6:5]固定为10。
ena_pause pause 帧使能信号，高有效；同时影响寄存器 4 的默认值
aneg[3:0] 自动协商模式配置寄存器 ，10/100/1000base-t模式下由aneg[3:0]配置决定，而1000base-x模式下由aneg[3:2]配置决定，具体的配置映射关系可参考88e1111芯片手册。
ena_xc 交叉连接使能信号，1时mdi交叉功能有效，反之则无效。
dis_125 125mhz时钟使能信号，0使能。
hwcfg_mode[3:0] 硬件配置模式，决定了phy接口模式，常用的有：1000base-x模式下rgmii为0011；1000base-x模式下gmii 为0111；10/100/1000base-t模式下rgmii为1011；10/100/1000base-t模式下rgmii为1111；其他的模式配置可参考88e1111芯片手册
dis_fc 光纤与铜线接入自动识别使能信号，0有效。
dis_sleep 能量检测使能信号，0有效。
sel_twsi 寄存器配置模式选择，0表示采用mdc/mdio配置模式，1表示采用i2c配置模式。
int_pol 中断电平值，0表示高电平中断，1表示低电平中断。
75/60 ohm 终端电阻匹配选择信号，主要用于光纤接入模式下，0采用 50ohm，1采用75ohm。
表3-5各引脚与配置位的映射关系
引脚 bit[2:0]
vddo 111
led_link10 110
led_link100 101
led_link1000 100
led_duplex 011
led_rx 010
led_tx 001
vss 000
钟输出设置为无效；ipqam项目的cpu对从设备的寄存器配置采用的是i2c总线方式，因此88e1111需配置成i2c从模式；phy接口采用gmii/mii模式，减少fpga对时钟的时序要求。因此，如图3-6配置电路图所示，默认情况下将config0~config6引脚分别配置为000、000、111、111、111、001、110。但是为了系统的升级维护，对config1、config4、config5、config6引脚设置了配置保留值，根据不同的需求本系统可以支持pause帧的传输、rgmii的phy 接口、mdc/mdio寄存器配置等工作模式。
图3-6 88e1111配置电路
（3）rj45接口和sfp接口电路设计
本系统支持普通双绞线和光纤两种媒介接入方式，双绞线的接入采用通用的rj45接口，其电路图如图3-7所示，88e1111芯片的四对mdi引脚直接与hx5008nl芯片的四对td引脚相连，实现与rj45接口的连接，完成双绞线与88e1111芯片的数据交换；光纤的接入采用sfp接口，其电路图如图3-8所示，88e1111芯片的s_in±引脚与sfp接口芯片的rd±引脚相连，接收光纤电缆上的数据；s_out±引脚与td±引脚相连，完成本地的数据的输出；同时sfp接口芯片采用i2c配置模式，与系统设计一致。
图3-7 rj45接口电路
图3-8 sfp接口电路
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