RISC-V MCU电源系统概述
1. 电源结构
ch32v307供电结构如下图所示：
通常ch32v307工作电压vdd的范围为2.4v~3.6v，当使用eth或usb时，工作电压vdd的范围为 3.0v~3.6v
内置电压调节器提供内核所需的1.5v电源。
vdda和vssa为模拟部分供电
为了提高ad等模拟部分的精度，可以使用独立的电源为vdda和vssa供电。
ch32v307vct6 lqfp100封装的vref+ 和vref- 引脚引出，用户可连接一个独立的参考电压用于adc测量，参考电压范围：2.4v ≤ vref+ ≤ vdda。
其他封装的ch32v307的vref+ 和vref- 引脚未引出，在芯片内部与vdda和vssa相连。
vbat为后备电源引脚，当vdd断电时，掉电复位功能会自动切换vbat为后备供电区域供电，用于维持rtc以及后备寄存器的内容。
当切换到vbat供电时：
pc14和pc15只能用作lse引脚
pc13可以作为tamper侵入检测引脚、rtc闹钟或秒输出
当vdd恢复供电稳定后，系统自动切换开关，后备区由vdd供电，此时pc13~pc15可以做为gpio。因为模拟开关只能通过少量的电流，当用在输出时，速度必须限制在2mhz以下，最大负载电容为30pf，并且禁止用在持续输出和吸收电流的场合，比如led驱动。
如果没有使用外部电池为vbat供电，vbat引脚必须连接到vdd引脚上
电池到vbat的连线要尽可能的短
在主电源vdd恢复供电过程中，内部vbat 电源仍然通过对应的vbat 引脚连在外部备用电源上，若 vdd在小于复位滞后时间 trsttempo 内就达到稳定，并且高于 vbat的值 0.6v 以上，则有可能存在较短瞬间，电流通过 vdd 与 vbat之间的二极管灌入 vbat，进而通过 vbat 引脚注入电池等后备电源，如果后备电源无法承受这样瞬时注入电流，建议在后备电源和vbat 引脚之间加一只正向导通低压降二极管。
2. 电源管理
2.1 上电复位和掉电复位
系统内部集成了上电复位por 和掉电复位pdr 电路。
当芯片供电电压vdd 和vdda 低于对应门限电压时，系统被相关电路复位，无需外置额外的复位电路。
上电门限电压 vpor 和掉电门限电压 vpdr 的参数请参考对应的数据手册。
2.2 可编程电压监测器（pvd）
可编程电压监测器 pvd，主要被用于监控系统主电源的变化，与电源控制寄存器 pwr_ctlr 的pls[2:0]所设置的门槛电压相比较，配合外部中断寄存器（exti）设置，可产生相关中断，以便及时通知系统进行数据保存等掉电前操作。
pvd详细配置参考。
3. 低功耗模式
微控制器目前提供了3 种低功耗模式，从处理器、外设、电压调节器等的工作差异上分为：
睡眠模式 ：内核停止运行，所有外设（包含内核私有外设）仍在运行
停止模式 ：停止所有时钟，唤醒后系统继续运行。
待机模式 ：停止所有时钟，唤醒后系统复位（电源复位）。
低功耗模式一览：
低功耗模式 进入方式 唤醒源 对时钟的影响 电压调节器
睡眠 wfi wfe wfi：任意中断唤醒 wfe：唤醒事件唤醒 内核时钟关闭， 其他时钟无影响 正常
停止 1) sleepdeep置1
2) pdds清0
3) wfi或wfe 任一外部中断/事件（在外部中断寄存器中设置） wkup引脚上升沿 关闭hse、hsi、pll 和外设时钟 正常：lpds=0 低功耗：lpds=1
待机 1) sleepdeep置1
2) pdds置1
3) wfi或wfe wkup引脚上升沿 rtc闹钟事件 nrst引脚复位 iwdg复位 注：任意外部中断/事件也可以唤醒系统， 但唤醒后系统不复位 关闭hse、hsi、pll 和外设时钟 正常：lpds=0 低功耗：lpds=1
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vdda和vssa为模拟部分供电
为了提高ad等模拟部分的精度，可以使用独立的电源为vdda和vssa供电。
ch32v307vct6 lqfp100封装的vref+ 和vref- 引脚引出，用户可连接一个独立的参考电压用于adc测量，参考电压范围：2.4v ≤ vref+ ≤ vdda。
其他封装的ch32v307的vref+ 和vref- 引脚未引出，在芯片内部与vdda和vssa相连。
vbat为后备电源引脚，当vdd断电时，掉电复位功能会自动切换vbat为后备供电区域供电，用于维持rtc以及后备寄存器的内容。
当切换到vbat供电时：
pc14和pc15只能用作lse引脚
pc13可以作为tamper侵入检测引脚、rtc闹钟或秒输出
当vdd恢复供电稳定后，系统自动切换开关，后备区由vdd供电，此时pc13~pc15可以做为gpio。因为模拟开关只能通过少量的电流，当用在输出时，速度必须限制在2mhz以下，最大负载电容为30pf，并且禁止用在持续输出和吸收电流的场合，比如led驱动。
如果没有使用外部电池为vbat供电，vbat引脚必须连接到vdd引脚上
电池到vbat的连线要尽可能的短
在主电源vdd恢复供电过程中，内部vbat 电源仍然通过对应的vbat 引脚连在外部备用电源上，若 vdd在小于复位滞后时间 trsttempo 内就达到稳定，并且高于 vbat的值 0.6v 以上，则有可能存在较短瞬间，电流通过 vdd 与 vbat之间的二极管灌入 vbat，进而通过 vbat 引脚注入电池等后备电源，如果后备电源无法承受这样瞬时注入电流，建议在后备电源和vbat 引脚之间加一只正向导通低压降二极管。
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系统内部集成了上电复位por 和掉电复位pdr 电路。
当芯片供电电压vdd 和vdda 低于对应门限电压时，系统被相关电路复位，无需外置额外的复位电路。
上电门限电压 vpor 和掉电门限电压 vpdr 的参数请参考对应的数据手册。
2.2 可编程电压监测器（pvd）
可编程电压监测器 pvd，主要被用于监控系统主电源的变化，与电源控制寄存器 pwr_ctlr 的pls[2:0]所设置的门槛电压相比较，配合外部中断寄存器（exti）设置，可产生相关中断，以便及时通知系统进行数据保存等掉电前操作。
pvd详细配置参考。
3. 低功耗模式
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2) pdds清0
3) wfi或wfe 任一外部中断/事件（在外部中断寄存器中设置） wkup引脚上升沿 关闭hse、hsi、pll 和外设时钟 正常：lpds=0 低功耗：lpds=1
待机 1) sleepdeep置1
2) pdds置1
3) wfi或wfe wkup引脚上升沿 rtc闹钟事件 nrst引脚复位 iwdg复位 注：任意外部中断/事件也可以唤醒系统， 但唤醒后系统不复位 关闭hse、hsi、pll 和外设时钟 正常：lpds=0 低功耗：lpds=1
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