基于CPCI总线结构的微波接收机设计
引言
微波接收机是一种重要的无线通信设备，随着车载、机载、舰载等移动环境下的应用需求的产生，微波接收机的小型化、模块化、通用化是当前必须解决的问题。
compact pci 简称cpci，是目前科研和军工领域广泛应用的一种工业计算机总线标准。cpci 结合了pci 总线的电气、软件标准和欧式卡的工业组装技术标准，与pci 规范完全兼容；定义了32 位数据总线 （ 可扩展到64 位），最高工作频率为 33mhz ;能够实现设备的即插即用；系统设计结构紧凑、可靠性高，适应各种运输、使用环境。
结合cpci 总线技术的微波接收机性能优良，可以满足智能交通、航空航天等众多领域的应用要求。
1 系统原理 本接收机系统以fpga 和单片机为中心控制单元，实现cpci 总线结构下微波信号的接收、滤波、变频、增益控制等功能。系统主要由微波接收机、pci9054、fpga（ep1c6q240c8）和单片机（atmega8l）组成，系统组成如图1 所示。
cpci 总线信号经高传输速率的pci 桥芯片pci9054 转换为local bus 信号，通过verilog hdl 语言编程产生对fpga 的控制信号，完成数据的快速读写，同时在外部采用eeprom 进行高速数据的缓冲，从而实现与fpga 与cpci 总线的高速数据通信。在控制信号作用下，fpga 实时接收localbus 信号，并进行运算处理，对接收机增益进行控制；对系统锁相环的控制指令、数据则通过串口发送给单片机，fpga 和单片机共同完成对接收机系统的控制。系统供电由cpci 机箱内5v、12v 开关电源提供。
2 关键技术设计 根据cpci 总线规范及结构特点要求，cpci 总线结构微波接收机系统的设计需要解决总线接口转换、结构设计、电源设计以及电磁兼容设计等关键技术。
2.1 总线接口转换 2.1.1 cpci bus 到local bus 的接口设计 cpci 总线信号到local 总线信号的转换是基于pci9054芯片实现的。pci9054 是plx 公司生产的一款基于pci2.2总线规范的通用接口芯片，是32 位、33mhz的pci总线主i/o 加速器，突发传输速度可达132mb/s.有m、j、c 三种工作模式，本设计中选用数据线与地址线独立使用的c 模式。
pci9054 支持主控、目标、dma（ 直接存储器访问）3 种局部总线传输方式，这里采用了目标传输方式和高传输速率的dma传输方式，即pci9054 既是pci 总线的目标，同时又是local总线的主控者。
pci9054 提供了3 种物理总线接口：cpci 总线接口、local 总线接口和串行eeprom 接口，其中需要用户设计的是local 总线接口。其接口信号见图2.
pci9054 对本地设备的访问有单周期访问和突发方式访问2 种访问方式，单周期访问可采用状态机实现对localbus 接口的控制，其状态转移如图3 所示。
2.1.2 spi 总线接口设计 fpga 与单片机的通信需要通过spi 总线来实现。spi总线是一种同步串行总线，以3 线或4 线方式通信。本设计中所使用的3 条通信线为：时钟sclk，数据dat，片选信号cs.图4 为spi 工作时序。
当fpga 从单片机读取数据时，向单片机发送读使能信号rd（可用任意i/o 口），串行数据经dat 口在每个时钟（sck）的上升沿送入fpga 的移位寄存器，全部接受完毕后，cs 置1 ;当fpga 向单片机传输命令或者数据时，cs 拉低后，移位寄存器开始工作。内部并行数据经串/ 并转换为64 位串行信号，每个时钟的下降沿移位寄存器送出一位数据，单片机通过dat 端口读取数据。借助vhdl 硬件描述语言可方便地实现该系统，部分程序如下：
2.2 结构设计 微波接收机的全部硬件电路设计在一张cpci 载板上，通过高密度2mm 插针式连接器安装在一个6u 标准机箱内。机箱采用220v 交流供电，前面板设有状态指示灯，可指示系统供电、pci 总线访问状态及微波接收机内部射频模块锁定状态。
cpci 总线结构的设计使该模块具有“即插即用”的高度兼容性，方便接收机系统的建立、操作，且具有良好的抗震性，适合移动平台的使用。
2.3 电源设计 由于cpci 机箱提供的开关电源电磁干扰严重，且纹波系数较大，严重影响接收机杂散、相噪等性能，因此必须对电源进行处理。机箱内12v 开关电源经lm7809、lm7805、lt1965三级dc/dc 稳压后，分别提供给系统中数字电路、模拟电路使用，有效降低了电源纹波和数字电路、模拟电路之间的电磁干扰。
2.4 电磁兼容设计 cpci 结构微波接收机的电磁干扰有机箱内部的电源干扰及接收机的本振频率泄露等。为了消除电源干扰的影响，将cpci 机箱内计算机电源和接收机电源分开使用，并进行多级稳压处理；模块内敏感电路采用单独的屏蔽盒进行隔离，减少频率泄露；在pcb 板设计中将射频线和控制线分层隔离；为了减小载板上其他模块的信号对底板总线的影响，用10ω的电阻在cpci 卡的接插件j1 口处进行串联电阻匹配。
3 实验验证 图5 为按照本文设计方法完成的 cpci 总线结构微波接收机实物。cpci 载板上设有三个模块，分别实现两路中频信号到s 频段的上变频和一路s 频段信号到中频的下变频。中频输入、s 频段输出和参考信号输入口均为sma-50k.控制软件能够实现对上、下变频器的增益控制和输出、输入频率设置，以及每个变频模块锁定状态的读取。其软件控制界面如图6 所示。
经过实际测试，本接收机软、硬件设计满足cpci 总线结构微波接收机的控制及指标要求，通过验证。
4 结束语 以cpci 总线的工控机为平台，结合6u 的cpci 卡研制的微波接收机系统，将微波接收机技术与先进的计算机技术融为一体，解决了业界长期面临的多通道、小型化、模块化、pci协议控制等射频接收前端技术难题，具有广阔的应用前景。
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cpci 总线信号经高传输速率的pci 桥芯片pci9054 转换为local bus 信号，通过verilog hdl 语言编程产生对fpga 的控制信号，完成数据的快速读写，同时在外部采用eeprom 进行高速数据的缓冲，从而实现与fpga 与cpci 总线的高速数据通信。在控制信号作用下，fpga 实时接收localbus 信号，并进行运算处理，对接收机增益进行控制；对系统锁相环的控制指令、数据则通过串口发送给单片机，fpga 和单片机共同完成对接收机系统的控制。系统供电由cpci 机箱内5v、12v 开关电源提供。
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