简介
jesd204是一种连接数据转换器(adc和dac)和逻辑器件的高速串行接口,该标准的 b 修订版支持高达 12.5 gbps串行数据速率,并可确保 jesd204 链路具有可重复的确定性延迟。随着转换器的速度和分辨率不断提升,jesd204b接口在adi高速转换器和集成rf收发器中也变得更为常见。此外,fpga和asic中灵活的串行器/解串器(serdes)设计正逐步取代连接转换器的传统并行lvds/cmos接口,并用来实现 jesd204b物理层。本文介绍如何快速在xilinx® fpga上实现jesd204b接口,并为fpga设计人员提供部分应用和调试建议。
jesd204b 协议实现概述
jesd204b规范定义了实现该协议数据流的四个关键层,如图1所示。传输层完成样本和未加扰的帧数据之间的映射和解映射。可选的加扰层可用来加扰/解扰8 位字,以扩散频谱尖峰来降低emi。数据链路层处理链路的同步、建立与保持,并对加扰后的数据进行8b10b编码或译码。物理层负责以比特速率发送和接收编码后的字符。点击阅读更多内容
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