SK海力士完成业内首款多堆栈176层4D闪存集成PUC技术研发
继美光之后，sk海力士宣布完成了业内首款多堆栈176层4d闪存的研发，容量512gb/64gb，tlc。sk海力士透露，闪存单元架构为ctf（电荷捕获），同时集成了puc技术。公司将样品提供给controller公司去制作解决方案产品
海力士一直在推广96层nand flash产品中的4d技术，该产品将电荷阱闪存（ctf）与高集成度peri相结合，并采用单元（puc）技术。新的176层nand闪存是第三代4d产品，从制造上来说，其能够确保业内最佳的每片晶圆产出。与上一代相比，除了容量增加35%，它采用2分裂单元阵列选择技术后，单元的读取速度比上一代提高了20%，在不增加进程数量的情况下，采用加速技术的数据传输速度也提高了33%，达到1.6gbps。
电荷阱闪光灯（ctf）
与浮栅将电荷存储在导体中不同，ctf将电荷存储在绝缘体中，消除了电池之间的干扰，提高了读写性能，同时与浮栅技术相比，减少了单位电池面积。在ctf架构中，没有浮栅，数据被临时存放在闪存内由氮化硅成的非传导层，也就是所谓的保持室（holding chamber）中，从而可以获得更高等级的可靠性与更好的存储电路的控性。大多数3d nand公司正在采用ctf。
puc技术
这是一种通过在电池阵列下放置外围电路而使生产效率最大化的技术。那sk海力士的4d nand与竞争“对手”3d nand的区别是什么呢？sk海力士称其结合了自身ctf设计与periphery under cell（puc）技术。简单来说，3d闪存由阵列和外围电路两个主要组件组成。与传统3d nand相同，sk海力士的阵列是垂直堆叠的层用于存储数据，而外围电路排列在单元边缘。由电路控制阵列，但随着nand层的增加，它就会消耗芯片空间，增加复杂性与尺寸大小，由此增加产品的最终成本。
为了解决这一问题，sk海力士的4d nand采用了puc设计，将外围电路放置在阵列之下而不是围绕，来提高存储密度，同时降低成本。然而，这与英特尔和美光首次推出第一代3d闪存设计相同，那边称之为“cmos under array”（cua）。并且，三星也已经宣布其将来会转向cua型设计，因此这绝不能算是新技术了。
2分单元阵列选择技术（2-division cell array selection technology）
字线在nand闪存电路中向电池施加电压。层数越多，字线越薄，就会降低细胞的高度，对字线的电阻越大，就会影响速度。通过将连接字线的电池与现有的电池相比分成两部分，可以降低电阻，从而缩短施加电压的时间，提高读取速度。
电池层间高度降低技术
随着层数的增加，通过钻孔形成存储单元就会变得困难。这导致电阻增加，电流减少，难以保证性能和可靠性。为此，这就需要尽可能降低单元间层的高度，但这会增加单元间的干扰和缺陷率。电池层间高度降低技术不仅大幅降低了176层的电池层间高度，而且通过相关工艺和设计技术确保了具有竞争力的性能/可靠性。
层变定时控制技术
增加层数和降低层高往往会导致通道孔扭曲和单元散射恶化，从而降低每一层的性能和可靠性。该技术根据每层的特性调整施加电压的数量和时间，以保持均匀的电池特性，提高了性能和可靠性。
超精密定位技术
由于随着层数的增加，不可能一次钻出用于单元形成的孔，所以使用两次钻出孔的双堆叠工艺。双堆叠技术的核心是使堆叠误差最小化。如果堆栈没有正确对齐，将导致堆栈之间的电流流动不顺畅，并发生恶化，降低成品率、性能和可靠性。sk海力士自2017年推出72层的产品以来，就一直在使用双堆叠技术，对176层产品进行了改进，并基于自身的专业知识，实时自动校正孔的位置和尺寸。
存储厂商们各自努力，176层顶峰见实力
在全球nand市场份额中，虽然美光排在第七位，但是在堆叠能力方面，美光却毫不逊色。美光是第一家发布176层3d nand的存储厂商，其第五代3d nand闪存是176层构造，这也是自美光与英特尔的存储器合作解散以来推出的第二代产品。2020年11月9日，美光宣布将批量发售世界上第一个176层3d nand。
据美光官网介绍，该176层nand采用了独特的技术，替换门架构将电荷陷阱与cmos阵列下（cua）设计相结合，与同类最佳竞争产品相比，其die尺寸减小了约30％。
三星电子作为全球nand领导者，占有33.8％的市场份额，如果三星想在很长一段时间内保持这一头把交椅，就必须始终走在前面。三星电子计划在2021年上半年大规模生产具有170层或更多层的第七代v-nand闪存，并将使用字符串堆叠方法，结合两个88l模具，新芯片还将采用“双栈”技术。行业观察家表示，由于三星电子改变了其堆叠方法，该产品的发布已被推迟。
西部数据于今年1月份宣布，它已经成功开发了其第五代3d nand技术bics5，bics5设计使用112层，而bics4使用96层。
长江存储进步非凡，他们坚持创新发展，走差异化的路线，于2018年7月正式推出自家的独门绝技xtacking®架构。传统3d nand架构中，外围电路约占芯片面积的20~30%，降低了芯片的存储密度。随着3d nand技术堆叠到128层甚至更高，外围电路可能会占到芯片整体面积的50%以上。xtacking®技术将外围电路置于存储单元之上，从而实现比传统3d nand更高的存储密度。2020年4月，长江存储抢先推出了128层qlc 3d nand闪存芯片x2-6070。目前长江存储的技术已经处于全球一流的水准，下一步就是解决产能的问题。
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电荷阱闪光灯（ctf）
与浮栅将电荷存储在导体中不同，ctf将电荷存储在绝缘体中，消除了电池之间的干扰，提高了读写性能，同时与浮栅技术相比，减少了单位电池面积。在ctf架构中，没有浮栅，数据被临时存放在闪存内由氮化硅成的非传导层，也就是所谓的保持室（holding chamber）中，从而可以获得更高等级的可靠性与更好的存储电路的控性。大多数3d nand公司正在采用ctf。
puc技术
这是一种通过在电池阵列下放置外围电路而使生产效率最大化的技术。那sk海力士的4d nand与竞争“对手”3d nand的区别是什么呢？sk海力士称其结合了自身ctf设计与periphery under cell（puc）技术。简单来说，3d闪存由阵列和外围电路两个主要组件组成。与传统3d nand相同，sk海力士的阵列是垂直堆叠的层用于存储数据，而外围电路排列在单元边缘。由电路控制阵列，但随着nand层的增加，它就会消耗芯片空间，增加复杂性与尺寸大小，由此增加产品的最终成本。
为了解决这一问题，sk海力士的4d nand采用了puc设计，将外围电路放置在阵列之下而不是围绕，来提高存储密度，同时降低成本。然而，这与英特尔和美光首次推出第一代3d闪存设计相同，那边称之为“cmos under array”（cua）。并且，三星也已经宣布其将来会转向cua型设计，因此这绝不能算是新技术了。
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