跳频控制器的工作原理
本内容介绍了跳频控制器的工作原理，详细说明了发送通路及接收同路的工作原理
首先介绍跳频控制器发送通路的工作原理。
(1)数字化的发送信号加到fc的串入并出寄存器，fc把发送数据组织为16bit一组。当二个数据字节准备好时，fc对cpu发信号，cpu读取两个字节，并把它们存入作为fifo寄存器的ram部分。fifo控制器的工作起点与跳频周期(用信号hop表示)的起点同步。
(2)fc还包括一个8bit并入串出寄存器。送到收发信机模块去的数据从该寄存器取出。在发送同步序列期间和频率变换期间，从fc的串入并出寄存器来的数据积累在作为fifo的ram部分中。
(3)以信号fout-stopped(频率为18.3khz)为时钟将fc的并入串出寄存器的数据字节移出。移出的速率(18.3khz)高于数据装入fc的速率(16khz)，这两个数据速率之差允许cpu把同步数据插入发送数据流中，并在频率变换期间停止发送数据。
(4)由fc移出的数据送到射频音频接口rai模块。rai对发送信号滤波并把得到的信号txbbr加到收发信机模块系统连接器。
下面再叙述跳频控制器接收通路的工作原理。
(1)rai把接收信号rxbbr通到位同步器bis、相关器cor，并经线性均衡器加到fc。
(2)cor将接收的数据和cpu提供的基准序列进行逐bit的比较，当一致bit数大于cpu提供的门限时，cor给出相关脉冲。
(3)正相关脉冲和负相关脉冲加到位于rc模块的sytd微电子模块。sytd监视正相关脉冲，以便检测同步序列。当检测到同步序列时，sytd产生信号s4。s4的出现受一窗口信号w2的控制。
(4)bit同步器bis使跳频控制器的接收时钟fout与接收数据的实际时钟速率同步。在收发信机模块的4ms换频间隔期间和接收同步数据时，一窗口信号w1堵塞fout信号。
(5)fc把接收数据送到fifo寄存器，然后从fifo寄存器送到rai或dm。接收方式时fc的工作方式和发送方式时的相反，即，数据以18.3khz速率注入控制器，并以16khz速率从控制器读出。
(6)出现在fc输出端的串序数据加到dm。dm把数据变换成模拟信号，并送絉ai。
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(3)以信号fout-stopped(频率为18.3khz)为时钟将fc的并入串出寄存器的数据字节移出。移出的速率(18.3khz)高于数据装入fc的速率(16khz)，这两个数据速率之差允许cpu把同步数据插入发送数据流中，并在频率变换期间停止发送数据。
(4)由fc移出的数据送到射频音频接口rai模块。rai对发送信号滤波并把得到的信号txbbr加到收发信机模块系统连接器。
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(2)cor将接收的数据和cpu提供的基准序列进行逐bit的比较，当一致bit数大于cpu提供的门限时，cor给出相关脉冲。
(3)正相关脉冲和负相关脉冲加到位于rc模块的sytd微电子模块。sytd监视正相关脉冲，以便检测同步序列。当检测到同步序列时，sytd产生信号s4。s4的出现受一窗口信号w2的控制。
(4)bit同步器bis使跳频控制器的接收时钟fout与接收数据的实际时钟速率同步。在收发信机模块的4ms换频间隔期间和接收同步数据时，一窗口信号w1堵塞fout信号。
(5)fc把接收数据送到fifo寄存器，然后从fifo寄存器送到rai或dm。接收方式时fc的工作方式和发送方式时的相反，即，数据以18.3khz速率注入控制器，并以16khz速率从控制器读出。
(6)出现在fc输出端的串序数据加到dm。dm把数据变换成模拟信号，并送絉ai。
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