几种使用DMA的可行设计探讨
使用独立于内核的外设（cip）构建硬件状态机
简介
状态机是逻辑单元、存储器单元和反馈的组合。状态机的输入与状态机的当前状态组合在一起，确定下一个状态。当出现状态时钟时，下一个状态成为当前状态，状态机的输出由当前状态决定。
输入 q 与锁存器 x 的当前输出组合。其结果 g（x，q）为下一个状态，并锁存在系统时钟的有效边沿。锁存器x 的输出也可以经过其他逻辑（变换 f）来生成输出。这种配置通常称为 moore 型状态机。
各单元与 moore 型设计相同，只是增加了从输入到输出的前馈路径。这种配置通常称为 mealy 型状态机。
通常，因为单个状态可以通过前馈路径提供多个不同的输出，所以 mealy 型状态机的状态少于 moore 型设计。通常认为 moore 型设计更安全，因为其输出与状态时钟同步，从而减少了状态机输出上出现逻辑条件竞争的可能。但是，mealy 型状态机对输入变化的响应比 moore 型状态机更快。
今天推荐的应用笔记将探讨几种使用 dma 的可行设计，这些设计将采用上述任一配置来实现。
主要内容
moore 型状态机（无输入变换 g）
moore 型状态机（带输入变换 g）
使用 clc 和端口的 moore 型状态机设计
使用定时器外设作为状态机
使用 tmr2 和 ccp 的状态机
使用 tmr1、ccp 和 clc 的状态机
使用水平同步时序的状态机
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