hcsl(hcsl--high−speed current steering logic)一般用于pcie参考时钟的电平类型,根据规范需要下拉电路,如下图hcsl之间的dc耦合。hcsl为电流输出驱动,输出结构由通常通过50ω电阻器接地的15 ma开关电流源驱动。 标称信号摆幅为750 mv。
hcsl规范
hcsl输入输出拓扑
1-hcsl端接匹配
hcsl接口通常以50ω负载源极端接,其中rs大小一般为33ω,匹配50ω阻抗。 一般在输出端位置。驱动器本身具有17欧姆的输出阻抗,所以,需要串联一个33欧姆的电阻,以获得与50欧姆传输线的匹配。对于传统的hcsl,为了避免出现过度的振铃,串联电阻rs是必须要的。
2-lp-hcsl比较
lphcsl(low-power hcsl)是为了降低传统的hcsl驱动器的功耗而开发的。采用推-拉(push-pull)电压驱动,电流消耗大约4到5ma。
lp-hcsl输出功能与幅值对比
hcsl与lp-hcsl端接方式:
lp-hcsl直连即可,少了四个电阻效率高,速度快,支持ac耦合。
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