CMOS电路设计问题
一则cmos电路设计问题
这次遇到的问题是这样的，由于ldo的电源输出能力有限，同时也是保证可靠性，某些保护电路必须直接电源上，这里需要注释的是，limp home“跛行回家”即使我们的5v系统出现了问题，我们也必须保证部分重要的功能能继续工作，因此为了满足这个条件，关键信号的供电只能是直接接电池。
这次第一个出问题的是一个cmos的与门（he4000b系列的）。
我们的控制信号出自mcu（5v的系统），而与门的系统供电是12v的，因此两个电平不兼容，导致了mcu的高低电平统一被与门cmos芯片识别成低电平。
我们在设计转换电平的时候，有两个问题需要我们去注意
1.要相同的逻辑，不能做成反逻辑
2.在正常状态下，不能允许大的电流（为了符合静态电流的要求）这里设计的是低有效电路，因此在输出高的时候不能出现大的静态电流。
可行的改进设计为：
不过一波未平一波又起，由于iso16750的规定
而我们的与门能够承受的电压为18～20v，这也是所有cmos的ic的极限电压，因此该芯片华丽的烧毁了（在我们做1分钟的jump start实验的时候）
我们的解决方案，加个齐纳管15v钳位
此电阻需要仔细斟酌，因为在24v的时候，有7v的电压在电阻上面，要限制齐纳管的电流防止其过热，同时又要保证cmos的正常工作电流下，电压不会下降的太厉害。
v.cmos=v.batt-r.limit×i.and
i.zener_max=（24-15）/r.limit
以上需要综合考虑。
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