pex6-cop是一个灵活的fpga协处理器卡。它是带有fmc 输入输出模块并且集成了virtex6 fpga计算的核心的行业标准的半长pcie台式机或服务器卡。
fpga运算核心采用了xilinx公司的virtex6 fpga系列密度最高的lx550和sx475。 sx475提供了超过2000个运行频率高达500 mhz的dsp mac元素。fpga核心有两个qdrii+ sram bank和三个512 mb ddr3 dram的bank。每个存储器是完全独立的直接连接到fpga的。
对于系统通信,pex6-cop有一个pcie和辅助x4端口。 pcie端口是一个x8第二代接口,支持高达2.5 gb/ s的持续操作和4 gb/ s的突发速率。辅助端口可以用作aurora端口(x4到x1),作为第二个pci express x4端口,或使用自定义的协议。
符合vita 57的fmc接口,提供pex6-cop可配置的输入输出。fmc接口全面支持高引脚数连接器,有超过80对lvds直接连接到fpga和10个通道每通道高达5 gbps的传输速率。 fmc也很容易适应特定于应用程序的自定义模块。
pex-cop系列的功率典型的操作是小于15w的。该卡可以适应温度范围(-40℃至+85℃),湿度为100%。
使用framework logic的工具集可以完全定制fpga逻辑。 该工具提供支持matlab和rtl设计。matlab bsp支持使用图形化框图simulink环境与xilinx system generator的生成器实时硬件在线开发。如ddc,解调和fft信号处理内核等用于无线通讯,雷达和信号情报的应用范围的ip核也可提供。
主机开发的软件工具包括c ++库和驱动程序适用于windows和linux(包括实时的变种)。以及展示了模块功能的应用实例
fmc高速数据采集和软件无线电接口板
与pex6-cop配套的fmc 接口卡有;fmc-500m高速数字化和的信号产生fmc io模块,具有两个500 msps a / d通道和两个500 msps d / a通道的采样时钟和触发功能的支持。
fmc-500m提供两个14位500msps的16位250 msps a / d转换,无论是ac或dc耦合,加上两个500msps更新率的dac。 dac可以使用一个单一的1 ghz的输出通道。模拟io是ac或dc耦合。接收器??支持高达250 mhz的if频率。采样时钟是从一个低抖动pll或外部输入。多卡可以同步进行采样。
fmc-500m功耗为6w典型的操作。该模块可vita20标准和散热板传导冷却。强化宽工作温度从-40到+85°c操作和0.1 g2/hz时的振动水平。敷形涂料是可用的。
支持vhdl逻辑与fpga载卡一起提供。对于innovative integration载体卡的具体支持内容包括支持vhdl / verilog的framework logic工具和matlab开发。 对于fmc模块与fpga的载体卡集成matlab的板支持包支持使用图形框图的simulink环境与xilinx 系统生成器实时硬件在线开发。
fmc-sfp+在一个带有可编程时钟和支持功能标准的fmc模块提供4个sfp+端口。光纤连接到远程io,如远程无线电的应用程序,从主机处理和fpga卡支持高达5 gbps的比特率。
sfp+端口与sff-xxxx收发器兼容,支持铜缆和光纤连接。这四个端口的模块是完全独立的。 sfp+的监测和控制信号映射到fmc接口用于检测,丢失信号,速率控制和i2c控制端口。
fmc-sfp+上的一个灵活的参考时钟在0.16 - 350 mhz范围内是完全可编程的。时钟可以通过编程适用于所有标准的通用速率率如oc-12,cpri,obsai,千兆以太网,sfpdp和sonet。最大时钟抖动小于1 ps rms,使其能够满足最严格的要求,这些应用程序。 一个卡上pll参考是10mhz是0.5 ppm稳定度。
fmc-sfp+是与fmc(ansi / vita 57)规格io模块完全电气兼容。物理上,模块将符合fmc接口尺寸,但突出于面盘上的sfp。该模块与4个fmc hpc sfp端口或lpc(1个sfp端口)兼容。不包括sfp+模块时,模块功耗小于500毫瓦。
fmc提供的接口vhdl代码说明。具体的fpga和平台支持提供了innovative integration的vpx-cop和pex-cop fpga卡。
PID控制的作用
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