PCIe中断机制介绍（MSI）
前面的文章中介绍过，msi本质上是一种memory write，和pcie总线中的message概念半毛钱关系都没有。并且，msi的data payload也是固定的，始终为1dw。
由于msi也是从pci总线继承而来的，因此msi相关的寄存器也存在于配置空间中的pci兼容部分（前256个字节）。如下图所示，msi有四种类型：
其中capability id的值是只读的，05h表示支持msi功能。
next capability pointer也是只读的，其用于查找下一个msi的位置，00h则表示到达linked list的最后了。
message control register用于确定msi的格式与支持的功能等信息，如下图所示：
具体描述如下：
message address register：32-bit最低两位固定为0，使得该地址是dw对齐的。
当mask bits将相关的中断向量（interrupt vector）屏蔽后，该msi将不会被发送。软件可以通过这种方式来使能或者禁止某些msi的发送。如果相关中断向量没有被屏蔽，则如果发生了相关中断请求，这时pending bits中的相应bit则会被置位。一旦中断信息被发出，则该bit会立即被清零。
注：可能有的人会有疑惑了（无论是mindshare的书，还是pci的spec都没有明确解释），因为mask bits和pending bits都只有32位，而8位的中断向量号最多可以表示256个！显然，32位最多只能对应32个中断向量号，无法支持256个的。实际上，一般的系统不会支持256个中断向量号的，32个就已经足够用了，所以并不用担心这个问题。
pcie设备会根据配置空间中的msi请求信息，来创建memory write tlp，来讲msi信息发送出去。作为一种特殊的tlp，传递msi的tlp需要遵循以下规则：
· no snoop和relaxed ordering bits的值必须为0
· tlp长度值必须为01h
· first be必须为1111b
· last be必须为0000b
· 地址是直接从配置空间中的响应位置复制过来的
如下图所示：
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