逻辑电路主时钟的基本作用
逻辑电路主时钟
我们知道，不管哪一个平台， 要让cpu跑起来，就必须有一个主时钟，在mtk平台中，这个主时钟多为26 mhz，高通平台则为19.2mhz，其他平台，如adi marvel等多为13 mhz，而在80c51系列单片机平台中，主时钟则多为11.0592 mhz。
在80c51系统中，cpu的工作频率就是11.0592 mhz，但我们知道，手机cpu的主频可不是26 mhz、19.2 mhz或者13 mhz这么低的频率。以目前的手机平台而言，cpu的主频动辄就在500mhz以上，很多甚至都已经超过1ghz。那么，cpu的主频时钟从何而来? 另外一方面，手机的rf信号，其频率高达1~2ghz左右，这些时钟又是从何而来的?
事实上，手机中的主时钟，更多的是用来作为pll (phase lock loop)电路中的参考信号的。利用pll中的闭环负反馈原理，使得输出信号频率 与主时钟的频率构成一定关系， 如式下所示:
f out= nf ref
f ref表示主时钟频率，fou表示pll电路输出频率，n表示分频比(多为复数)。
对于某个确定的平台或模块，frer是 一定的，但只要对各个pll电路设计不同的分频系数n,就会得到频率各不相同的fout。这便是在大多数手机平台中，通常只有一个fref, 却有不同fout的由来，如主时钟恒定为26 mhz，但rf tx频率却在1~2 ghz可配置。
另外，从式可以看出，只要主时钟的频率维持稳定，则输出信号频率也可以维持稳定，这也就是我们在pcb布局布线中特别重视主时钟信号隔离与保护的原因。
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