六类存内计算技术原理解析
过去几十年来，在摩尔定律的推动下，处理器的性能有了显著提高。然而，传统的计算架构将数据的处理和存储分离开来，随着以数据为中心的计算（如机器学习）的发展，在这两个物理分离的单元之间传输数据的成本越来越高，在整体延迟和能耗方面占据了主导地位。
专用处理器的能效
同时，尽管传统逻辑门具有通用性和鲁棒性，但其计算效率低下，在进行乘法、加法和非线性函数等算术计算时需要消耗大量资源。此外，通过在底层硬件层面构建多个内核来提高计算并行性也需要耗费大量资源。
传统的计算硬件基于冯-诺依曼架构，处理和内存分离，数据需要在两者之间来回穿梭。这在处理机器学习任务时效率很低，既限制了计算速度，又浪费了电力。神经形态计算有各种不同的形式，是一种可能的解决方案，例如，ibm研究院的研究人员最新设计的芯片中受大脑启发，它将内存和处理元件共置一地，无需访问片外内存。这种被称为northpole的芯片能以比现有架构更快的速度和更低的能耗执行图像识别任务。
另一种也可归入神经形态计算的方法是存内计算。在这里，计算任务被转移到存储它们的内存单元中。迄今为止，已开发出了一系列复杂的存内计算技术，用于克服冯-诺依曼瓶颈，并持续提高计算吞吐量和能效。
01.在后摩尔时代提高计算机性能
存内计算（cim）技术是解决摩尔定律瓶颈的潜在方案之一。
cim与“存算一体化”（in-memory computing）和内存处理密切相关，其子领域有时被称为存内逻辑。cim的基本思想是，将数据计算移至存储数据的内存单元，从而实现原位计算，消除带宽限制和数据移动成本。
它通常利用物理定律（如基尔霍夫电流定律）和内存阵列中的电荷共享来进行模拟计算，创建高效的计算基元，包括逻辑门和乘积（mac）操作。此外，交叉点随机存取存储器（ram）架构允许自然扇出，从而促进了大规模计算并行性。
这些优势催生了各种cim研究方向，目的是在后摩尔时代提高计算机性能，并为人工智能（ai）等应用构建计算加速器。
cim研究涉及从基础电子器件到高级架构和大规模系统的各个层面，可以使用新兴的电阻式存储器，也可以使用成熟的硅基存储器。尽管名称相同，但cim技术的基本原理却大相径庭，这取决于全部或部分输入操作数是否由存储单元就地提供、计算完成后是否将输出重新就地存储在存储单元中、输入/输出数据是易失性还是非易失性，以及输入/输出数据是否以相同的物理方式表示......这些差异使得我们很难对cim技术形成全面的认识。
计算基元和cim的基础部件。a）冯-诺依曼体系结构和cim体系结构中计算原语的ouroboros模型。在冯-诺依曼计算机中，计算路线从基本逻辑门开始，提供算术运算，以支持人工神经网络等算法。所有这些计算都在处理器中执行，处理器与整个内存层次结构通信，以运行完整的程序。在当今的cim提议中，计算一般基于存内单元中的物理mac运算，利用物理定律进行乘法和求和。物理mac可以很容易地在内存阵列中并行化，以进行向量和矩阵运算，这反过来又为ann奠定了基础。b）cim架构，包括内存阵列瓦片组、输入/输出（i/o）缓冲器和控制器。c）包括vm和nvm在内的存储器技术，所有这些技术都可以在交叉点架构中实现cim
mac是计算机运算的基本操作，它与基础布尔逻辑门的关系如图所示。在冯-诺依曼计算机中，所有操作都依赖于功能完整的逻辑门，而逻辑门又是由互补金属氧化物半导体（cmos）晶体管构成的。逻辑门用于构建算术计算的处理核心，其中最重要的是mac运算。由于矩阵代数的常规形式，标量mac运算可通过顺序处理或多核并行化扩展到矢量/矩阵运算。
最后，矩阵代数为大量算法奠定了基石，其中，ann（和深度学习）是当今最受关注的算法。就cim而言，其理念始于嵌入式电路物理的mac运算，它通过基于ann的阈值逻辑概念为逻辑门奠定了基础，而逻辑门又是通过向量运算实现的。并行mac或逻辑门都可以沿着存储器阵列中的一列进行，尽管前者是后者的基础。在这种方法中，并行mac和复合逻辑门都用于执行矩阵计算，例如神经网络。
与cmos逻辑门相比，cim逻辑门的优势在于能将计算融合到存储器阵列中，以及交叉点ram架构提供的大规模计算并行性。 由于cim逻辑门依赖于物理定律的模拟计算，任何线性可分离的逻辑功能都可以在一次操作中完成。因此，复杂的逻辑功能可以通过减少运算次数和降低硬件成本来轻松实现。
02.六类存内计算技术
全方位的cim技术可抽象为一个等式z = x¤y，其中符号¤代表逻辑门或点乘运算。对于点乘，x和y分别代表权重向量和输入向量，z是标量输出；对于逻辑门，x和y是两个输入操作数，z是逻辑输出。
根据x和y是否由存储单元提供，以及计算结束时输出z是否重新存储在存储单元中，cim被分为六类：xyz-cim、xz-cim、z-cim、xy-cim、x-cim和o-cim。
全方位的cim技术。每种类型的cim都标明了候选存储器、计算基元和主要应用。频谱是在将并行mac（点积）和逻辑门抽象为z = x¤y的基础上建立的，其中x和y可以是标量或向量，z是标量，¤是表示cim操作的符号。所有cim技术分为六种类型，从全部在内存中到不在内存中，每种类型都有若干nvm和/或vm种类，进而针对通用或特定应用
xyz-cim
x和y均由阵列中的存储单元提供，输出z也重新存储在一个存储单元中。计算依赖于x和y的隐式读出，从而修改bl电位，最终改写输出单元。xyz-cim是典型的布尔逻辑运算，已通过单位非易失性rram、pcm、mram和易失性dram实现。
xz-cim
在计算过程中，只有一个输入操作数驻留在内存单元中。另一个输入由外部施加的电压编码，输出z在计算结束时重新存储为单位单元状态。xz-cim仅适用于基于nvm的逻辑运算，典型的存储器技术包括rram和mram。
z-cim
存储单元中只存储输出z，输入通过bl和wl提供。考虑到bl和wl电压的所有可能组合，由此产生的单比特单元状态构成一个逻辑门。z-cim已在rram、mram和pcm等nvm上实现。
xy-cim
输入操作数x和y均由存储单元提供，而输出z则通过bl检测放大器 (sa) 获得。它也适用于逻辑运算，存储器技术可以是电阻式nvm或sram。它的工作原理是并行读出两个单比特存储单元，并将读出结果感应和离散化为二进制输出。
x-cim
只有输入x由阵列中沿一列的存储单元提供，y由施加到wl的外部电压表示，输出z则在bl外围获得。与上述类型的cim不同，x-cim通常旨在以高度并行的方式执行两个向量的点乘。所有存内技术，包括单比特或多比特nvm和单比特vm都已实现了x-cim，这为进一步鼓励其研究提供了积极反馈。
o-cim
这里没有存储单元之间的交互，而是将传统逻辑门或计算模块置于存储单元或阵列附近进行计算。o-cim通常采用成熟的存储器技术进行设计，包括sram和dram。它类似于早期的近存储器计算概念，但其进步在于进一步缩短了存储器与处理器之间的距离。
由于全面识别了输入的来源和输出的方向，基于该分类法的频谱应涵盖所有cim技术。在频谱的末端，它与传统的冯-诺依曼范式相联系。在这一范围内，特定的存储技术可能被用于多种类型的cim，但原理各不相同。另一方面，某些类型的cim在技术上可能只适用于特定的内存设备，或只值得关注。此外，计算基元与cim类型相关，并最终与存储器载体相关。
除o-cim外，所有其他cim类型都依赖于模拟乘法、加法和电路中物理定律的非线性激活。将前两种运算结合起来，就可以得到用于并行mac运算的点乘，而将所有三种运算结合起来，就可以得到布尔逻辑门。
03.各种cim技术的原理
xyz-cim、xz-cim和z-cim的共同点是将输出z原位存储在存储单元中。它们都主要使用新兴的nvm进行逻辑运算。由于新兴nvm通常是基于电阻的存储器，因此可将其视为一般的两端电阻开关 (rs) 器件。通常情况下，当器件两端的电压足够大且具有正负极性时，就会通过“设置”切换到高导状态（hcs），或通过“复位”切换到低导状态（lcs）。
这种描述适用于rram、mram和ftj。由于cim通常只使用一种开关极性，因此单极性开关pcm也可包含在此模型中。两种电导状态编码二进制1和0，与传统存储器应用相同。对于逻辑门，计算依赖于器件的条件开关，这是其他器件状态和外加电压的函数。这种非线性特性可视为 ann中的激活函数。
因此，任何基于rs的nvm器件都有可能用于这三种类型的cim。
xyz-cim、xz-cim和z-cim。a）电阻式存储器件示意图及其rs行为；b）xyz-cim的状态imp逻辑；c）xyz-cim的sfnn；d）dram位向逻辑；e）xz-cim 的逻辑运算；f）z-cim 的逻辑运算
xyz-cim：nvm有状态逻辑
在xyz-cim建议中，一种突出的方法是基于所谓的有状态逻辑，利用nvm器件（通常是rram）实现。蕴含（imp）门最初是为有状态逻辑运算而提出的，一个rram单元的电导状态编码输入操作数x，而另一个单元则代表操作前和操作后的输入y和输出z。电阻的电导值大致设定在lcs和hcs的对数值中间。
vp（例如，vw/2）和vw分别施加到两个wl中的一个不同的wl上，其中vw足够大以实现设定的转换，而vp则不然，同时bl电阻器接地。激活后，单元y的最终状态，即输出z，根据imp函数确定。具体来说，如果y单元最初处于hcs (1)，则施加的电压极性不会触发开关；如果y最初处于lcs (0)，则其开关取决于x：如果x处于lcs，由于两个lcs设备的隔离，bl电位将接近于0。
因此，器件y上的压降足以将其切换到hcs；但如果x位于hcs中，vp将大大提高bl电位，从而阻止y的切换。
xyz-cim：dram位向逻辑
dram位向逻辑是另一项重要的xyz-cim提议，它依赖于计算期间的锁存型sa同步重写。商用dram产品只需少量修改甚至无需修改即可实现该功能。
图（d）显示了由三个dram单元组成的一列，在bl的末端有一个锁存型sa。sa是一个双稳态电路，由两个cmos反相器组成，形成一个正反馈回路。与bl相连的终端既是输入节点，也是输出节点，通过它来检测和修改bl电压。当bl电压高于（或低于）vdd/2时，sa迅速做出反应，将输出稳定在vdd（或0）。在逻辑运算中，多行同时被激活。因此，电路自然会执行三个输入单元的多数逻辑功能，逻辑结果最终会重新存储在所有三个单元中。
第一步，将bl预充电至vdd/2，以实现位向逻辑。然后，用vdd同时激活三个wl，而sa尚未激活。存储在dram单元x、y和q中的电荷由所有dram电容（电容cc）和寄生bl电容（电容cb）共享，从而使bl电位达到vdd/2。
多数逻辑函数是线性可分离的，dram电路可视为单层感知器，类似于sfnn。在该模型中，输入是存储的电压电平，网络权重由电容给出，非线性激活神经元由阈值为vdd/2的锁存型sa激活。在多数门的基础上，可以方便地实现更复杂的功能，例如全加法器。为了实现一套完整的逻辑门，可以利用sa中的互补位设计not门，通过另一个选择晶体管将互补位写入双触点单元。与保留所有输入的sfnn不同，dram位逻辑对逻辑输入具有破坏性。为解决这一问题，可在阵列中专门设计三行用于逻辑运算。
此外，在逻辑运算之前和之后，应执行rowclone操作，即利用相同的电荷共享原理将源行中的数据复制到目的行，以便在阵列内传输输入和输出。
xz-cim
xz-cim还依赖于rram和mram等nvm器件的条件切换。有状态逻辑以两个输入存储单元的电导状态为条件，而xz-cim中用于调节的两个输入则分别用电导状态和电压表示。
这种编码方法为逻辑门的构建提供了更多便利，并使xor等线性不可分割函数的一步操作成为可能，但却增加了级联时转换输入和输出异质属性的成本。基于两个rram单元的典型xz-cim逻辑门如图（e）所示。一个输入操作数x由rram器件的电导状态提供，而另一个输入操作数y则由外加电压编码。
输出重新存储在第二个单元中，该单元初始化为lcs（0）。bl负载电阻的电导值设置在lcs和hcs之间，以便进行适当的分压。输出存储单元采用恒定的vp，条件是vset/2 < vp < vset，然后wl1和bl的电压决定逻辑门的类型。在xor的情况下，wl1和bl的电压分别为 (y - 1)vp 和 (-y)vp 。
通过改变所加电压的编码方案，该电路可以实现所有16个双输入布尔逻辑门，从而简化复杂函数的逻辑合成，进而缩短cim的延迟时间。
z-cim
基于nvm的逻辑可扩展到z-cim，其中输入操作数x和y均通过施加电压来提供。输出z作为存储单元的电导状态就地存储（图f）。除了mram和pcm之外，rram一直是z-cim研究最活跃的对象。
它基本上基于nvm的传统写入操作，但对传统上被认为无效的其他输入组合进行了逻辑扩展。rram的切换取决于压降的极性和初始电导状态。当存储单元最初处于lcs状态（z0 = 0）时，只有x = 1 (vw)和y = 0的输入组合才能将设备切换到hcs，即z = 1，而在其他输入情况下，设备仍处于lcs状态（z = 0）。当存储单元最初处于hcs状态（z0 = 1）时，只有x = 0和y = 1 (vw) 的组合才会关闭设备并存储 z = 0，而在其他情况下，设备仍处于z = 1状态。这两种情况分别对应于非蕴涵函数（nimp）和互补蕴涵函数（cimp）。
通过将一个输入固定为1或0，或通过交换应用于wl和bl的操作数以及级联此类操作，所有14个线性可分离逻辑门都可以用存储单元来实现。
线性不可分离的xor/xnor是例外。为使其可行，应采用基于堆叠两个极性相反的电阻开关的互补rram概念，利用其非对称读出过程。另外，1t1r单元可以更有效地执行z-cim的xor逻辑，这要归功于该结构的终端数量较多，便于对输入操作数进行编码。
xy-cim
基于nvm或sram的逻辑运算也提出了xy-cim。
就nvm而言，两个输入操作数是存储单元的二进制电导状态（lcs或hcs）。基本上，任何具有两种不同电阻状态的nvm器件都可用于xy-cim，包括本征三端器件，如 fefet。在同时激活两个wl时，存储单元的状态被读出到bl，其中的电流（ilcs或ihcs）被累加，并由电流模式sa感测。可以将sa视为二元神经元电路，以参考电流作为激活阈值，产生逻辑输出。
两个输入的四种组合会产生以2ilcs、ilcs + ihcs和2ihcs为中心的三种bl电流分布。因此，在2ilcs和ilcs + ihcs之间（或ilcs + ihcs和2ihcs之间）设置sa的阈值，就能得到线性可分离的or（或and）逻辑函数。
鉴于神经元激活是通过cmos电路实现的，因此很容易得到两个逻辑门的倒数，即nor和nand。or和nand的组合将产生线性不可分割的xor逻辑，通过连续施加两个参考电流来实现。
xy-cim和x-cim。a）xy-cim基于电阻式nvm的逻辑运算。b）基于sram的xy-cim逻辑运算。c-f）基于被动1r nvm（c）、基于1t1r nvm（d）、基于nor闪存（也基于fefet）（e）和基于sram（f）的点积运算
就sram而言，xy-cim的两个输入操作数由存储在sram单元中的电压电平提供。
sram单元的核心是双稳态电路，其两个内部节点存储二进制电压电平及其补码。在标准6t sram结构中，两个选择晶体管控制bl和互补blb，以访问两个节点。在进行逻辑运算时，bl和blb首先被预充电到vdd，如同sram的读出过程。
同时激活两个wl时，bl和blb 可能会放电，这取决于两个sram单元的状态。具体来说，只有当输入x和y均为1时，bl才会保持在vdd位置。如果有一个单元处于0状态，则bl放电至较低电压；在两个单元都处于0状态的情况下，bl电压的降低会加剧。
通过为sa设置参考电压，以区分vdd和其他降低的bl电压，sa输出被识别为and逻辑结果。当blb访问输入位x和y的补码时，sa采用相同的参考电压提供nor逻辑。
同样，and和nor的组合也有助于xor逻辑。传统6t sram的位逻辑运算会受到存储单元的干扰，这是由于通过同一端口的写入和读取路径耦合所致。当多个wl同时开启时，bl/blb可能会放电，进而导致存储单元状态翻转。为解决这一问题，主要策略是通过增加存取晶体管或修改其配置来解耦写入和读取路径，从而形成4 + 2t/8t/10t sram结构。此外，wl的欠驱动或异步激活也有助于解决干扰问题。
x-cim
x-cim的基本物理原理与xy-cim基本相同，只是输入操作数的定义不同。
通常，x-cim以实现并行mac运算为目标，其中一个输入操作数由表示权重向量x的存储单元列提供，另一个输入则是外部施加到wl或其他线路上的电压向量y。因此，这两个向量的点积在bl上以电流或放电累积的形式产生，然后由bl外围电路感应。人们对ann加速器的浓厚兴趣促使所有存储器技术都被用于x-cim，该技术正在积极研究中，并努力实现模拟-数字混合浮点精度方案。
x-cim也可能意味着基于非易失性存储器（如mram和fefet）的逻辑运算。然而，人工智能加速器在并行mac运算方面的大量工作使这方面的努力黯然失色。
在虚拟机方面，sram凭借其独特的优势和工业成熟度，包括快速读/写速度、低功耗、无限耐久性以及与最先进逻辑工艺的兼容性，在利用x-cim进行并行mac加速方面备受关注，尽管其代价是单元占用空间较大。值得注意的是，在锁存器电路中，还包括x的补码二进制向量，这对带符号计算非常有用。
sram结构具有丰富的灵活性，可用于可靠、高效的x-cim优化，但4t锁存器电路始终是权重存储的核心。一种策略是通过采用8t/10t/12t结构来解耦读出路径，以保护sram单元免受干扰，但这会进一步加剧单元占用空间的问题。在一些基于标准6t sram阵列的方案中，加入了专门设计的局部计算单元和全局bl，以平衡电路功能和面积开销之间的权衡。
根据存储器技术的不同，存储在存储器单元中的权重向量x可以是单位或多位的。虽然vm通常是单比特器件，但许多nvm显示多比特甚至模拟状态，这是提高x-cim吞吐量的关键因素，而机器学习加速非常需要这种吞吐量。闪存、fefet、pcm、rram和ftj是出色的模拟电导器件，这要归功于它们的基本物理特性，允许对电荷存储、铁电极性比、晶体体积和导电丝直径等状态变量进行持续调整。
因此，这些非易失性存储器件的存储窗口很大，从10到10^6不等，这使它们能够在单个单元中存储多比特信息。由于电导开关比小，mram被认为是单比特存储器，尽管目前正在努力开发多比特器件。为了最大限度地提高计算效率，输入矢量y通常编码为多比特值，如具有模拟幅度或宽度的wl电压脉冲，不过也可能采用串行二进制脉冲以节省数据转换成本。
因此，cim操作是在电流域、时域或电荷域进行的。鉴于x和y都可能是二进制值、模拟值或由差分运算实现的双极值，两个元素的乘法运算可能采用and逻辑、双极xnor或纯模拟结果的形式。由于多位输入和同时激活的多个wl（通常为≫2），点乘的检测需要一个能量化多个离散输出电平的转换电路，这通常通过多级sa或模数转换器 (adc) 来实现。与存储单元相比，sa和adc通常要大得多，耗电量也更大。因此，除了原位计算和x-cim固有的并行性，sa或adc已成为另一个效率瓶颈，需要进行设计优化，以保持cim带来的性能提升。
o-cim
最近，基于sram的cim通过在存储单元附近加入传统逻辑门，逐步转向全数字领域。由于在计算过程中不需要融合存储单元，因此被合理地称为o-cim。
在这种方法中，一个输入操作数通过一条专门设计的线路从外部提供，另一个输入操作数从sram单元读出并输入到邻近的逻辑门，由逻辑门执行两个操作数的乘法运算。为了对乘法结果进行求和，必须在附近部署分层加法器树，在数字域中产生部分和。
就dram而言，传统的计算模块不是将单个逻辑门嵌入存储单元周围，而是靠近阵列构建，从而利用阵列级并行性实现mac加速。o-cim通常采用成熟的易失性存储器进行设计，以寻求与当代商业产品的工业兼容性。通过采用标准数字计算单元，o-cim比其他基于模拟计算的cim更为可靠。
04.cim技术发展的挑战与展望
不同cim方案的主要特点和挑战，以及这些方法在器件可靠性和计算效率方面面临的挑战
cim技术可用于融合内存和计算，并为加速计算提供空间并行性。 它们还可以通过使用非常规但功能强大的逻辑门（例如多数函数），以及将算术运算直接映射到硬件电路，来提供高效计算。
cim可通过同时激活多个wl来实现，从而通过阵列中的物理规律启动存储单元之间的交互。目前已开发出一系列cim技术，其中许多技术都基于交叉点阵列架构——该架构可容纳几乎所有存储器技术。
新兴的nvm已成为cim的重要候选技术，并被用于探索一系列超越内存的应用。相反，dram和sram等成熟内存技术的修改较少：dram已针对存储密度和减少漏电进行了优化，因此不利于工艺修改，尽管cim在阵列中造成的开销不到1%；sram的优势在于其在现代逻辑制造工艺中的灵活性，允许定制存储器阵列设计，尽管标准的6t sram仍受到重视。
在cim中，逻辑门的开发旨在为通用计算提供功能完整的逻辑集，所有xyz/xz/z/xy-cim类型都能通过众所周知的逻辑集（如and + or + not 门或单一nand或nor门）或非常规逻辑集（如imp + false门）提供这种功能。相比之下，并行mac是为加速神经网络等特定应用而开发的。
在不同的逻辑门cim方案中，有两个因素可用来区分不同的方法：计算（即非线性激活）是否由被动rs单元执行，以及输入和输出操作数的物理属性是否相同。在前一种情况下，使用rs单元作为神经元的nvm有状态逻辑、xz-cim和z-cim实现非常紧凑，但dram比特逻辑和xy-cim方案需要额外的有源sa进行计算，因此牺牲了部分面积效率。在后一种情况下，xyz-cim被认为是一种真正的cim方法，因为所有输入/输出操作数都由阵列中的存储单元就地表示；它没有转换过程，因此可以轻松实现级联，并有利于顺序处理的整体延迟。
相反，nvm的xz-cim、z-cim和xy-cim则需要额外的操作来将输出读出为电压（或将输出写入为电导），以便级联下一个逻辑门，从而造成延迟，阻碍吞吐量的提高。就sram而言，可能需要设计一个特殊单元，将逻辑输出写入单元，以便后续访问。
x-cim和o-cim均用于并行mac，但使用方式不同：即模拟与数字。x-cim可以提供很高的能量/面积效率，这要归功于将计算基元直接映射到存储器阵列的高效方法。然而，由于计算过程的模拟性质，它的精度会因设备（如电阻单元、电容器或晶体管）、阵列和电路的非理想性而下降。在一次操作中，还可以提高输入的分辨率、nvm的存储容量和cim单元的并行性，从而提高计算吞吐量。然而，这种优势也带来了输入数模转换和输出模数转换的开销。
在nvm的x-cim应用中，神经网络已被提出，由于每两层神经元之间的权重矩阵是固定的，因此mvm可以自然级联。对于通用应用，由于存储单元中一个向量的隔离，可能需要像逻辑门一样的属性转换过程来进行级联操作。
o-cim在数字域中使用传统的cmos逻辑门。因此，它的计算稳健性更高。此外，由于省去了adc和数模转换器 (dac)，数据转换的负担也得以克服。模拟x-cim的硬件映射是固定的，与之相比，数字o-cim具有更高的灵活性，可以适应更广泛的问题。不过，由于每个处理元件都包括一个乘法器和一个用于mac运算的加法器，因此它在面积和能效之间进行了权衡，类似于其他数字加速器，如基于收缩阵列的设计。
在用于逻辑运算的cim类型中，nvm状态逻辑、xz-cim和z-cim依赖于存储器单元的动态rs，因此要求器件具有较高的耐用性，以支持频繁的逻辑门操作。因此，pcm（据报道其耐用性超过10^10）似乎更适合（尽管还不够）这些类型的cim。rram的最新耐用性相当有限（超过10^6），必须加以改进才能达到要求。mram的表现甚至更好，一般显示出10^12的耐用性。然而，mram本身受限于较小的内存窗口，这对可靠的模拟计算，尤其是多输入逻辑门构成了障碍。
由于xy-cim和x-cim基本上是两个或多个单元的并行读出过程，因此可以采用任何具有两个或多个不同状态的存储器件。因此，nvm器件的时间保持特性和状态变化应足以保证可靠的读出、求和和离散化，分别由用于逻辑运算或并行mac的sa或adc完成。虽然nvm器件在传统的二进制存储器应用中一般都能保持足够的存储时间（85°c时超过10年），但在逻辑运算中，两个或多个单元状态的线性叠加会对存储性能造成更严格的限制。特别是在用于并行mac的x-cim中，最好有一个多比特单元，通常会同时激活多个单元以提高吞吐量。
在这种情况下，除mram外，所有nvm设备都显示出较大的存储窗口，从而实现了多位存储。然而，由于受到状态变化的严重限制，最先进的nvm只能提供可靠的两比特容量。因此，要实现更大容量的存储单元，仍有很大的器件优化空间，成熟的多级nand闪存可以作为很好的参考。
非易失性存储器的模拟电导经常被用于计算，通常是为了在人工智能加速器等典型应用中实现较高的等效吞吐量和能效。然而，必须注意的是，传统的存储器模式应始终保持，在这种模式下，应能以足够的读出余量区分多种状态。为了开发可靠的基于电阻式nvm的cim技术，在算法和系统层面已经做出了许多努力，但这些努力通常仅限于特定应用。
位切片、分而治之和补偿等策略已被用于扩展大规模问题的计算精度。虽然这些解决方案可方便地应用于正向矩阵乘法，但对于x-cim的矩阵反演而言，这些问题变得难以解决，从而为基于电阻式nvm的通用矩阵计算留下了探索空间。
nvm设备的耐用性不足是有状态逻辑、xz-cim和z-cim所面临的关键问题，阻碍了它们在实际应用中的发展。对于有状态逻辑和xz-cim而言，由于两者都依赖于模拟乘法、求和及非线性激活，因此必须保证设置/复位电压以及lcs和hcs在周期与周期之间以及设备与设备之间的低变化，以限制逻辑运算的误码率。
z-cim不需要模拟乘法和求和。因此，它只需要较低的设定/复位电压变化。相比之下，xy-cim和x-cim则需要较低的lcs和hcs变化，以实现可靠的cim操作。特别是在使用多位nvm器件的并行mac中，输入存储单元的电导分布和点乘结果会变得更加复杂，因此需要设计精细的读出电路（sa/adc）。此外，x-cim还可能涉及神经网络训练。因此，电导更新在电导范围的最小或最大边界具有良好的线性非常重要。
要克服nvm器件的耐久性、时空一致性和更新线性等挑战，从根本上说，这些都是由器件物理特性控制的，因此必须对器件材料和结构进行优化，从源头上解决这些问题。所有这些cim方案都依赖于模拟计算，而模拟计算很容易受到工艺-电压-温度（pvt）变化的干扰。不过，对于使用新兴nvm的cim的pvt问题，目前仅有偶尔的研究，但这是实际应用过程中的一个重要挑战。
要最大限度地提高cim的能效，需要解决几个问题：
1）在基于rs的cim方案中，每个事件都会导致相当大的功耗。因此，需要优化设置/复位电压和电流。
在使用静态存储单元状态的xy-cim和x-cim中，nvm器件较低的绝对电导率应有助于降低能耗。尽管如此，这种优化并不容易，因为低电导通常伴随着非线性电流-电压特性，这会带来额外的计算误差。
2）在合成具有完整功能逻辑集的复杂逻辑运算时，可选择的方法多种多样。
它可以由许多双输入门电路或少数几个多输入门电路组成，从而导致硬件和延迟成本的巨大差异，以及对模拟非理想性的不同敏感性。因此，要实现可靠而高效的逻辑合成，就必须权衡利弊。x-cim一直在努力解决adc和dac的开销问题，而这正是提高能效的主要挑战。在o-cim中，虽然使用单逻辑门（例如nor门）可以方便地实现乘法器，但加法器树一直是公认的瓶颈。因此，需要在这方面进一步努力，以提高能效和面积效率。
3）此外，虽然x-cim的并行mac已被证明在加速计算方面具有相当大的潜力，但它本质上无法提供通用计算系统。在这种情况下，cim方法中逻辑门与并行mac运算的结合值得进一步探索。
05.存内计算开辟数据处理新范式
目前，存内计算提供了多种技术，但迄今为止最重要的是存内数据库（以下简称imdb），市场上已有相关软件及其应用。
早在1984年，市场上就出现了存内数据库，最早的产品之一是ibm tm1 - olap数据库。然而，由于操作系统和可用硬件的限制，这些系统无法发挥其优势。近年来，这些限制逐渐被淘汰，市场上出现了几种来自主要供应商的imdb解决方案。
2008年，ibm推出了soliddb作为imdb，它通过两个独立但永久同步的数据库副本以及硬盘上的永久日志来提供数据的完整性。一旦发生数据丢失，整个数据库可在几秒钟内恢复而不会丢失数据。oracle于2009年推出了 timesten作为imdb，可用作传统rdbms的缓存或独立数据库。timesten使用事务日志和数据库检查点作为数据完整性措施。2010年，sap推出了hana数据库技术，这是一种高性能分析设备。
sqlite是一个包含关系型数据库系统的程序库，由于具有许多数据库接口，是世界上使用最广泛的sql数据库。要在主内存中使用sqlite数据库，可以在数据库连接中使用：“存内”选项。一旦关闭数据库连接，数据库就会被写入磁盘。
随着技术不断发展，内存数据库正变得越来越流行，主要用于时间紧迫的应用程序、实时数据输出以及海量数据分析等领域。例如，谷歌、twitter和facebook使用的都是定制的存内数据库，以确保对不断增加的数据量做出快速反应。
事实上，关于存内计算的话题，it专家们认为这是一种范式转变，是数据处理或实时业务的新时代。
在进行研究和实验的过程中，可以证明这些说法并不那么笼统。存内计算的高效使用为大数据和实时分析领域提供了全新的可能性，但大型企业在硬件和软件领域的转换和购置成本仍然很高。
在不太复杂的领域，如软件开发中的单元测试，中小型企业已经开始使用存内数据库。在不久的将来，由于数据量的稳步增长和硬件价格的下降，存内计算技术将变得越来越重要。
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专用处理器的能效
同时，尽管传统逻辑门具有通用性和鲁棒性，但其计算效率低下，在进行乘法、加法和非线性函数等算术计算时需要消耗大量资源。此外，通过在底层硬件层面构建多个内核来提高计算并行性也需要耗费大量资源。
传统的计算硬件基于冯-诺依曼架构，处理和内存分离，数据需要在两者之间来回穿梭。这在处理机器学习任务时效率很低，既限制了计算速度，又浪费了电力。神经形态计算有各种不同的形式，是一种可能的解决方案，例如，ibm研究院的研究人员最新设计的芯片中受大脑启发，它将内存和处理元件共置一地，无需访问片外内存。这种被称为northpole的芯片能以比现有架构更快的速度和更低的能耗执行图像识别任务。
另一种也可归入神经形态计算的方法是存内计算。在这里，计算任务被转移到存储它们的内存单元中。迄今为止，已开发出了一系列复杂的存内计算技术，用于克服冯-诺依曼瓶颈，并持续提高计算吞吐量和能效。
01.在后摩尔时代提高计算机性能
存内计算（cim）技术是解决摩尔定律瓶颈的潜在方案之一。
cim与“存算一体化”（in-memory computing）和内存处理密切相关，其子领域有时被称为存内逻辑。cim的基本思想是，将数据计算移至存储数据的内存单元，从而实现原位计算，消除带宽限制和数据移动成本。
它通常利用物理定律（如基尔霍夫电流定律）和内存阵列中的电荷共享来进行模拟计算，创建高效的计算基元，包括逻辑门和乘积（mac）操作。此外，交叉点随机存取存储器（ram）架构允许自然扇出，从而促进了大规模计算并行性。
这些优势催生了各种cim研究方向，目的是在后摩尔时代提高计算机性能，并为人工智能（ai）等应用构建计算加速器。
cim研究涉及从基础电子器件到高级架构和大规模系统的各个层面，可以使用新兴的电阻式存储器，也可以使用成熟的硅基存储器。尽管名称相同，但cim技术的基本原理却大相径庭，这取决于全部或部分输入操作数是否由存储单元就地提供、计算完成后是否将输出重新就地存储在存储单元中、输入/输出数据是易失性还是非易失性，以及输入/输出数据是否以相同的物理方式表示......这些差异使得我们很难对cim技术形成全面的认识。
计算基元和cim的基础部件。a）冯-诺依曼体系结构和cim体系结构中计算原语的ouroboros模型。在冯-诺依曼计算机中，计算路线从基本逻辑门开始，提供算术运算，以支持人工神经网络等算法。所有这些计算都在处理器中执行，处理器与整个内存层次结构通信，以运行完整的程序。在当今的cim提议中，计算一般基于存内单元中的物理mac运算，利用物理定律进行乘法和求和。物理mac可以很容易地在内存阵列中并行化，以进行向量和矩阵运算，这反过来又为ann奠定了基础。b）cim架构，包括内存阵列瓦片组、输入/输出（i/o）缓冲器和控制器。c）包括vm和nvm在内的存储器技术，所有这些技术都可以在交叉点架构中实现cim
mac是计算机运算的基本操作，它与基础布尔逻辑门的关系如图所示。在冯-诺依曼计算机中，所有操作都依赖于功能完整的逻辑门，而逻辑门又是由互补金属氧化物半导体（cmos）晶体管构成的。逻辑门用于构建算术计算的处理核心，其中最重要的是mac运算。由于矩阵代数的常规形式，标量mac运算可通过顺序处理或多核并行化扩展到矢量/矩阵运算。
最后，矩阵代数为大量算法奠定了基石，其中，ann（和深度学习）是当今最受关注的算法。就cim而言，其理念始于嵌入式电路物理的mac运算，它通过基于ann的阈值逻辑概念为逻辑门奠定了基础，而逻辑门又是通过向量运算实现的。并行mac或逻辑门都可以沿着存储器阵列中的一列进行，尽管前者是后者的基础。在这种方法中，并行mac和复合逻辑门都用于执行矩阵计算，例如神经网络。
与cmos逻辑门相比，cim逻辑门的优势在于能将计算融合到存储器阵列中，以及交叉点ram架构提供的大规模计算并行性。 由于cim逻辑门依赖于物理定律的模拟计算，任何线性可分离的逻辑功能都可以在一次操作中完成。因此，复杂的逻辑功能可以通过减少运算次数和降低硬件成本来轻松实现。
02.六类存内计算技术
全方位的cim技术可抽象为一个等式z = x¤y，其中符号¤代表逻辑门或点乘运算。对于点乘，x和y分别代表权重向量和输入向量，z是标量输出；对于逻辑门，x和y是两个输入操作数，z是逻辑输出。
根据x和y是否由存储单元提供，以及计算结束时输出z是否重新存储在存储单元中，cim被分为六类：xyz-cim、xz-cim、z-cim、xy-cim、x-cim和o-cim。
全方位的cim技术。每种类型的cim都标明了候选存储器、计算基元和主要应用。频谱是在将并行mac（点积）和逻辑门抽象为z = x¤y的基础上建立的，其中x和y可以是标量或向量，z是标量，¤是表示cim操作的符号。所有cim技术分为六种类型，从全部在内存中到不在内存中，每种类型都有若干nvm和/或vm种类，进而针对通用或特定应用
xyz-cim
x和y均由阵列中的存储单元提供，输出z也重新存储在一个存储单元中。计算依赖于x和y的隐式读出，从而修改bl电位，最终改写输出单元。xyz-cim是典型的布尔逻辑运算，已通过单位非易失性rram、pcm、mram和易失性dram实现。
xz-cim
在计算过程中，只有一个输入操作数驻留在内存单元中。另一个输入由外部施加的电压编码，输出z在计算结束时重新存储为单位单元状态。xz-cim仅适用于基于nvm的逻辑运算，典型的存储器技术包括rram和mram。
z-cim
存储单元中只存储输出z，输入通过bl和wl提供。考虑到bl和wl电压的所有可能组合，由此产生的单比特单元状态构成一个逻辑门。z-cim已在rram、mram和pcm等nvm上实现。
xy-cim
输入操作数x和y均由存储单元提供，而输出z则通过bl检测放大器 (sa) 获得。它也适用于逻辑运算，存储器技术可以是电阻式nvm或sram。它的工作原理是并行读出两个单比特存储单元，并将读出结果感应和离散化为二进制输出。
x-cim
只有输入x由阵列中沿一列的存储单元提供，y由施加到wl的外部电压表示，输出z则在bl外围获得。与上述类型的cim不同，x-cim通常旨在以高度并行的方式执行两个向量的点乘。所有存内技术，包括单比特或多比特nvm和单比特vm都已实现了x-cim，这为进一步鼓励其研究提供了积极反馈。
o-cim
这里没有存储单元之间的交互，而是将传统逻辑门或计算模块置于存储单元或阵列附近进行计算。o-cim通常采用成熟的存储器技术进行设计，包括sram和dram。它类似于早期的近存储器计算概念，但其进步在于进一步缩短了存储器与处理器之间的距离。
由于全面识别了输入的来源和输出的方向，基于该分类法的频谱应涵盖所有cim技术。在频谱的末端，它与传统的冯-诺依曼范式相联系。在这一范围内，特定的存储技术可能被用于多种类型的cim，但原理各不相同。另一方面，某些类型的cim在技术上可能只适用于特定的内存设备，或只值得关注。此外，计算基元与cim类型相关，并最终与存储器载体相关。
除o-cim外，所有其他cim类型都依赖于模拟乘法、加法和电路中物理定律的非线性激活。将前两种运算结合起来，就可以得到用于并行mac运算的点乘，而将所有三种运算结合起来，就可以得到布尔逻辑门。
03.各种cim技术的原理
xyz-cim、xz-cim和z-cim的共同点是将输出z原位存储在存储单元中。它们都主要使用新兴的nvm进行逻辑运算。由于新兴nvm通常是基于电阻的存储器，因此可将其视为一般的两端电阻开关 (rs) 器件。通常情况下，当器件两端的电压足够大且具有正负极性时，就会通过“设置”切换到高导状态（hcs），或通过“复位”切换到低导状态（lcs）。
这种描述适用于rram、mram和ftj。由于cim通常只使用一种开关极性，因此单极性开关pcm也可包含在此模型中。两种电导状态编码二进制1和0，与传统存储器应用相同。对于逻辑门，计算依赖于器件的条件开关，这是其他器件状态和外加电压的函数。这种非线性特性可视为 ann中的激活函数。
因此，任何基于rs的nvm器件都有可能用于这三种类型的cim。
xyz-cim、xz-cim和z-cim。a）电阻式存储器件示意图及其rs行为；b）xyz-cim的状态imp逻辑；c）xyz-cim的sfnn；d）dram位向逻辑；e）xz-cim 的逻辑运算；f）z-cim 的逻辑运算
xyz-cim：nvm有状态逻辑
在xyz-cim建议中，一种突出的方法是基于所谓的有状态逻辑，利用nvm器件（通常是rram）实现。蕴含（imp）门最初是为有状态逻辑运算而提出的，一个rram单元的电导状态编码输入操作数x，而另一个单元则代表操作前和操作后的输入y和输出z。电阻的电导值大致设定在lcs和hcs的对数值中间。
vp（例如，vw/2）和vw分别施加到两个wl中的一个不同的wl上，其中vw足够大以实现设定的转换，而vp则不然，同时bl电阻器接地。激活后，单元y的最终状态，即输出z，根据imp函数确定。具体来说，如果y单元最初处于hcs (1)，则施加的电压极性不会触发开关；如果y最初处于lcs (0)，则其开关取决于x：如果x处于lcs，由于两个lcs设备的隔离，bl电位将接近于0。
因此，器件y上的压降足以将其切换到hcs；但如果x位于hcs中，vp将大大提高bl电位，从而阻止y的切换。
xyz-cim：dram位向逻辑
dram位向逻辑是另一项重要的xyz-cim提议，它依赖于计算期间的锁存型sa同步重写。商用dram产品只需少量修改甚至无需修改即可实现该功能。
图（d）显示了由三个dram单元组成的一列，在bl的末端有一个锁存型sa。sa是一个双稳态电路，由两个cmos反相器组成，形成一个正反馈回路。与bl相连的终端既是输入节点，也是输出节点，通过它来检测和修改bl电压。当bl电压高于（或低于）vdd/2时，sa迅速做出反应，将输出稳定在vdd（或0）。在逻辑运算中，多行同时被激活。因此，电路自然会执行三个输入单元的多数逻辑功能，逻辑结果最终会重新存储在所有三个单元中。
第一步，将bl预充电至vdd/2，以实现位向逻辑。然后，用vdd同时激活三个wl，而sa尚未激活。存储在dram单元x、y和q中的电荷由所有dram电容（电容cc）和寄生bl电容（电容cb）共享，从而使bl电位达到vdd/2。
多数逻辑函数是线性可分离的，dram电路可视为单层感知器，类似于sfnn。在该模型中，输入是存储的电压电平，网络权重由电容给出，非线性激活神经元由阈值为vdd/2的锁存型sa激活。在多数门的基础上，可以方便地实现更复杂的功能，例如全加法器。为了实现一套完整的逻辑门，可以利用sa中的互补位设计not门，通过另一个选择晶体管将互补位写入双触点单元。与保留所有输入的sfnn不同，dram位逻辑对逻辑输入具有破坏性。为解决这一问题，可在阵列中专门设计三行用于逻辑运算。
此外，在逻辑运算之前和之后，应执行rowclone操作，即利用相同的电荷共享原理将源行中的数据复制到目的行，以便在阵列内传输输入和输出。
xz-cim
xz-cim还依赖于rram和mram等nvm器件的条件切换。有状态逻辑以两个输入存储单元的电导状态为条件，而xz-cim中用于调节的两个输入则分别用电导状态和电压表示。
这种编码方法为逻辑门的构建提供了更多便利，并使xor等线性不可分割函数的一步操作成为可能，但却增加了级联时转换输入和输出异质属性的成本。基于两个rram单元的典型xz-cim逻辑门如图（e）所示。一个输入操作数x由rram器件的电导状态提供，而另一个输入操作数y则由外加电压编码。
输出重新存储在第二个单元中，该单元初始化为lcs（0）。bl负载电阻的电导值设置在lcs和hcs之间，以便进行适当的分压。输出存储单元采用恒定的vp，条件是vset/2 < vp < vset，然后wl1和bl的电压决定逻辑门的类型。在xor的情况下，wl1和bl的电压分别为 (y - 1)vp 和 (-y)vp 。
通过改变所加电压的编码方案，该电路可以实现所有16个双输入布尔逻辑门，从而简化复杂函数的逻辑合成，进而缩短cim的延迟时间。
z-cim
基于nvm的逻辑可扩展到z-cim，其中输入操作数x和y均通过施加电压来提供。输出z作为存储单元的电导状态就地存储（图f）。除了mram和pcm之外，rram一直是z-cim研究最活跃的对象。
它基本上基于nvm的传统写入操作，但对传统上被认为无效的其他输入组合进行了逻辑扩展。rram的切换取决于压降的极性和初始电导状态。当存储单元最初处于lcs状态（z0 = 0）时，只有x = 1 (vw)和y = 0的输入组合才能将设备切换到hcs，即z = 1，而在其他输入情况下，设备仍处于lcs状态（z = 0）。当存储单元最初处于hcs状态（z0 = 1）时，只有x = 0和y = 1 (vw) 的组合才会关闭设备并存储 z = 0，而在其他情况下，设备仍处于z = 1状态。这两种情况分别对应于非蕴涵函数（nimp）和互补蕴涵函数（cimp）。
通过将一个输入固定为1或0，或通过交换应用于wl和bl的操作数以及级联此类操作，所有14个线性可分离逻辑门都可以用存储单元来实现。
线性不可分离的xor/xnor是例外。为使其可行，应采用基于堆叠两个极性相反的电阻开关的互补rram概念，利用其非对称读出过程。另外，1t1r单元可以更有效地执行z-cim的xor逻辑，这要归功于该结构的终端数量较多，便于对输入操作数进行编码。
xy-cim
基于nvm或sram的逻辑运算也提出了xy-cim。
就nvm而言，两个输入操作数是存储单元的二进制电导状态（lcs或hcs）。基本上，任何具有两种不同电阻状态的nvm器件都可用于xy-cim，包括本征三端器件，如 fefet。在同时激活两个wl时，存储单元的状态被读出到bl，其中的电流（ilcs或ihcs）被累加，并由电流模式sa感测。可以将sa视为二元神经元电路，以参考电流作为激活阈值，产生逻辑输出。
两个输入的四种组合会产生以2ilcs、ilcs + ihcs和2ihcs为中心的三种bl电流分布。因此，在2ilcs和ilcs + ihcs之间（或ilcs + ihcs和2ihcs之间）设置sa的阈值，就能得到线性可分离的or（或and）逻辑函数。
鉴于神经元激活是通过cmos电路实现的，因此很容易得到两个逻辑门的倒数，即nor和nand。or和nand的组合将产生线性不可分割的xor逻辑，通过连续施加两个参考电流来实现。
xy-cim和x-cim。a）xy-cim基于电阻式nvm的逻辑运算。b）基于sram的xy-cim逻辑运算。c-f）基于被动1r nvm（c）、基于1t1r nvm（d）、基于nor闪存（也基于fefet）（e）和基于sram（f）的点积运算
就sram而言，xy-cim的两个输入操作数由存储在sram单元中的电压电平提供。
sram单元的核心是双稳态电路，其两个内部节点存储二进制电压电平及其补码。在标准6t sram结构中，两个选择晶体管控制bl和互补blb，以访问两个节点。在进行逻辑运算时，bl和blb首先被预充电到vdd，如同sram的读出过程。
同时激活两个wl时，bl和blb 可能会放电，这取决于两个sram单元的状态。具体来说，只有当输入x和y均为1时，bl才会保持在vdd位置。如果有一个单元处于0状态，则bl放电至较低电压；在两个单元都处于0状态的情况下，bl电压的降低会加剧。
通过为sa设置参考电压，以区分vdd和其他降低的bl电压，sa输出被识别为and逻辑结果。当blb访问输入位x和y的补码时，sa采用相同的参考电压提供nor逻辑。
同样，and和nor的组合也有助于xor逻辑。传统6t sram的位逻辑运算会受到存储单元的干扰，这是由于通过同一端口的写入和读取路径耦合所致。当多个wl同时开启时，bl/blb可能会放电，进而导致存储单元状态翻转。为解决这一问题，主要策略是通过增加存取晶体管或修改其配置来解耦写入和读取路径，从而形成4 + 2t/8t/10t sram结构。此外，wl的欠驱动或异步激活也有助于解决干扰问题。
x-cim
x-cim的基本物理原理与xy-cim基本相同，只是输入操作数的定义不同。
通常，x-cim以实现并行mac运算为目标，其中一个输入操作数由表示权重向量x的存储单元列提供，另一个输入则是外部施加到wl或其他线路上的电压向量y。因此，这两个向量的点积在bl上以电流或放电累积的形式产生，然后由bl外围电路感应。人们对ann加速器的浓厚兴趣促使所有存储器技术都被用于x-cim，该技术正在积极研究中，并努力实现模拟-数字混合浮点精度方案。
x-cim也可能意味着基于非易失性存储器（如mram和fefet）的逻辑运算。然而，人工智能加速器在并行mac运算方面的大量工作使这方面的努力黯然失色。
在虚拟机方面，sram凭借其独特的优势和工业成熟度，包括快速读/写速度、低功耗、无限耐久性以及与最先进逻辑工艺的兼容性，在利用x-cim进行并行mac加速方面备受关注，尽管其代价是单元占用空间较大。值得注意的是，在锁存器电路中，还包括x的补码二进制向量，这对带符号计算非常有用。
sram结构具有丰富的灵活性，可用于可靠、高效的x-cim优化，但4t锁存器电路始终是权重存储的核心。一种策略是通过采用8t/10t/12t结构来解耦读出路径，以保护sram单元免受干扰，但这会进一步加剧单元占用空间的问题。在一些基于标准6t sram阵列的方案中，加入了专门设计的局部计算单元和全局bl，以平衡电路功能和面积开销之间的权衡。
根据存储器技术的不同，存储在存储器单元中的权重向量x可以是单位或多位的。虽然vm通常是单比特器件，但许多nvm显示多比特甚至模拟状态，这是提高x-cim吞吐量的关键因素，而机器学习加速非常需要这种吞吐量。闪存、fefet、pcm、rram和ftj是出色的模拟电导器件，这要归功于它们的基本物理特性，允许对电荷存储、铁电极性比、晶体体积和导电丝直径等状态变量进行持续调整。
因此，这些非易失性存储器件的存储窗口很大，从10到10^6不等，这使它们能够在单个单元中存储多比特信息。由于电导开关比小，mram被认为是单比特存储器，尽管目前正在努力开发多比特器件。为了最大限度地提高计算效率，输入矢量y通常编码为多比特值，如具有模拟幅度或宽度的wl电压脉冲，不过也可能采用串行二进制脉冲以节省数据转换成本。
因此，cim操作是在电流域、时域或电荷域进行的。鉴于x和y都可能是二进制值、模拟值或由差分运算实现的双极值，两个元素的乘法运算可能采用and逻辑、双极xnor或纯模拟结果的形式。由于多位输入和同时激活的多个wl（通常为≫2），点乘的检测需要一个能量化多个离散输出电平的转换电路，这通常通过多级sa或模数转换器 (adc) 来实现。与存储单元相比，sa和adc通常要大得多，耗电量也更大。因此，除了原位计算和x-cim固有的并行性，sa或adc已成为另一个效率瓶颈，需要进行设计优化，以保持cim带来的性能提升。
o-cim
最近，基于sram的cim通过在存储单元附近加入传统逻辑门，逐步转向全数字领域。由于在计算过程中不需要融合存储单元，因此被合理地称为o-cim。
在这种方法中，一个输入操作数通过一条专门设计的线路从外部提供，另一个输入操作数从sram单元读出并输入到邻近的逻辑门，由逻辑门执行两个操作数的乘法运算。为了对乘法结果进行求和，必须在附近部署分层加法器树，在数字域中产生部分和。
就dram而言，传统的计算模块不是将单个逻辑门嵌入存储单元周围，而是靠近阵列构建，从而利用阵列级并行性实现mac加速。o-cim通常采用成熟的易失性存储器进行设计，以寻求与当代商业产品的工业兼容性。通过采用标准数字计算单元，o-cim比其他基于模拟计算的cim更为可靠。
04.cim技术发展的挑战与展望
不同cim方案的主要特点和挑战，以及这些方法在器件可靠性和计算效率方面面临的挑战
cim技术可用于融合内存和计算，并为加速计算提供空间并行性。 它们还可以通过使用非常规但功能强大的逻辑门（例如多数函数），以及将算术运算直接映射到硬件电路，来提供高效计算。
cim可通过同时激活多个wl来实现，从而通过阵列中的物理规律启动存储单元之间的交互。目前已开发出一系列cim技术，其中许多技术都基于交叉点阵列架构——该架构可容纳几乎所有存储器技术。
新兴的nvm已成为cim的重要候选技术，并被用于探索一系列超越内存的应用。相反，dram和sram等成熟内存技术的修改较少：dram已针对存储密度和减少漏电进行了优化，因此不利于工艺修改，尽管cim在阵列中造成的开销不到1%；sram的优势在于其在现代逻辑制造工艺中的灵活性，允许定制存储器阵列设计，尽管标准的6t sram仍受到重视。
在cim中，逻辑门的开发旨在为通用计算提供功能完整的逻辑集，所有xyz/xz/z/xy-cim类型都能通过众所周知的逻辑集（如and + or + not 门或单一nand或nor门）或非常规逻辑集（如imp + false门）提供这种功能。相比之下，并行mac是为加速神经网络等特定应用而开发的。
在不同的逻辑门cim方案中，有两个因素可用来区分不同的方法：计算（即非线性激活）是否由被动rs单元执行，以及输入和输出操作数的物理属性是否相同。在前一种情况下，使用rs单元作为神经元的nvm有状态逻辑、xz-cim和z-cim实现非常紧凑，但dram比特逻辑和xy-cim方案需要额外的有源sa进行计算，因此牺牲了部分面积效率。在后一种情况下，xyz-cim被认为是一种真正的cim方法，因为所有输入/输出操作数都由阵列中的存储单元就地表示；它没有转换过程，因此可以轻松实现级联，并有利于顺序处理的整体延迟。
相反，nvm的xz-cim、z-cim和xy-cim则需要额外的操作来将输出读出为电压（或将输出写入为电导），以便级联下一个逻辑门，从而造成延迟，阻碍吞吐量的提高。就sram而言，可能需要设计一个特殊单元，将逻辑输出写入单元，以便后续访问。
x-cim和o-cim均用于并行mac，但使用方式不同：即模拟与数字。x-cim可以提供很高的能量/面积效率，这要归功于将计算基元直接映射到存储器阵列的高效方法。然而，由于计算过程的模拟性质，它的精度会因设备（如电阻单元、电容器或晶体管）、阵列和电路的非理想性而下降。在一次操作中，还可以提高输入的分辨率、nvm的存储容量和cim单元的并行性，从而提高计算吞吐量。然而，这种优势也带来了输入数模转换和输出模数转换的开销。
在nvm的x-cim应用中，神经网络已被提出，由于每两层神经元之间的权重矩阵是固定的，因此mvm可以自然级联。对于通用应用，由于存储单元中一个向量的隔离，可能需要像逻辑门一样的属性转换过程来进行级联操作。
o-cim在数字域中使用传统的cmos逻辑门。因此，它的计算稳健性更高。此外，由于省去了adc和数模转换器 (dac)，数据转换的负担也得以克服。模拟x-cim的硬件映射是固定的，与之相比，数字o-cim具有更高的灵活性，可以适应更广泛的问题。不过，由于每个处理元件都包括一个乘法器和一个用于mac运算的加法器，因此它在面积和能效之间进行了权衡，类似于其他数字加速器，如基于收缩阵列的设计。
在用于逻辑运算的cim类型中，nvm状态逻辑、xz-cim和z-cim依赖于存储器单元的动态rs，因此要求器件具有较高的耐用性，以支持频繁的逻辑门操作。因此，pcm（据报道其耐用性超过10^10）似乎更适合（尽管还不够）这些类型的cim。rram的最新耐用性相当有限（超过10^6），必须加以改进才能达到要求。mram的表现甚至更好，一般显示出10^12的耐用性。然而，mram本身受限于较小的内存窗口，这对可靠的模拟计算，尤其是多输入逻辑门构成了障碍。
由于xy-cim和x-cim基本上是两个或多个单元的并行读出过程，因此可以采用任何具有两个或多个不同状态的存储器件。因此，nvm器件的时间保持特性和状态变化应足以保证可靠的读出、求和和离散化，分别由用于逻辑运算或并行mac的sa或adc完成。虽然nvm器件在传统的二进制存储器应用中一般都能保持足够的存储时间（85°c时超过10年），但在逻辑运算中，两个或多个单元状态的线性叠加会对存储性能造成更严格的限制。特别是在用于并行mac的x-cim中，最好有一个多比特单元，通常会同时激活多个单元以提高吞吐量。
在这种情况下，除mram外，所有nvm设备都显示出较大的存储窗口，从而实现了多位存储。然而，由于受到状态变化的严重限制，最先进的nvm只能提供可靠的两比特容量。因此，要实现更大容量的存储单元，仍有很大的器件优化空间，成熟的多级nand闪存可以作为很好的参考。
非易失性存储器的模拟电导经常被用于计算，通常是为了在人工智能加速器等典型应用中实现较高的等效吞吐量和能效。然而，必须注意的是，传统的存储器模式应始终保持，在这种模式下，应能以足够的读出余量区分多种状态。为了开发可靠的基于电阻式nvm的cim技术，在算法和系统层面已经做出了许多努力，但这些努力通常仅限于特定应用。
位切片、分而治之和补偿等策略已被用于扩展大规模问题的计算精度。虽然这些解决方案可方便地应用于正向矩阵乘法，但对于x-cim的矩阵反演而言，这些问题变得难以解决，从而为基于电阻式nvm的通用矩阵计算留下了探索空间。
nvm设备的耐用性不足是有状态逻辑、xz-cim和z-cim所面临的关键问题，阻碍了它们在实际应用中的发展。对于有状态逻辑和xz-cim而言，由于两者都依赖于模拟乘法、求和及非线性激活，因此必须保证设置/复位电压以及lcs和hcs在周期与周期之间以及设备与设备之间的低变化，以限制逻辑运算的误码率。
z-cim不需要模拟乘法和求和。因此，它只需要较低的设定/复位电压变化。相比之下，xy-cim和x-cim则需要较低的lcs和hcs变化，以实现可靠的cim操作。特别是在使用多位nvm器件的并行mac中，输入存储单元的电导分布和点乘结果会变得更加复杂，因此需要设计精细的读出电路（sa/adc）。此外，x-cim还可能涉及神经网络训练。因此，电导更新在电导范围的最小或最大边界具有良好的线性非常重要。
要克服nvm器件的耐久性、时空一致性和更新线性等挑战，从根本上说，这些都是由器件物理特性控制的，因此必须对器件材料和结构进行优化，从源头上解决这些问题。所有这些cim方案都依赖于模拟计算，而模拟计算很容易受到工艺-电压-温度（pvt）变化的干扰。不过，对于使用新兴nvm的cim的pvt问题，目前仅有偶尔的研究，但这是实际应用过程中的一个重要挑战。
要最大限度地提高cim的能效，需要解决几个问题：
1）在基于rs的cim方案中，每个事件都会导致相当大的功耗。因此，需要优化设置/复位电压和电流。
在使用静态存储单元状态的xy-cim和x-cim中，nvm器件较低的绝对电导率应有助于降低能耗。尽管如此，这种优化并不容易，因为低电导通常伴随着非线性电流-电压特性，这会带来额外的计算误差。
2）在合成具有完整功能逻辑集的复杂逻辑运算时，可选择的方法多种多样。
它可以由许多双输入门电路或少数几个多输入门电路组成，从而导致硬件和延迟成本的巨大差异，以及对模拟非理想性的不同敏感性。因此，要实现可靠而高效的逻辑合成，就必须权衡利弊。x-cim一直在努力解决adc和dac的开销问题，而这正是提高能效的主要挑战。在o-cim中，虽然使用单逻辑门（例如nor门）可以方便地实现乘法器，但加法器树一直是公认的瓶颈。因此，需要在这方面进一步努力，以提高能效和面积效率。
3）此外，虽然x-cim的并行mac已被证明在加速计算方面具有相当大的潜力，但它本质上无法提供通用计算系统。在这种情况下，cim方法中逻辑门与并行mac运算的结合值得进一步探索。
05.存内计算开辟数据处理新范式
目前，存内计算提供了多种技术，但迄今为止最重要的是存内数据库（以下简称imdb），市场上已有相关软件及其应用。
早在1984年，市场上就出现了存内数据库，最早的产品之一是ibm tm1 - olap数据库。然而，由于操作系统和可用硬件的限制，这些系统无法发挥其优势。近年来，这些限制逐渐被淘汰，市场上出现了几种来自主要供应商的imdb解决方案。
2008年，ibm推出了soliddb作为imdb，它通过两个独立但永久同步的数据库副本以及硬盘上的永久日志来提供数据的完整性。一旦发生数据丢失，整个数据库可在几秒钟内恢复而不会丢失数据。oracle于2009年推出了 timesten作为imdb，可用作传统rdbms的缓存或独立数据库。timesten使用事务日志和数据库检查点作为数据完整性措施。2010年，sap推出了hana数据库技术，这是一种高性能分析设备。
sqlite是一个包含关系型数据库系统的程序库，由于具有许多数据库接口，是世界上使用最广泛的sql数据库。要在主内存中使用sqlite数据库，可以在数据库连接中使用：“存内”选项。一旦关闭数据库连接，数据库就会被写入磁盘。
随着技术不断发展，内存数据库正变得越来越流行，主要用于时间紧迫的应用程序、实时数据输出以及海量数据分析等领域。例如，谷歌、twitter和facebook使用的都是定制的存内数据库，以确保对不断增加的数据量做出快速反应。
事实上，关于存内计算的话题，it专家们认为这是一种范式转变，是数据处理或实时业务的新时代。
在进行研究和实验的过程中，可以证明这些说法并不那么笼统。存内计算的高效使用为大数据和实时分析领域提供了全新的可能性，但大型企业在硬件和软件领域的转换和购置成本仍然很高。
在不太复杂的领域，如软件开发中的单元测试，中小型企业已经开始使用存内数据库。在不久的将来，由于数据量的稳步增长和硬件价格的下降，存内计算技术将变得越来越重要。
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