RAM、ROM常用安全机制
存储器数据的稳定可靠是mcu安全运行的基础，但环境因素和存储器本身的物理特性都可能造成存储器数据异常，本文将详细介绍ram&rom常用安全机制。
存储器（rom，ram）数据的安全可靠是mcu稳定运行的基础，在汽车功能安全设计中，存储器相关的安全机制也是系统基本保障的重点之一。通常，不同的汽车芯片都有自己的存储器校验机制以及相应的处理手段来保证功能的正常运行。下面会对常见的处理机制进行一些介绍。
ram的校验纠错机制
ram的校验机制相对rom的校验机制较少，校验机制基本都属于mcu本身的特性，通过内部硬件实现，对于用户来说是透明的。而一般用户使用时也不会主动的对ram进行校验。1. parity bitparity bit（奇偶校验位）是一种数据校验机制，常用与判断数据在存储过程中是否发生了比特位错误。
图1 奇偶校验模式可以看到图1，带有parity bit的内存在每一个字节（b7~b0）外又额外增加了一个校验位（c）用于对错误进行校验。parity bit有着计算简单的优点，只需要对前面字节的位进行异或操作：
c = b7^ b6^ b5^ b4^ b3^ b2^ b1^ b0parity bit在ecc技术之前，是ram中应用最多的错误检查技术，当然，现在只有在已经很少有cpu用到，因为每1 byte的数据都需要1 bit的校验位，对于mcu本就很紧张的ram显然不合适。另外parity bit只具备检错能力，并不具备纠错能力。2. ecc通过上面对parity bit的分析可以知道，通过在原来的数据1 byte基础上增加1 bit，可以用来检查当前1 byte数据的正确性。如果数据为256 byte就需要256 bit的校验位，而且出错的数据无法纠正。由于上述的缺点，出现了一种新的存储检错纠错机制 – ecc。
图2 检错能力对比ecc（error-correcting code），可以译为检错纠错码。ecc的计算过程比parity bit的计算过程复杂一点，这里不进行过多描述。仅针对ecc的两个主要特点进行说明：① ecc有极强的检错能力ecc的计算方式与parity bit不同，当数据为1 byte时，ecc需要5 bit校验位对数据进行校验，之后数据每增加1倍，相应的只需要增加1 bit的ecc 校验位。可以看到图2，ecc的检错能力相比parity bit有极大的提升。② ecc具有纠错能力当数据只有单bit 错误时，ecc能够对错误进行修复，但需要注意的是，当数据中有超过 2 bit的错误同时产生时，ecc不一定能检测出来，这一点parity bit也是一样。
rom的检验纠错机制
与复杂的ram空间相比，rom空间的操作显然简单的多，因此，对于rom的校验使用者可以根据不同的需求，选择不同的方式。
常用的有hash，crc，对于大容量rom，比如nand flash同样也可以使用ecc的方式。基本上，只需要满足rom内容和生成的校验码存在相对唯一的映射关系即可。
但是用户自己实现的rom校验机制存在不少缺点：校验失败没有灵活的处理措施，对rom的校验需要消耗额外mcu资源等。1. hse随着汽车产业的不断升级，汽车智能化程度也在不断加深，越来越多的汽车会通过ota的方式实现客户的个性化需求。但ota在增加汽车升级和维护便利性的同时，也给数据的安全可靠性带来了新的考验。显然，应用开发者自己实现的rom校验并不足以满足汽车应用的安全需求，汽车应用上，保证mcu程序的正确运行显然需要一套更灵活，更完善的校验机制，并且该校验机制不仅需要保证数据的可靠性，还要保证检验机制本身的可靠性。下面会介绍nxp s32系列芯片是如何利用其hse安全子系统来为rom数据的可靠性提供支持，进而保证汽车应用的安全稳定运行的。
图3 hse框架hse（hardware security engine）全称为硬件安全引擎，用于给对数据的可靠性和保密性有严格要求的应用提供相应的安全服务。其有以下特点：
独立的内核，固件，存储空间；
可以为加密算法提供安全硬件加速；
支持固件升级。
可以看到图3中，hse模块最基础也最主要的部分是它的crypto engine（加密引擎），其可以通过硬件实现加解密/mac生成校验/签名验签等功能。因为hse全面完善的算法和密钥管理机制，可以利用hse模块可以对用户设定的存储区域进行校验，并根据检验结果执行不同的操作，正是hse安全可靠，设置灵活的特性，构成了mcu安全稳定运行的基础。当然hse除了能够为mcu的ota和安全启动功能提供可靠保证外，hse通过硬件加速特性和完善的加解密算法库还能够对网络协议进行全面可靠的支持，可以实现tls offload，ip offload，减少网络协议的通信时延。
结语
上面提到了一些存储器常见的校验方式和nxp s32系列的hse安全子系统，当然无论通过哪种方式，为了实现ota和越来越多的网络应用功能，通过mcu实现更加安全可靠的数据存储传输都是现在的趋势。
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图1 奇偶校验模式可以看到图1，带有parity bit的内存在每一个字节（b7~b0）外又额外增加了一个校验位（c）用于对错误进行校验。parity bit有着计算简单的优点，只需要对前面字节的位进行异或操作：
c = b7^ b6^ b5^ b4^ b3^ b2^ b1^ b0parity bit在ecc技术之前，是ram中应用最多的错误检查技术，当然，现在只有在已经很少有cpu用到，因为每1 byte的数据都需要1 bit的校验位，对于mcu本就很紧张的ram显然不合适。另外parity bit只具备检错能力，并不具备纠错能力。2. ecc通过上面对parity bit的分析可以知道，通过在原来的数据1 byte基础上增加1 bit，可以用来检查当前1 byte数据的正确性。如果数据为256 byte就需要256 bit的校验位，而且出错的数据无法纠正。由于上述的缺点，出现了一种新的存储检错纠错机制 – ecc。
图2 检错能力对比ecc（error-correcting code），可以译为检错纠错码。ecc的计算过程比parity bit的计算过程复杂一点，这里不进行过多描述。仅针对ecc的两个主要特点进行说明：① ecc有极强的检错能力ecc的计算方式与parity bit不同，当数据为1 byte时，ecc需要5 bit校验位对数据进行校验，之后数据每增加1倍，相应的只需要增加1 bit的ecc 校验位。可以看到图2，ecc的检错能力相比parity bit有极大的提升。② ecc具有纠错能力当数据只有单bit 错误时，ecc能够对错误进行修复，但需要注意的是，当数据中有超过 2 bit的错误同时产生时，ecc不一定能检测出来，这一点parity bit也是一样。
rom的检验纠错机制
与复杂的ram空间相比，rom空间的操作显然简单的多，因此，对于rom的校验使用者可以根据不同的需求，选择不同的方式。
常用的有hash，crc，对于大容量rom，比如nand flash同样也可以使用ecc的方式。基本上，只需要满足rom内容和生成的校验码存在相对唯一的映射关系即可。
但是用户自己实现的rom校验机制存在不少缺点：校验失败没有灵活的处理措施，对rom的校验需要消耗额外mcu资源等。1. hse随着汽车产业的不断升级，汽车智能化程度也在不断加深，越来越多的汽车会通过ota的方式实现客户的个性化需求。但ota在增加汽车升级和维护便利性的同时，也给数据的安全可靠性带来了新的考验。显然，应用开发者自己实现的rom校验并不足以满足汽车应用的安全需求，汽车应用上，保证mcu程序的正确运行显然需要一套更灵活，更完善的校验机制，并且该校验机制不仅需要保证数据的可靠性，还要保证检验机制本身的可靠性。下面会介绍nxp s32系列芯片是如何利用其hse安全子系统来为rom数据的可靠性提供支持，进而保证汽车应用的安全稳定运行的。
图3 hse框架hse（hardware security engine）全称为硬件安全引擎，用于给对数据的可靠性和保密性有严格要求的应用提供相应的安全服务。其有以下特点：
独立的内核，固件，存储空间；
可以为加密算法提供安全硬件加速；
支持固件升级。
可以看到图3中，hse模块最基础也最主要的部分是它的crypto engine（加密引擎），其可以通过硬件实现加解密/mac生成校验/签名验签等功能。因为hse全面完善的算法和密钥管理机制，可以利用hse模块可以对用户设定的存储区域进行校验，并根据检验结果执行不同的操作，正是hse安全可靠，设置灵活的特性，构成了mcu安全稳定运行的基础。当然hse除了能够为mcu的ota和安全启动功能提供可靠保证外，hse通过硬件加速特性和完善的加解密算法库还能够对网络协议进行全面可靠的支持，可以实现tls offload，ip offload，减少网络协议的通信时延。
结语
上面提到了一些存储器常见的校验方式和nxp s32系列的hse安全子系统，当然无论通过哪种方式，为了实现ota和越来越多的网络应用功能，通过mcu实现更加安全可靠的数据存储传输都是现在的趋势。
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