Vivado BDC (Block Design Container)怎么用
谈到bdc（block designcontainer）就不得不提ipi（ip integrator）。ipi常被翻译为“ip集成器”，也是有道理的。它提供了一种“图形化+模块化”的设计方式。若用过simulink或者system generator，对此应该不会陌生，毕竟都是向设计中添加“block”，故ipi设计的文件后缀为.bd。
这种方式最大的好处是直观，同时简化了互连操作。
vivado早期版本ipi中的“block”必须是来自于ip catalog中的ip，所以对于用户的rtl代码就必须先用ip packager封装为ip，然后才能添加到ipi中。这就带来了一个问题：封装ip的过程是严格的、耗时的，尽管它可以提升设计的可复用性。
为此，vivado又增加了一个新特性：可以将rtl代码描述的模块直接添加到block design中。用户可以在打开的block design中点右键，选择add module，也可以在sources窗口中找到相应的rtl代码文件，点右键选择add module to block design，还可以直接将rtl代码文件直接拖拽到打开的block design中。
同时，被引用的rtl代码可支持实例化绝大多数ipcatalog中的ip。另外，若rtl代码中声明了参数（vhdl：generic，或verilog：parameter），当其被引用到block design中之后，这些参数也是可以重新定制的：双击模块，即可进入参数编辑状态。包含rtlreference module的block design也可以被其他工程使用，从而实现设计复用。
需要注意的是在新工程中要先将rtl reference module对应的rtl代码文件添加到工程中，然后再添加相应的.bd文件。rtl reference module是有一些限制条件的，包括：rtl代码中不能以网表形式存在的子模块，也不能包含其他block design或者被设置为ooc综合的模块；目前仅支持vhdl和verilog，还不支持systemverilog。对于包含rtl reference module的block design，vivado无法再将其通过ip packager封装为ip的。
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同时，被引用的rtl代码可支持实例化绝大多数ipcatalog中的ip。另外，若rtl代码中声明了参数（vhdl：generic，或verilog：parameter），当其被引用到block design中之后，这些参数也是可以重新定制的：双击模块，即可进入参数编辑状态。包含rtlreference module的block design也可以被其他工程使用，从而实现设计复用。
需要注意的是在新工程中要先将rtl reference module对应的rtl代码文件添加到工程中，然后再添加相应的.bd文件。rtl reference module是有一些限制条件的，包括：rtl代码中不能以网表形式存在的子模块，也不能包含其他block design或者被设置为ooc综合的模块；目前仅支持vhdl和verilog，还不支持systemverilog。对于包含rtl reference module的block design，vivado无法再将其通过ip packager封装为ip的。
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