分享一种将AD原理图更新Allegro PCB文件的方法
altium designer是原protel软件开发商altium公司推出的一款优秀的电子eda设计软件，主要运行在windows操作系统。altium designer 除了全面继承包括protel 99se、protel dxp在内的先前一系列版本的功能和优点外，还增加了许多改进和很多高端功能。
protel在很多学校都有普及使用，从使用群体数量来讲，无疑是众多pcb设计的eda软件中使用人数最多的。
但卫红的工程师们长期使用的eda软件为cadence和pads，对ad的了解还停留在protel99se的时代。几天前 ，一个客户发来一个ad的原理图，希望能做出pcb设计，鉴于对ad不熟悉，只能使用cadence allegro进行pcb设计。
最初尝试将ad的原理图转为orcad的原理图进行设计，而且现在orcad17.4的软件也可以很方便的将ad的pcbdoc文件转成orcad的dsn文件。
但转换后发现一个问题，ad的原理图中不同页码中相同的网络，转成了dsn文件中，这些网络名字后面都被加了“_1、”_2等变成了不同的网络，这样实际相同的网络都没法连接起来。
经过研究才发现，这个是软件间不同的使用ruler造成的，在orcad中不同页码之间相同的网络，必须通过跨页连接符offpage来定义连接，在ad中则不需要，只要定义相同的net label，就直接默认连接起来。这就造成了ad的原理图转换到orcad后，net label虽然在的，但页码之间没有offpage，orcad就认为不是相同的网络。
重新添加offpage工作量很大，而且ad中原理图和pcb封装名字和属性都习惯用小数线、空格之类的，这些在orcad中都不支持的，导致即使原理图可以用，导netlist时也会report出来很多问题，只有把这些名字中非法字符更改后，才能顺利导出netlist文件。关键是eda工程师对原理图不熟悉，更改原理图后可能会产生一些不可控的问题出现会影响到pcb设计端。
几番衡量之后，还是决定将客户的原理图导出网表后，将netlist的网表导入到cadence allegro中进行pcb设计，感谢行业资深工程师陈工提供的netlist转换工具，先将具体的方法分享给大家。
1、先将ad的原理图，导出protel格式的netlist文件，操作如下图所示，要导出整个工程的网表，不是某页的网表；
2、protel格式的netlist文件后缀名是net的，用记事本打开后，是这个样子，如下图所示，这个格式显然是allegro不能识别的，我们需要将netlist文件进行转换下；
3、打开protel网表转allegro.exe的程序文件，选择protel格式的netlist文件，其他默认选择，点击转换进行网表格式转换；
然后就生成了一个txt后缀名的文件，如下图所示，直接点击保存即可；
4、用记事本打开转换成的txt文件，可以看到文件格式转换已经好了，但名字中出现了很多小数点和空格的非法字符，这个比较麻烦，就需要手动去修改下，如果这款软件能自动把小数点和空格自动改为underline，那就更方便了；
5、这个还需要手动把“!”前的一部分删除掉，更改后的结果如下图所示；
6、还有一点的就是pcb封装不仅要有dra文件、symbol文件，还要有device文件，这个可以打开dra文件，然后执行creat device，如下图所示；
直接点击ok就生成了一个txt的device文件，操作虽然很简单，但架不住封装数量多，可以做个批处理的脚本文件来自动执行；
同时，不要忘了将device文件的路径更改到pcb库的路径一样；
7、最后就需要将更改后的netlist文件导入到allegro的pcb文件中了，导入后可能会有很多的报错信息出现，比如device文件找不到， 需要有很大的耐心去处理。
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2、protel格式的netlist文件后缀名是net的，用记事本打开后，是这个样子，如下图所示，这个格式显然是allegro不能识别的，我们需要将netlist文件进行转换下；
3、打开protel网表转allegro.exe的程序文件，选择protel格式的netlist文件，其他默认选择，点击转换进行网表格式转换；
然后就生成了一个txt后缀名的文件，如下图所示，直接点击保存即可；
4、用记事本打开转换成的txt文件，可以看到文件格式转换已经好了，但名字中出现了很多小数点和空格的非法字符，这个比较麻烦，就需要手动去修改下，如果这款软件能自动把小数点和空格自动改为underline，那就更方便了；
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