AD9850实现嵌入式信号源设计
引 言
信号源是现代电子系统的重要组成部分，在通信、测控、导航、雷达、医疗等领域有着广泛的应用，而且信号源作为现代电子产品设计和生产中的重要工具，必须满足高精度、高速度、高分辨率、频率可调等要求。
该设计采用直接数字频率合成(dds)技术，使用dds芯片ad9850与超低功耗的msp430f149单片机配合，可输出精确控制的正弦波和方波信号。在控制流程中，通过4x 4矩阵键盘设定频率值，msp430为ad9850计算频率控制字，并且将频率控制字通过串行方式写入其中，结合键盘上步进调节增量“1 hz”，“10 hz”，“100 hz”键，使得频率可以精确到步长为1 hz的调节;产生正弦波时，经过低通滤波器滤除信号的高频分量，通过增益可调的宽带放大器放大输出所需信号。如果接到ad9850内部的高速比较器上，即可直接输出一个抖动很小的方波，系统通过字符型液晶屏1602显示设定频率和其他信息。实验结果显示，输出信号频率范围在1 hz～10 mhz，且无明显失真;输出信号频率实现1 hz，10 hz，100 hz三级步进调节，频率精度0.01 hz，频率转换速度1 ms，输出幅度范围1～10 v。
该设计的创新点在于：将dds芯片ad9850与超低功耗的msp430f149单片机结合，提出了具有较高性价比和集成度、低功耗的嵌入式信号源设计方案;并且ad9850与msp430f149采用串行连接方式，节省单片机的i/o资源，便于系统的功能扩展和产品升级。该信号源具有精度高，频率范围宽，频率输出稳定，体积小，功耗低，控制灵活方便的特点，可广泛应用于日常教学和科研工作中，如果再经过结构优化，将具有良好的市场前景。
1 系统设计
1.1 dds技术原理与结构
dds技术是一种用数字控制信号的相位增量技术，具有频率分辨率高，稳定性好，可灵活产生多种信号的优点。一个dds信号发生器由相位累加器、波形数rom表、d/a转换器以及模拟低通滤波器lpf组成，原理框图如图1所示。dds技术的核心是相位累加器。相位累加器在稳定时钟信号的控制下产生读取数据的地址值，随后通过查表变换，地址值被转化为信号波形的数字幅度序列，再由数/模变换器(d/a)将代表波形幅度的数字序列转化为模拟电压;最后经由低通滤波器将d/a输出的阶梯状波形平滑为所需的连续波形。dds信号发生器通过改变相位增量寄存器的值△phase(每个时钟周期的度数)来改变输出频率。每当n位全加器的输出锁存器接收到一个时钟脉冲时，锁存在相位增量寄存器中的频率控制字就与n位全加器的输出相加。在相位累加器的输出被锁存后，它就作为波形存储器的一个寻址地址，该地址对应波形存储器中的内容就是一个波形合成点的幅度值，然后经d/a转换变成模拟值输出。当下一个时钟到来时，相位累加器的输出又加一次频率控制字，使波形存储器的地址处于所合成波形的下一个幅值点上。最终，相位累加器检索到足够的点就构成了整个波形。合成信号的波形取决于rom表中的幅度序列，通过修改数据可以产生任意波形，如果要产生多种波形，只需把所需的多种波形数据存放到波形rom表中。
dds系统输出正弦波的频率计算公式为：
式中：fo为输出正弦波的频率;fo为系统的时钟频率;fsw为频率控制字;n为相位累加器的字长，频率控制字与输出频率成正比。由取样定理，所产生的信号频率能超过时钟频率的50 %，在实际应用中，为了保证信号的输出质量，输出频率不要高于时钟频率的33 %，以避免混叠或谐波落入有用输出频带内。
dds的频率分辨率定义为：
由于基准时钟的频率一般固定，因此相位累加器的位数决定了频率分辨率;位数越多，分辨率越高。
该信号源采用dds专用芯片ad9850产生正弦信号。ad9850采用cmos工艺，其功耗在3.3 v供电时为155 mw，扩展工业级温度范围为-40～+80℃，采用28脚ssop表面封装形式，ad9850内含可编程dds系统和高速比较器，能实现全数字编程控制的频率合成。ad9850支持的时钟输入最高为125 mhz，频率控制字的位数为32位。由式(2)可以计算出在125 mhz时钟输入时分辨率为0.021 9 hz，该设计中选用30 mhz的有源晶振，故其分辨率按式(2)计算得0.006 9 hz。
1.2 系统总体设计
该系统采用msp430f149对dds进行控制构成方波正弦波信号源的系统框图如图2所示。
该信号源由msp430f149单片机、dds芯片ad9850、低通滤波器(lpf)、4×4软键盘、1602液晶显示屏和外部参考时钟源、宽带放大器和稳压电源等组成。其中，低通滤波器是信号源中的关键器件，负责滤除正弦输出信号中的高频、杂散信号和谐波信号;稳压电源的+5 v电压经过电平转换后为msp430和ad9850提供+3.3 v的电源电压;外部参考时钟源选用30 mhz有源晶振，msp430f149与ad9850采用串行通信方式连接。
1.3 硬件设计
该信号源选用msp430f149作为核心控制器，为了节省i/o资源，方便系统功能扩展，msp430与dds芯片ad9850之间采用串行通信方式，接口电路如图3所示。ad9850与外围元件的硬件连接图如图4所示，ad9851的正弦输出信号端iout接至外部的低通滤波器，滤除高频杂散和谐波后，一路信号经过宽大放大器ad811放大后输出需要的正弦信号，另一路再回接到ad9851内部比较器的正向输入端(vinp)以得到方波信号。其中：dgnd为数字地;agnd为模拟地;vcc为模拟部分的电源电压;vdd为数字部分的电源电压。d7，fq_ud，w_clk，reset分别接至msp430的p3.0，p3.1，p3.2，p3.3上。为降低噪声信号对放大器的影响，在低通滤波器与宽带放大器之间接一级高速电压跟随器隔离，ad9850的输出信号峰峰值为1～2 v，为增大ad9850输出信号幅值，采用单位增益带宽为140 mhz，sr=2 500 v/μs的高速宽频带运放ad811进行信号放大，并且通过调节反馈电阻来改变增益，从而调节输出信号幅度。放大电路的最大放大倍数，可以满足一般的应用需求。
1.4 低通滤波器设计
低通滤波器是直接数字频率合成器的重要组成部分，其性能的优劣直接影响整个直接数字合成器的特性。在整个dds实现过程中，低通滤波器除了滤掉高频信号之外，还有除去杂散的作用。dds的杂散主要来源以下三个方面：
(1)rom幅度量化误差：相位转化为幅度，是通过寻址rom实现的，然而rom地址中存有的波形幅度值字长是有限的，rom存储能力有限而引起的舍位误差就是幅度量化误差;
(2)相位截断误差：为了提高dds的精度，dds的相位累加器位数都取得非常大，但rom的容量是有限的，因此只利用相位累加器的高m位rom寻址，其低(n-m)位被截断。由此引入的截断误差是dds杂散的主要来源;
(3)dac的转换误差，即dac中非线性引起的转换误差：dac有限的分辨率、非线性特性以及转换过程中出现的尖峰脉冲均会导致频谱质量变坏。因此，低通滤波器的使用是非常必要的，其性能的优劣直接关系到整个dds的技术指标。
低通滤波器可以分为巴特沃什滤波、切比雪夫滤波、贝赛尔滤波和椭圆滤波等。巴特沃什低通滤波器通带和阻带都是平坦的，但是其过渡带太过平缓;切比雪夫低通滤波器的通带是等波纹抖动的，阻带是平坦的，过渡带比巴特沃什稍陡;贝赛尔低通滤波器和切比雪夫低通刚好相反，通带平坦，阻带是等波纹抖动的;椭圆低通滤波器的通带和阻带都是抖动的。但是其过渡带下降迅速，过渡带很窄。在该系统中，为了使输出信号频率最高10 mhz时能够最低程度地降低ad9850外部系统时钟30 mhz的干扰，采用具有较窄过渡带特性的椭圆滤波器，并采用7阶椭圆低通滤波。根据系统要求，输出信号的频率可达10 mhz，设定其通带为10 mhz，且7阶滤波具有下降速度更快的过渡带，可以有效地滤除10 mhz以上的高频干扰。考虑到实际的椭圆滤波器设计与理论分析是有所不同的，在此使用multisim 9经行仿真后得出椭圆滤波器的具体参数。椭圆低通滤波器的电路图如图5所示。
2 系统软件设计
软件设计主要分为菜单操作和频率控制值计算两部分。在系统中通过外接4×4软键盘输入设定频率和调整步进。一共16个按键，不同的按键代表着不同的数字和功能，除了正常的10个数字键0～9外，为了方便频率值的输入，还设计了菜单键、删除键、步进一、步进十、确认键、输出键等功能键。通过输入0～9数字键，输入设定频率;按下确认键，输出相应频率的波形;按下菜单键，可根据需要按下1，2，3数字键，分别选择1 hz，10 hz，100 hz三个档位的频率步进;按下确认键，此后按下步进+、步进一即可对输出信号进行频率的步进调整;欲重新设定频率只需按下删除键，再次输入预设的频率即可。
该系统中单片机与ad9850采用串行通信方式连接。其中，频率控制字的计算：ad9850的时钟信号采用30 mhz，根据式(1)得：
式中：fo为从键盘上输入的频率值。式(3)计算的结果在不影响精度的情况下舍去小数部分，转换为32位的频率控制字。ad9850有40位控制字，32位用于频率控制，5位用于相位控制，1位用于电源休眠(powerdown)控制，2位用于选择工作方式。这40位控制字可通过并行方式或串行方式输入到ad9850。实际应用中，工作方式选择位通常设定成00，该系统中ad9850的40位控制字高8位设置为00h。串行接口方式下需满足的时序关系为：在w_clk的上升沿，引脚d7上的数据自最低有效位开始逐位串行移人输入寄存器，40位数据输入结束后，任何w_clk上升沿到来，都会造成数据顺序移出并导致原来数据无效。此时，fq_ud端的上升沿将40位数据装入频率/相位控制寄存器，更新芯片的输出频率和相位，同时把地址指针复位到第一个输入寄存器，等待下一组新数据的写入。ad9850的控制字串行输入时序图如图6所示。
该系统的总程序框图如图7所示，程序开始后，运行初始化程序，包括初始化单片机msp430f149、初始化ad9850、初始化液晶显示模块1602等。然后扫描键盘状态，检查到有键按下就运行键值处理程序，对按键值进行查表处理，之后执行相应的子程序。输入的信号相关信息通过运行液晶显示程序，在lcd上显示正确的输入数据和提示字符。在按下确认键后，msp430f149计算出所需信号的数据或控制命令，将其传送到ad9850，输出最终信号。
3 系统测试与结果分析
为了检验本系统的实际性能，在完成所有设计后，使用hdsto22m型示波表对该系统进行实测，经过实验测试系统达到下列性能指标：输出信号频率范围为1 hz～10 mhz;步进调整为1 hz，10 hz，100 hz三档步进;失真度无明显失真;输出电压峰峰值为1～10 v;频率稳定度优于10-4。
4 结 语
在此给出一种基于dds芯片ad9850和msp430f149单片机的嵌入式信号源设计方法，该信号源可输出频率范围为1 hz～10 mhz的正弦波和方波，且具有频率设定1 hz，10 hz，100 hz多档步进调整和幅度调节的功能。可以通过按键进行频率值设定，并有lcd显示波形的频率等信息，经实验测试，在1 hz～10 mhz频率范围内，得到的正弦波方波信号具有频率稳定性好，频率准确度高及频率分辨率高等特点。
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式中：fo为输出正弦波的频率;fo为系统的时钟频率;fsw为频率控制字;n为相位累加器的字长，频率控制字与输出频率成正比。由取样定理，所产生的信号频率能超过时钟频率的50 %，在实际应用中，为了保证信号的输出质量，输出频率不要高于时钟频率的33 %，以避免混叠或谐波落入有用输出频带内。
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由于基准时钟的频率一般固定，因此相位累加器的位数决定了频率分辨率;位数越多，分辨率越高。
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1.4 低通滤波器设计
低通滤波器是直接数字频率合成器的重要组成部分，其性能的优劣直接影响整个直接数字合成器的特性。在整个dds实现过程中，低通滤波器除了滤掉高频信号之外，还有除去杂散的作用。dds的杂散主要来源以下三个方面：
(1)rom幅度量化误差：相位转化为幅度，是通过寻址rom实现的，然而rom地址中存有的波形幅度值字长是有限的，rom存储能力有限而引起的舍位误差就是幅度量化误差;
(2)相位截断误差：为了提高dds的精度，dds的相位累加器位数都取得非常大，但rom的容量是有限的，因此只利用相位累加器的高m位rom寻址，其低(n-m)位被截断。由此引入的截断误差是dds杂散的主要来源;
(3)dac的转换误差，即dac中非线性引起的转换误差：dac有限的分辨率、非线性特性以及转换过程中出现的尖峰脉冲均会导致频谱质量变坏。因此，低通滤波器的使用是非常必要的，其性能的优劣直接关系到整个dds的技术指标。
低通滤波器可以分为巴特沃什滤波、切比雪夫滤波、贝赛尔滤波和椭圆滤波等。巴特沃什低通滤波器通带和阻带都是平坦的，但是其过渡带太过平缓;切比雪夫低通滤波器的通带是等波纹抖动的，阻带是平坦的，过渡带比巴特沃什稍陡;贝赛尔低通滤波器和切比雪夫低通刚好相反，通带平坦，阻带是等波纹抖动的;椭圆低通滤波器的通带和阻带都是抖动的。但是其过渡带下降迅速，过渡带很窄。在该系统中，为了使输出信号频率最高10 mhz时能够最低程度地降低ad9850外部系统时钟30 mhz的干扰，采用具有较窄过渡带特性的椭圆滤波器，并采用7阶椭圆低通滤波。根据系统要求，输出信号的频率可达10 mhz，设定其通带为10 mhz，且7阶滤波具有下降速度更快的过渡带，可以有效地滤除10 mhz以上的高频干扰。考虑到实际的椭圆滤波器设计与理论分析是有所不同的，在此使用multisim 9经行仿真后得出椭圆滤波器的具体参数。椭圆低通滤波器的电路图如图5所示。
2 系统软件设计
软件设计主要分为菜单操作和频率控制值计算两部分。在系统中通过外接4×4软键盘输入设定频率和调整步进。一共16个按键，不同的按键代表着不同的数字和功能，除了正常的10个数字键0～9外，为了方便频率值的输入，还设计了菜单键、删除键、步进一、步进十、确认键、输出键等功能键。通过输入0～9数字键，输入设定频率;按下确认键，输出相应频率的波形;按下菜单键，可根据需要按下1，2，3数字键，分别选择1 hz，10 hz，100 hz三个档位的频率步进;按下确认键，此后按下步进+、步进一即可对输出信号进行频率的步进调整;欲重新设定频率只需按下删除键，再次输入预设的频率即可。
该系统中单片机与ad9850采用串行通信方式连接。其中，频率控制字的计算：ad9850的时钟信号采用30 mhz，根据式(1)得：
式中：fo为从键盘上输入的频率值。式(3)计算的结果在不影响精度的情况下舍去小数部分，转换为32位的频率控制字。ad9850有40位控制字，32位用于频率控制，5位用于相位控制，1位用于电源休眠(powerdown)控制，2位用于选择工作方式。这40位控制字可通过并行方式或串行方式输入到ad9850。实际应用中，工作方式选择位通常设定成00，该系统中ad9850的40位控制字高8位设置为00h。串行接口方式下需满足的时序关系为：在w_clk的上升沿，引脚d7上的数据自最低有效位开始逐位串行移人输入寄存器，40位数据输入结束后，任何w_clk上升沿到来，都会造成数据顺序移出并导致原来数据无效。此时，fq_ud端的上升沿将40位数据装入频率/相位控制寄存器，更新芯片的输出频率和相位，同时把地址指针复位到第一个输入寄存器，等待下一组新数据的写入。ad9850的控制字串行输入时序图如图6所示。
该系统的总程序框图如图7所示，程序开始后，运行初始化程序，包括初始化单片机msp430f149、初始化ad9850、初始化液晶显示模块1602等。然后扫描键盘状态，检查到有键按下就运行键值处理程序，对按键值进行查表处理，之后执行相应的子程序。输入的信号相关信息通过运行液晶显示程序，在lcd上显示正确的输入数据和提示字符。在按下确认键后，msp430f149计算出所需信号的数据或控制命令，将其传送到ad9850，输出最终信号。
3 系统测试与结果分析
为了检验本系统的实际性能，在完成所有设计后，使用hdsto22m型示波表对该系统进行实测，经过实验测试系统达到下列性能指标：输出信号频率范围为1 hz～10 mhz;步进调整为1 hz，10 hz，100 hz三档步进;失真度无明显失真;输出电压峰峰值为1～10 v;频率稳定度优于10-4。
4 结 语
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