异步复位寄存器的0时刻是如何进行赋值的呢？
verilog规范告诉我们：negedge 事件指的是如表43所示的跳变，发生negedge事件时才会执行操作。那么0时刻，是如何执行操作的呢？
鸽子在verilog标准中并没有找到0时刻赋值明确的说明。如下代码中，0时刻，rst_n为0,clk 处于低电平，那么cfg_mode的数值是多少呢？
always @(posedge clk or negedge rst_n) if (!rst_n) begin cfg_mode <= 1'b0; end else begin cfg_mode <= cfg_mode_in ;end
实际电路中：
在芯片上电之前，芯片的chip_reset一直处于复位状态，因此导致芯片内部的rst_n一直为0，且芯片内部pll还没有工作，也没有产生clk，此时没有任何信号的跳变，即clk没有跳变，rst_n一直为0也没有跳变。在实际电路中，从d触发器的结构图可以看到，当复位r一直是1时，即使时钟信号不跳变，q端输出也是0。
vcs在0时刻赋值
vcs 在0时刻会执行一次always块的赋值，而不是等到信号跳变。
module zero_time_test; reg rst_n; initial begin rst_n = 0; #20 rst_n = 1; end always@(posedge rst_n) begin: always_case1 $display(the always case1 executed @time %f, $time()); end always@(negedge rst_n) begin: always_case2 $display(the always case2 executed @time %f, $time()); end always@(rst_n) begin: always_case3 $display(the always case3 executed @time %f, $time()); end endmodulemodule zero_time_test; reg rst_n; initial begin rst_n = 1; #20 rst_n = 0; end always@(posedge rst_n) begin: always_case4 $display(the always case4 executed @time %f, $time()); end always@(negedge rst_n) begin: always_case5 $display(the always case5 executed @time %f, $time()); end always@(rst_n) begin: always_case6 $display(the always case6 executed @time %f, $time()); end endmodule
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vcs在0时刻赋值
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module zero_time_test; reg rst_n; initial begin rst_n = 0; #20 rst_n = 1; end always@(posedge rst_n) begin: always_case1 $display(the always case1 executed @time %f, $time()); end always@(negedge rst_n) begin: always_case2 $display(the always case2 executed @time %f, $time()); end always@(rst_n) begin: always_case3 $display(the always case3 executed @time %f, $time()); end endmodulemodule zero_time_test; reg rst_n; initial begin rst_n = 1; #20 rst_n = 0; end always@(posedge rst_n) begin: always_case4 $display(the always case4 executed @time %f, $time()); end always@(negedge rst_n) begin: always_case5 $display(the always case5 executed @time %f, $time()); end always@(rst_n) begin: always_case6 $display(the always case6 executed @time %f, $time()); end endmodule
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