PCIe 5.0推行下再迎爆点的扇出缓冲器
作为一种高速总线接口技术，pcie具有很多优势，比如大带宽和模块化，采用标准独特连接时可以优化成本及可靠性等。随着pcie的应用日渐普及，越来越多的平台开始过渡到更新的pcie标准。
pcie 5.0作为最新一代的pcie的标准，理所当然地成了数据中心高速计算处理持续演进的关键。不仅是作为cpu与ai加速器之间的纽带，越来越多的存储方案也开始从sas/sata转向pcie，包括固态硬盘。不仅如此，在ai/ml这样的工作负载转变下，pcie在pc、工作站、数据通信乃至汽车上的出镜率也越来越高，异构计算等架构也对带宽提出了更高的需求。
除了最小的pcie系统以外，几乎所有系统中都需使用pcie时钟分配器件，也就是缓冲器。 器件有限的引脚数目限制了单个器件中可以生成的pcie时钟数量。某些情况下，电路板布线要求也会限制可在单个区域中可分配的时钟数量。
扇出缓冲器可将单个时钟从拥挤的电路板区域引出至需要多份拷贝的区域，然后缓冲器在本地扇出时钟。此外，在只有来自连接器的单pcie时钟，却需要多份拷贝的情况下，也得靠扇出缓冲器来解决问题。
ti
ti的lmk00334就是一款经典的4路输出hcsl扇出缓冲器，具备两组双差分输出。该缓冲器采用了3：1输入多路复用器，其中两个通用输入工作频率高达400mhz，接受lvpecl、lvds、cml、sstl、hstl、hcsl或单端时钟，另一个晶振输入则可以接受10mhz到40mhz的晶振或单端时钟。
lmk00334 / ti
该缓冲器兼容pcie gen1至gen5的标准，在100mhz pcie 5.0下的附加相位抖动低至30fs rms。lmk00334的输入和性能特性，让其成了替代固定输出缓冲器的不二之选，如此低的附加抖动在服务器、射频拉远单元和基站单元可以说是一大优势。
瑞萨
瑞萨的9dbl0255和9dbl0455是针对pcie 1到5应用的pcie时钟扇出缓冲器，分别为2输出和4输出，其中9dbl0455的工作频率可高至267mhz。根据瑞萨在规格书上提供的数据，该系列在pcie 5.0下可以做到小于15fs rms的附加抖动值，在156.25mhz的高频下典型附加抖动为46fs rms。
9dbl0255/0455原理图 / 瑞萨
该系列最大的特点在与集成了一个开漏信号丢失（los）输出电路，用于指示是否存在输入时钟。瑞萨也有内置pll的pcie缓冲器，不过在需要扩频的情况下，基本都要用到纯扇出缓冲器。而且在没有旁路mux的情况下，也进一步降低了传播延迟。
skyworks
skyworks在今年收购silicon labs基础设施和汽车业务后，silicon labs的部分产品全部归到了skyworks旗下，扇出缓冲器也是其中之一。si53212、si53208 和 si53204 是skyworks高性能、附加抖动低的低功耗 pcie 时钟缓冲器产品系列，分别可以获得 12、8 或 4 路 100 mhz 的 pcie 时钟输出，均为非pll的扇出缓冲器。
si53212 原理图 / skyworks
除了100mhz以外，该系列还支持10mhz到200mhz的输入频率。该系列所有差分时钟输出均符合 pcie gen1/2/3/4/5 公共时钟和单独参考时钟规格。该缓冲器产品系列支持扩频，可以用于对输入时钟进行扩频直通，进一步降低emi以保证信号完整性。不过该系列的附加抖动没有做到极致，在pcie 4.0下的附加抖动典型值为0.04ps。
随着越来越多的数据中心硬件设计正在使用1.5v或1.8v电源，以最大限度地降低整体功耗，比如网络接口控制器（nic）、pcie总线扩展器和高性能计算（hpc）加速器等。si532xx系列缓冲器支持单个1.5v-1.8v电源供电，非常适合在这样的低功耗设计中提供低抖动pcie时钟分发。除了支持pcie通用时钟外，该系列也支持分离参考无展频（srns）和分离参考独立展频（sris）架构，能够满足各种应用需求。
极景微半导体
为突破高性能时钟芯片上“卡脖子”的困境，南京极景微半导体也在近日推出了两款支持pcie 5.0接口标准的4/8输出时钟扇出缓冲器，分别是us5d334和us5d338，前者可为输入时钟创建4个缓冲副本，后者可产生8个缓冲副本。
虽然没有给出具体的数据，但极景微半导体称us5d334和us5d338可以直接以pin2pin的方式替代ti的lmk00334和lmk00338，而且能与未来极景微自研的us6s208时钟发生器结合，提供国产的高性能时钟树方案。极景微指出，这两款扇出缓冲器与同类竞争器件相比，支持锐降70%的附加抖动，而且支持显著提高的电源噪声抑制。
小结
其实不只是数据中心，移动互联网和汽车电子也在推动更高性能的时钟解决方案，不少厂商也都推出了车规级的pcie缓冲器。在pcie 5.0从今年年底正式开始铺开的情况下，扇出缓冲器市场也将迎来新一轮的爆发。
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除了最小的pcie系统以外，几乎所有系统中都需使用pcie时钟分配器件，也就是缓冲器。 器件有限的引脚数目限制了单个器件中可以生成的pcie时钟数量。某些情况下，电路板布线要求也会限制可在单个区域中可分配的时钟数量。
扇出缓冲器可将单个时钟从拥挤的电路板区域引出至需要多份拷贝的区域，然后缓冲器在本地扇出时钟。此外，在只有来自连接器的单pcie时钟，却需要多份拷贝的情况下，也得靠扇出缓冲器来解决问题。
ti
ti的lmk00334就是一款经典的4路输出hcsl扇出缓冲器，具备两组双差分输出。该缓冲器采用了3：1输入多路复用器，其中两个通用输入工作频率高达400mhz，接受lvpecl、lvds、cml、sstl、hstl、hcsl或单端时钟，另一个晶振输入则可以接受10mhz到40mhz的晶振或单端时钟。
lmk00334 / ti
该缓冲器兼容pcie gen1至gen5的标准，在100mhz pcie 5.0下的附加相位抖动低至30fs rms。lmk00334的输入和性能特性，让其成了替代固定输出缓冲器的不二之选，如此低的附加抖动在服务器、射频拉远单元和基站单元可以说是一大优势。
瑞萨
瑞萨的9dbl0255和9dbl0455是针对pcie 1到5应用的pcie时钟扇出缓冲器，分别为2输出和4输出，其中9dbl0455的工作频率可高至267mhz。根据瑞萨在规格书上提供的数据，该系列在pcie 5.0下可以做到小于15fs rms的附加抖动值，在156.25mhz的高频下典型附加抖动为46fs rms。
9dbl0255/0455原理图 / 瑞萨
该系列最大的特点在与集成了一个开漏信号丢失（los）输出电路，用于指示是否存在输入时钟。瑞萨也有内置pll的pcie缓冲器，不过在需要扩频的情况下，基本都要用到纯扇出缓冲器。而且在没有旁路mux的情况下，也进一步降低了传播延迟。
skyworks
skyworks在今年收购silicon labs基础设施和汽车业务后，silicon labs的部分产品全部归到了skyworks旗下，扇出缓冲器也是其中之一。si53212、si53208 和 si53204 是skyworks高性能、附加抖动低的低功耗 pcie 时钟缓冲器产品系列，分别可以获得 12、8 或 4 路 100 mhz 的 pcie 时钟输出，均为非pll的扇出缓冲器。
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随着越来越多的数据中心硬件设计正在使用1.5v或1.8v电源，以最大限度地降低整体功耗，比如网络接口控制器（nic）、pcie总线扩展器和高性能计算（hpc）加速器等。si532xx系列缓冲器支持单个1.5v-1.8v电源供电，非常适合在这样的低功耗设计中提供低抖动pcie时钟分发。除了支持pcie通用时钟外，该系列也支持分离参考无展频（srns）和分离参考独立展频（sris）架构，能够满足各种应用需求。
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虽然没有给出具体的数据，但极景微半导体称us5d334和us5d338可以直接以pin2pin的方式替代ti的lmk00334和lmk00338，而且能与未来极景微自研的us6s208时钟发生器结合，提供国产的高性能时钟树方案。极景微指出，这两款扇出缓冲器与同类竞争器件相比，支持锐降70%的附加抖动，而且支持显著提高的电源噪声抑制。
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