FPGA开发要掌握的六大基础知识（3）
xilinx fpga开发软件为ise.现在其版本更新比较快，大家现在常用的版本都在ise12.1了。
使用ise开发fpga，需要根据自己的设计内容和设计目标设置，在开发软件中设置一些参数。这些参数对成功开发可以说必不可少。
常用选项之一： keep hierachy。该参数有3个值：no、yes、soft.
在使用chipscope进行调试时，如果是采用的网表插入icon的方法的话，或者是为了便于调试，最好是保留设计的层次结构，选择yes或soft。yes与soft的区别是：
keep hierachy =yes：对debug阶段有用，xst会根据层次综合而不打破层次优化，所有寄存器名字都以名字排列，traslate通过ucf文件可以很方面地找到需要的约束对象。
keep hierachy =soft：则在综合时保持层次，在map阶段工具将打破层次关系；但instance名字还是保留。
在fpga设计原型验证阶段，选yes会提高xst的综合速度。
常用选项之二：register_duplication + max_fanout + equivalent_register_removal + resource_sharing - 允许自动复制寄存器，设置最大扇出，禁止资源共享。这4个选项是对map和par的效果影响最明显的。不同的设计，他们的选择
组合方式不尽相同。要看具体设计情况。下面是其中的一种开发策略。
当timing不满足时使用复制寄存器的方法通常能改善一些瓶颈。综合器为了节省面积而做出的某些优化可能导致对时序不利，因此关闭equivalent_register_removal和resource_sharing可能可以改善时序。
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