首先开门见山的回答这个问题——lut的作用是 实现所有的逻辑函数 ,也就是类似于计算y=a&b+c+d之类的算式结果!
lut是什么构成的?
xilinx的lut是4输入1输出的 ram ,也就是4根地址线的,一根数据线的ram,并且i1是高地址位,i4是低地址位,样子参考下图。i1到i4就是地址线,o是输出数据线。
ram怎么实现逻辑运算?
假设要实现运算y=a&b+c+d。假设i1代表a,i2代表b,i3代表c,i4代表d,o代表y。此时将下表存入lut中。从下表可以看出,lut存储的就是函数y=a&b+c+d的真值表。 **4个输入信号的地址对应的位置上存储的就是4个地址进行逻辑运算后的真值!** 这样任何4输入的所有逻辑运算都可以通过存取真值表的方法实现。一旦输入地址中的任何一个数,立马就会输出存储位置上对应的结果。
verilog怎么实现上面的函数呢?
reg y;
reg [3:0] i ;
always@(*)begin y=(i[0] & i1) | i2 | i3;end
请注意( )里面是 ,代表不需要时钟,实现的是组合逻辑。如果最后一行变成如下:
always@(posedge clk)begin y=(i[0] & i1) | i2 | i3;end
则生成的不是一个lut是一个lut加一个触发器ff。如下图。
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