JESD204B：高达12.5Gbps高速数据采集的新替代方案
您的pcb可以处理高达12.5gbps的速度吗，感到惊讶，对吗？jesd204b标准为串行接口提供高达12.5gbps的比特率。这种升级允许设计人员在fpga/asic上使用更少的收发器，从而减少i/o数量和封装尺寸。新标准正在高速数据转换器应用中迅速采用，例如无线基础设施收发器、软件定义无线电、医疗成像系统以及雷达和安全通信。
多个串行通道和高达 12.5g 的转换器
回到10年前，设计人员使用传统的单端cmos接口，将速度限制在200mbps左右。然后是差分lvds，改善了信号线和电源上的噪声耦合。该接口的局限性是在较低的采样速度下功耗较高。这给了cmos接口存在的理由，至今仍在使用。随着更快的adc的发展，需要比并行lvds更节能的数字接口，这种需求催生了jesd204，一种高速串行链路，将单个或多个数据转换器连接到数字逻辑器件，jesd3a的数据速率高达125.204 gbps，jesd12b的数据速率高达5.204gbps。
为了选择使用lvds或各种版本的jesd204串行接口规范的最佳转换器产品，比较每个接口的特性和功能是有用的。下表提供了简短的表格比较。
为什么我们关心jesd204b？
符合jesd204b标准的数据转换器以更高的速率串行化和传输数据，从而减少数据转换器或fpga上的引脚数量。
布局简单，路线更方便，因为船上的车道要少得多。
更小的封装尺寸和更低的成本。
减少对偏斜管理的需求，因为数据时钟嵌入在数据流中。
jesd204b接口可适应不同分辨率的数据转换器。这样就无需对未来的adc和数模转换器（dac）的收发器/接收器（tx/rx）板（逻辑器件）进行物理重新设计。
jesd204b标准通过使用确定性延迟简化了多通道同步。
很明显，jesd204b是先进数据采集系统设计的首选接口。该标准减少了高速数据转换器与fpga和其他设备之间的数字输入和输出数量。更少的互连简化了布局，并有可能实现更小的外形尺寸。
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