基于FPGA的可编程AES加解密IP
可编程aes加解密ip
可编程aes加解密ip提供了加解密算法功能，兼容美国国家标准与技术研究院（nist）发布的高级加密标准(aes)：fips pub 197。结合fips 197分组加密算法，可编程aes加解密ip具备5种加密模式：ecb，cbc，cfb，ofb，ctr，全部支持加密和解密功能，兼容美国国家标准与技术研究院（nist）发布的推荐分组加密操作模式：nist special publication 800-38a。可编程aes加解密ip内建密钥扩展功能，使用初始密钥产生扩展密钥，用于加解密过程。可编程aes加解密ip处理128-bit分组数据，并且支持可编程的密钥长度：128-bit，192-bit和256-bit。
内核特性：
1. 使用aes rijndael分组加密算法进行加解密
2. 兼容联邦信息处理标准fips publication 197
3. 兼容推荐分组加密操作模式：nist special publication 800-38a
4. 用户可编程密钥长度：128-bit，192-bit和256-bit
5. 用户可编程加密模式：ecb，cbc，ofb，cfb和ctr
6. 内置密钥扩展
7. 128-bit高速数据通路；对于128/192/256-bit加密密钥，内核分别需要11/13/15个时钟周期来处理128-bit分组
8. 易于集成的同步，可综合verilog设计
9. 通过完全验证的aes ip
对外接口：
1. 标准的axi4-stream数据总线
2. 方便的axi4-stream类似的接口，用于配置密钥、模式和参数
性能指标：
1. 加解密吞吐率大于3gbps@250mhz内核时钟
资源使用（xcku115为例）：
1. luts：5532，ffs：2535
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5. 用户可编程加密模式：ecb，cbc，ofb，cfb和ctr
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