——简化的risc cpu设计
咱们讨论简化的risc cpu设计。
2.risc cpu结构
④算数运算器
算术逻辑运算单元 根据输入的8种不同操作码分别实现相应的加、与、异或、跳转等8种基本操作运算。利用这几种基本运算可以实现很多种其它运算以及逻辑判断等操作。
其veriloghdl 程序见下面的模块:
//------------------------------------------
module alu (alu_out, zero, data, accum, alu_clk, opcode);
output [7:0]alu_out;
output zero;
input [7:0] data, accum;
input [2:0] opcode;
input alu_clk;
reg [7:0] alu_out;
parameter hlt =3’b000,
skz =3’b001,
add =3’b010,
andd =3’b011,
xorr =3’b100,
lda =3’b101,
sto =3’b110,
jmp =3’b111;
assign zero = !accum;
always @(posedgealu_clk)
begin //操作码来自指令寄存器的输出opc_iaddr的低3位
casex (opcode)
hlt: alu_out<=accum;
skz: alu_out<=accum;
add: alu_out<=data+accum;
andd: alu_out<=data&accum;
xorr: alu_out<=data^accum;
lda: alu_out<=data;
sto: alu_out<=accum;
jmp: alu_out<=accum;
default: alu_out<=8'bxxxx_xxxx;
endcase
end
endmodule
//------------------------------------------
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简化的RISC CPU设计解析
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