8位串行模数转换器TLC548、TLC549的应用
1、概述
tlc548，tlc549是美国德州仪器公司生产的8位串行a/d转换器芯片，可与通用微处理器、控制器通过i/oclock、cs、dataout三条口线进行串行接口。具有4mhz片内系统时钟和软、硬件控制电路，转换时间最长17μs，tlc548允许的最高转换速率为45500次/s，tlc549为40000次/s。总失调误差最大为±0.5lsb，典型功耗值为6mw。采用差分参考电压高阻输入，抗干扰，可按比例量程校准转换范围，vref-接地，vref+-vref-≥1v，可用于较小信号的采样。
2、芯片简介 tlc548、tlc549的内部框图和引脚名称如图1所示。
3、工作原理 tlc548、tlc549均有片内系统时钟，该时钟与i/oclock是独立工作的，无须特殊的速度或相位匹配。其工作时序如图2所示。
当cs为高时，数据输出（dataout）端处于高阻状态，此时i/oclock不起作用。这种cs控制作用允许在同时使用多片tlc548、tlc549时，共用i/oclock，以减少多路（片）a/d并用时的i/o控制端口。一组通常的控制时序为：
（1）将cs置低。内部电路在测得cs下降沿后，再等待两个内部时钟上升沿和一个下降沿后，然后确认这一变化，最后自动将前一次转换结果的最高位（d7）位输出到dataout端上。
（2）前四个i/oclock周期的下降沿依次移出第2、3、4和第5个位（d6、d5、d4、d3），片上采样保持电路在第4个i/oclock下降沿开始采样模拟输入。
（3）接下来的3个i/oclock周期的下降沿将移出第6、7、8（d2、d1、d0）个转换位。
（4）最后，片上采样保持电路在第8个i/oclock周期的下降沿将移出第6、7、8（d2、d1、d0）个转换位。保持功能将持续4个内部时钟周期，然后开始进行32个内部时钟周期的a/d转换。第8个i/oclock后，cs必须为高，或i/oclock保持低电平，这种状态需要维持36个内部系统时钟周期以等待保持和转换工作的完成。如果cs为低时i/oclock上出现一个有效干扰脉冲，则微处理器/控制器将与器件的i/o时序失去同步;若cs为高时出现一次有效低电平，则将使引脚重新初始化，从而脱离原转换过程。
在36个内部系统时钟周期结束之前，实施步骤（1）-（4），可重新启动一次新的a/d转换，与此同时，正在进行的转换终止，此时的输出是前一次的转换结果而不是正在进行的转换结果。若要在特定的时刻采样模拟信号，应使第8个i/oclock时钟的下降沿与该时刻对应，因为芯片虽在第4个i/oclock时钟下降沿开始采样，却在第8个i/oclock的下降沿开始保存。
4、应用接口及采样程序 tlc548、tlc549可方便地与具有串行外围接口（spi）的单片机或微处理器配合使用，也可与51系列通用单片机连接使用。与51系列单片机的接口如图3所示。其采样程序框图如图4所示，实际应用程序清单如下：
tlc548/549片型小，采样速度快，功耗低，价格便宜，控制简单。适用于低功耗的袖珍仪器上的单路a/d或多路并联采样。
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2、芯片简介 tlc548、tlc549的内部框图和引脚名称如图1所示。
3、工作原理 tlc548、tlc549均有片内系统时钟，该时钟与i/oclock是独立工作的，无须特殊的速度或相位匹配。其工作时序如图2所示。
当cs为高时，数据输出（dataout）端处于高阻状态，此时i/oclock不起作用。这种cs控制作用允许在同时使用多片tlc548、tlc549时，共用i/oclock，以减少多路（片）a/d并用时的i/o控制端口。一组通常的控制时序为：
（1）将cs置低。内部电路在测得cs下降沿后，再等待两个内部时钟上升沿和一个下降沿后，然后确认这一变化，最后自动将前一次转换结果的最高位（d7）位输出到dataout端上。
（2）前四个i/oclock周期的下降沿依次移出第2、3、4和第5个位（d6、d5、d4、d3），片上采样保持电路在第4个i/oclock下降沿开始采样模拟输入。
（3）接下来的3个i/oclock周期的下降沿将移出第6、7、8（d2、d1、d0）个转换位。
（4）最后，片上采样保持电路在第8个i/oclock周期的下降沿将移出第6、7、8（d2、d1、d0）个转换位。保持功能将持续4个内部时钟周期，然后开始进行32个内部时钟周期的a/d转换。第8个i/oclock后，cs必须为高，或i/oclock保持低电平，这种状态需要维持36个内部系统时钟周期以等待保持和转换工作的完成。如果cs为低时i/oclock上出现一个有效干扰脉冲，则微处理器/控制器将与器件的i/o时序失去同步;若cs为高时出现一次有效低电平，则将使引脚重新初始化，从而脱离原转换过程。
在36个内部系统时钟周期结束之前，实施步骤（1）-（4），可重新启动一次新的a/d转换，与此同时，正在进行的转换终止，此时的输出是前一次的转换结果而不是正在进行的转换结果。若要在特定的时刻采样模拟信号，应使第8个i/oclock时钟的下降沿与该时刻对应，因为芯片虽在第4个i/oclock时钟下降沿开始采样，却在第8个i/oclock的下降沿开始保存。
4、应用接口及采样程序 tlc548、tlc549可方便地与具有串行外围接口（spi）的单片机或微处理器配合使用，也可与51系列通用单片机连接使用。与51系列单片机的接口如图3所示。其采样程序框图如图4所示，实际应用程序清单如下：
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