DS3144成帧器与DS3154 LIU的连接
摘要：ds3144在一块硅片上集成了四个独立的ds3/e3成帧器，包括在四路单独的ds3或e3信道产生帧并对其进行格式化所必需的全部电路。器件中的每一个成帧器都是独立配置，支持具有告警检测与生成功能的m23 ds3、ds3 c位奇偶或g.751帧格式。ds3144可以不使用粘合逻辑与各种liu、微处理器总线和其他系统元件连接。连接到liu的数字数据可以是二进制(nrz)或双极性(pos/neg)数据，并提供内部b3zs/hdb3编、解码器。ds3154四liu提供在物理层与ds3、e3或sts-1线路接口的必要功能。每一个liu有一个独立的接收和发送通道以及一个内置的抖动衰减器。ds3154的每一个端口独立配置。ds3154可以采用硬件配置或cpu总线配置。
本应用笔记也适用于下面的dallas semiconductor成帧器和dallas semiconductor liu： ds3/e3 framer description
ds3141 single-port framer
ds3142 dual-port framer
ds3143 triple-port framer
ds3146 6-port framer
ds3148 8-port framer
ds31412 12-port framer
ds3/e3/sts-1 liu description
ds3151 single-port liu
ds3152 dual-port liu
ds3153 triple-port liu
ds3144接收成帧器liu接口引脚接收正数据输入/接收nrz数据输入(rpos/rnrz)：如果mc1寄存器中的bin = 0，liu接口处于双极性模式(pos/neg)。这种模式下，ami格式的串行数据流随时钟输入成帧器。外部liu 的rpos = 1表示线上接收到正脉冲，liu的rneg = 1表示线上接收到负脉冲。如果bin = 1，成帧器处于二进制(nrz) liu接口模式。在这种模式下，成帧器在rnrz引脚随时钟输入二进制格式的串行数据。rnrz = 1表示数据流中的一个1，rnrz = 0表示数据流中的一个0。 接收负数据输入/接收线路代码违反输入(rneg/rlcv)：如果mc1寄存器中的bin = 0，liu接口处于双极性模式(pos/neg)。这种模式下，成帧器随时钟输入交替符号反转(ami)格式的串行数据流。外部liu的rpos = 1表示线上接收到正脉冲，liu上的rneg = 1表示线上接收到一个负脉冲。如果bin = 1，成帧器处于二进制(nrz) liu接口模式。在这种模式下，成帧器在rnrz引脚随时钟输入二进制格式的串行数据流，在rlcv引脚输入线路代码违反。 接收时钟输入(rclk)：rclk用来将数据从rpos/rneg (双极性liu接口模式)或rnrz (二进制liu接口模式)送入接收成帧器。如果mc5寄存器中的rclki = 0，数据在rclk的上升沿进入成帧器。如果rclki = 1，数据在rclk的下降沿进入成帧器。从liu得到的rclk通常具有±20ppm以内的精确度，但是成帧器也能在rclk上接收高达52mhz的间隙时钟，比如从那些将ds3和e3映射至sonet/sdh或从中反映射的ic中得到的时钟。 ds3144发送格式化liu接口引脚发送正数据输出/发送nrz数据输出(tpos/tnrz)：如果mc1寄存器的bin = 0，liu接口处于双极性(pos/neg)模式。在这种模式下，发送格式化器以ami格式输出串行数据流。tpos = 1告诉外部liu要在线上驱动一个正脉冲，tneg = 1告诉liu在线上驱动一个负脉冲。如果bin = １，liu接口处于二进制(nrz)模式。在这种模式下，发送格式化器在tnrz引脚上以二进制格式输出串行数据流。tnrz = 1表示数据流中的一个1，tnrz = 0表示0。 发送负数据输出(tneg)：如果mc1寄存器中的bin = 0，liu接口处于双极性(pos/neg)模式。这种模式下，发送格式化器以ami格式输出串行数据流。tpos = 1告诉外部liu在线上驱动一个正脉冲，tneg = 1告诉liu在线上驱动一个负脉冲。如果bin = 1，liu接口处于二进制(nrz)模式。这种模式下，发送格式化器在tnrz引脚上以二进制格式输出串行数据流，并且tneg被置低。 发送时钟输出(tclk)：tclk用于发送成帧器从tpos/tneg (双极性liu接口模式)或tnrz (二进制liu接口模式)输出时钟数据。如果mc5寄存器的tclki = 0，数据在tclk的上升沿送出格式化器。如果tclki = 1，数据在tclk下降沿输出。tclk通常ticlk的缓冲输出(可选择反相)。当线路环回或载荷环回激活时，tclk是rclk的缓冲输出(可选择反相)。当ticlk上没有时钟信号并且mc1：lotcmc=1时，tclk是rclk缓冲输出(可选择反相)。 ds3154接收-liu成帧器接口引脚接收器正ami/接收器数据(rpos/rdat)：当接收器被配置为双极性接口时(rbin = 0)，每次接收到正ami脉冲rpos都为高脉冲。当接收器配置为二进制接口时(rbin = 1)，rdat输出解码二进制数据。rpos/rdat在rclk的下降沿(rcinv = 0)或rclk的上升沿(rcinv = 1)刷新。 接收器负ami/线路代码违反(rneg/rlcv)：当接收器被配置为双极性接口时(rbin = 0)，每次接收到负ami脉冲rneg都为高脉冲。当接收器配置为二进制接口时(rbin = 1)，rlcv产生高脉冲表示代码违反。rneg/rlcv在rclk的下降沿(rcinv = 0)或在rclk的上升沿(rcinv = 1)刷新。 接收器时钟(rclk)：恢复的时钟在rclk引脚输出。恢复的数据在rclk的下降沿(rcinv = 0)或rclk的上升沿(rcinv = 1)从rpos/rdat和rneg/rlcv引脚输出。信号丢失期间(rlos = 0)，rclk输出信号从liu主时钟获得。 ds3154传送-liu成帧器接口引脚发送器正ami/发送器数据(tpos/tdat)：当发送器配置为双极性接口时(tbin = 0)，tpos为高时线上发送正脉冲。发送器配置为二进制接口时(tbin = 1)，tdat上的数据经过b3zs或hdb3编码后发送。tpos/tdat在tclk的上升沿(tcinv = 0)或tclk的下降沿(tcinv = 1)采样。 发送器器负ami (tneg)：当发送器配置为双极性接口时(tbin = 0)，tneg为高时在线上传送负脉冲。当发送器配置为二进制接口时(tbin = 1)，tneg被忽略并置高或置低。tneg在tclk的上升沿(tcinv = 0)或tclk的下降沿(tcinv = 1)采样。 发送器时钟(tclk)：ds3 (44.736mhz _20ppm)、e3 (34.368mhz _20ppm)或sts-1 (51.840mhz _20ppm)时钟作用在该信号。要发送的数据在tclk上升沿(tcinv = 0)或tclk下降沿(tcinv = 1)从tpos/tdat和tneg引脚移入器件。 接口所需的ds3144与ds3154寄存器:表1所示为对应于最高级别配置、控制以及包括复位、时钟、引脚控制和线路接口功能在内的每一个成帧器状态的ds3144寄存器。 表1. ds3144线路接口寄存器映射 addr. register bit 7 bit 6 bit 5 bit 4 bit 3 bit 2 bit 1 bit 0
01h mc1 lotcmc zcsd bin mecu aecu tua1 disable rst
02h mc2 ostcs tcclk n/a n/a n/a dlb llb plb
03h mc3 tdenms tsofc toheni tohi tsofi ticlki tdati tdeni
04h mc4 rdenms roofi rlosi rdath rsofi roclki rdati rdeni
05h mc5 rnegi rposi rclki tnegh tposh tnegi tposi tclki
06h isr1 n/a n/a n/a n/a int4 int3 int2 int1
08h msr lorc lotc t3e3 feac hdlc bert covf n/a
09h msrl lorcl lotcl n/a n/a n/a n/a covfl ostl
oah msrie lorcie lotcie t3e3ie feacie hdlcie bertie covfie ostie
注：有下划线的位是只读位。标有n/a的位是未定义位。未定义位是为将来功能升级保留的，必须写为逻辑 0并且在读取的时候忽略。 表2所示为ds3144 ds3/e3成帧器寄存器。在此寄存器地址映射中，带下划线的位是只读位。标有n/a的位是未定义位。未定义位是为将来功能升级保留的，必须写为逻辑 0并在读取的时候忽略。 表2中的寄存器对应于最高级配置、控制以及ds3和e3模式下的每一个成帧器的状态。 表2. ds3144 ds3/e3成帧器寄存器映射 addr. register bit 7 bit 6 bit 5 bit 4 bit 3 bit 2 bit 1 bit 0
10 t3e3cr1 e3snc1 e3snc0 t3idle trai tais tpt cben ds3m
11 t3e3cr2 fresync n/a tfebe afebed ecc fecc1 fecc0 e3cve
12 t3e3eic meims fbeic1 fbeic0 fbei t3cpbei t3pbei exzi bpvi
18 t3e3sr n/a n/a sef t3idle rai ais oof los
19 t3e3srl cofal n/a sefl t3idlel rail aisl oofl losl
1a t3e3srie cofaie n/a sefie t3idleie raiie aisie oofie losie
1b t3e3ir rua1 t3aic e3sn n/a exzl mbel fbel zscdl
20 bpvcr1 bpv7 bpv6 bpv5 bpv4 bpv3 bpv2 bpv1 bpv0
21 bpvcr2 bpv15 bpv14 bpv13 bpv12 bpv11 bpv10 bpv9 bpv8
22 exzcr1 exz7 exz6 exz5 exz4 exz3 exz2 exz1 exz0
23 exzcr2 exz15 exz14 exz13 exz12 exz11 exz10 exz9 exz8
24 fecr1 fe7 fe6 fe5 fe4 fe3 fe2 fe1 fe0
25 fecr2 fe15 fe14 fe13 fe12 fe11 fe10 fe9 fe8
26 pcr1 pe7 pe6 pe5 pe4 pe3 pe2 pe1 pe0
27 pcr2 pe15 pe14 pe13 pe12 pe11 pe10 pe9 pe8
28 cpcr1 cpe7 cpe6 cpe5 cpe4 cpe3 cpe2 cpe1 cpe0
29 cpcr2 cpe15 cpe14 cpe13 cpe12 cpe11 cpe10 cpe9 cpe8
2a febecr1 febe7 febe6 febe5 febe4 febe3 febe2 febe1 febe0
2b febecr2 febe15 febe14 febe13 febe12 febe11 febe10 febe9 febe8
ds3154可以工作在硬件模式或者cpu总线模式。 在硬件模式下，将输入引脚置为高或低就可以进行所有配置。所有的状态信息在状态输出引脚得以体现。硬件模式下内部寄存器不可访问。hw引脚被拉高时(hw = 1)器件配置为硬件模式。 在cpu总线模式下，大多数硬件模式下的配置引脚和状态引脚被重新分配成地址、数据和控制线，它们与8位微处理器总线接口。hw引脚置低(hw = 0)时器件配置为cpu总线模式。 除了hw引脚外，硬件模式下的配置引脚和状态引脚在cpu总线模式下都有相应的寄存器位。硬件模式引脚和cpu总线模式寄存器位有相同的名称和功能，不同的是所有寄存器位都是高有效。表3为ds3154的寄存器映射，可以用来与ds3144进行接口连接。 表3. ds3154的寄存器映射 addr. register bit 7 bit 6 bit 5 bit 4 bit 3 bit 2 bit 1 bit 0
00h gcr1 e3m sts llb rlb tdsa tdsb - rst
01h tcr1 - tbin tcinv tja tpd tts tlbo -
02h rcr1 itu rbin rcinv rja rpd rts rmon rcvud
03h sr1 - - tdm prbs - - rlol rlos
04h srl1 - - tdml prbsl pberl rcvl rloll rlosl
05h srie1 - - tdmie prbsie pberie rcvie rlolie rlosie
06h rcvl1 rcv[7] rcv[6] rcv[5] rcv[4] rcv[3] rcv[2] rcv[1] rcv[0]
07h rcvh1 rcv[15] rcv[14] rcv[13] rcv[12] rcv[11] rcv[10] rcv[9] rcv[8]
o8h-0fh test - - - - - - - -
在成帧器和liu之间实现接口ds3144器件总是开启上电复位功能。复位之后，除了rdath和tua1被设置位1外，所有的读/写控制寄存器位都被复位至0。有关器件复位的工作细节可以从数据资料中获得(www.maxim-ic.com.cn/ds3144)。器件复位以后，ds3144需要配置为ds3或e3。任何模式下，mc1寄存器中的tua1位和mc4寄存器中的rdath位必须清零。复位时这些位被置为1以便在发送liu接口(tpos/tneg)和接收系统接口(rdat)产生未成帧的全1 (e3 ais)信号。 复位之后，缺省的ds3144 liu接口格式为带有b3zs/hdb3编、解码的双极性(pos/neg)格式。为了将复位之后的成帧器工作格式改为不带b3zs/hdb3编、解码的二进制(nrz)格式(编、解码在成帧器中关闭，但在liu中应开启)，mc1寄存器中的bin位需要设置为1。 成帧器接口格式与ds3154 b3zs/hdb3解码器数据可以以二进制或双极性格式输出。为了选择双极性接口格式，rbin引脚需要在硬件模式下置低。在cpu总线模式下，rbin配置位需要清零。 在双极性格式下，b3zs/hdb3解码器被关闭，恢复的数据经过缓存在rpos和rneg输出。rpos = 1时表示接收到正极性脉冲，rneg = 1时表示接收到负极性脉冲。 在双极性接口格式下，接收器简单的让接收数据通过而不进行bpv或exz检查。为了选择二进制接口格式，rbin引脚应该在硬件模式下置高。在cpu总线模式下，rbin配置位需置1。 在二进制格式下，b3zs/hbd3解码器开启，对恢复数据进行解码，并在rdat引脚以二进制数输出。rlcv引脚可以标记出代码违反。 为了支持与各种相邻元件的接口，rclk的极性可以反转。通常，数据在rclk的下降沿从rpos/rdat和rneg/rlcv引脚输出。为了在rclk的上升沿从这些引脚输出数据，rcinv引脚需要在硬件模式下置高，或者在cpu总线模式下将rcinv配置位设置为1。 rclk、rpos/rdat和rneg/rlcv引脚具有三态模式，支持保护开关和冗余liu应用。这种三态性能支持两个或更多个liu线或在一起，由系统处理器选择其中一个为有效工作。为了使rclk、rpos/rdat和rneg/rlcv成为三态，将rts引脚置高或rts配置位置1。图1所示为dallas semiconductor成帧器ds3144与dallas semiconductor liu ds3154的功能框图。
图1. 成帧器和liu的功能框图 总结关于设计成帧器和liu之间硬件接口的更多帮助信息，请参考ds3144dk数据资料，可以在线获得www.maxim-ic.com.cn/ds3144dk。 关于dallas semiconductor成帧器和liu之间与/或接口连接工作情况的更多问题请通过电子邮件 telecom.support@dalsemi.com联系dallas semiconductor telecommunications应用支持小组(english only)或者打电话至972-371-6555 (english only)。
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本应用笔记也适用于下面的dallas semiconductor成帧器和dallas semiconductor liu： ds3/e3 framer description
ds3141 single-port framer
ds3142 dual-port framer
ds3143 triple-port framer
ds3146 6-port framer
ds3148 8-port framer
ds31412 12-port framer
ds3/e3/sts-1 liu description
ds3151 single-port liu
ds3152 dual-port liu
ds3153 triple-port liu
ds3144接收成帧器liu接口引脚接收正数据输入/接收nrz数据输入(rpos/rnrz)：如果mc1寄存器中的bin = 0，liu接口处于双极性模式(pos/neg)。这种模式下，ami格式的串行数据流随时钟输入成帧器。外部liu 的rpos = 1表示线上接收到正脉冲，liu的rneg = 1表示线上接收到负脉冲。如果bin = 1，成帧器处于二进制(nrz) liu接口模式。在这种模式下，成帧器在rnrz引脚随时钟输入二进制格式的串行数据。rnrz = 1表示数据流中的一个1，rnrz = 0表示数据流中的一个0。 接收负数据输入/接收线路代码违反输入(rneg/rlcv)：如果mc1寄存器中的bin = 0，liu接口处于双极性模式(pos/neg)。这种模式下，成帧器随时钟输入交替符号反转(ami)格式的串行数据流。外部liu的rpos = 1表示线上接收到正脉冲，liu上的rneg = 1表示线上接收到一个负脉冲。如果bin = 1，成帧器处于二进制(nrz) liu接口模式。在这种模式下，成帧器在rnrz引脚随时钟输入二进制格式的串行数据流，在rlcv引脚输入线路代码违反。 接收时钟输入(rclk)：rclk用来将数据从rpos/rneg (双极性liu接口模式)或rnrz (二进制liu接口模式)送入接收成帧器。如果mc5寄存器中的rclki = 0，数据在rclk的上升沿进入成帧器。如果rclki = 1，数据在rclk的下降沿进入成帧器。从liu得到的rclk通常具有±20ppm以内的精确度，但是成帧器也能在rclk上接收高达52mhz的间隙时钟，比如从那些将ds3和e3映射至sonet/sdh或从中反映射的ic中得到的时钟。 ds3144发送格式化liu接口引脚发送正数据输出/发送nrz数据输出(tpos/tnrz)：如果mc1寄存器的bin = 0，liu接口处于双极性(pos/neg)模式。在这种模式下，发送格式化器以ami格式输出串行数据流。tpos = 1告诉外部liu要在线上驱动一个正脉冲，tneg = 1告诉liu在线上驱动一个负脉冲。如果bin = １，liu接口处于二进制(nrz)模式。在这种模式下，发送格式化器在tnrz引脚上以二进制格式输出串行数据流。tnrz = 1表示数据流中的一个1，tnrz = 0表示0。 发送负数据输出(tneg)：如果mc1寄存器中的bin = 0，liu接口处于双极性(pos/neg)模式。这种模式下，发送格式化器以ami格式输出串行数据流。tpos = 1告诉外部liu在线上驱动一个正脉冲，tneg = 1告诉liu在线上驱动一个负脉冲。如果bin = 1，liu接口处于二进制(nrz)模式。这种模式下，发送格式化器在tnrz引脚上以二进制格式输出串行数据流，并且tneg被置低。 发送时钟输出(tclk)：tclk用于发送成帧器从tpos/tneg (双极性liu接口模式)或tnrz (二进制liu接口模式)输出时钟数据。如果mc5寄存器的tclki = 0，数据在tclk的上升沿送出格式化器。如果tclki = 1，数据在tclk下降沿输出。tclk通常ticlk的缓冲输出(可选择反相)。当线路环回或载荷环回激活时，tclk是rclk的缓冲输出(可选择反相)。当ticlk上没有时钟信号并且mc1：lotcmc=1时，tclk是rclk缓冲输出(可选择反相)。 ds3154接收-liu成帧器接口引脚接收器正ami/接收器数据(rpos/rdat)：当接收器被配置为双极性接口时(rbin = 0)，每次接收到正ami脉冲rpos都为高脉冲。当接收器配置为二进制接口时(rbin = 1)，rdat输出解码二进制数据。rpos/rdat在rclk的下降沿(rcinv = 0)或rclk的上升沿(rcinv = 1)刷新。 接收器负ami/线路代码违反(rneg/rlcv)：当接收器被配置为双极性接口时(rbin = 0)，每次接收到负ami脉冲rneg都为高脉冲。当接收器配置为二进制接口时(rbin = 1)，rlcv产生高脉冲表示代码违反。rneg/rlcv在rclk的下降沿(rcinv = 0)或在rclk的上升沿(rcinv = 1)刷新。 接收器时钟(rclk)：恢复的时钟在rclk引脚输出。恢复的数据在rclk的下降沿(rcinv = 0)或rclk的上升沿(rcinv = 1)从rpos/rdat和rneg/rlcv引脚输出。信号丢失期间(rlos = 0)，rclk输出信号从liu主时钟获得。 ds3154传送-liu成帧器接口引脚发送器正ami/发送器数据(tpos/tdat)：当发送器配置为双极性接口时(tbin = 0)，tpos为高时线上发送正脉冲。发送器配置为二进制接口时(tbin = 1)，tdat上的数据经过b3zs或hdb3编码后发送。tpos/tdat在tclk的上升沿(tcinv = 0)或tclk的下降沿(tcinv = 1)采样。 发送器器负ami (tneg)：当发送器配置为双极性接口时(tbin = 0)，tneg为高时在线上传送负脉冲。当发送器配置为二进制接口时(tbin = 1)，tneg被忽略并置高或置低。tneg在tclk的上升沿(tcinv = 0)或tclk的下降沿(tcinv = 1)采样。 发送器时钟(tclk)：ds3 (44.736mhz _20ppm)、e3 (34.368mhz _20ppm)或sts-1 (51.840mhz _20ppm)时钟作用在该信号。要发送的数据在tclk上升沿(tcinv = 0)或tclk下降沿(tcinv = 1)从tpos/tdat和tneg引脚移入器件。 接口所需的ds3144与ds3154寄存器:表1所示为对应于最高级别配置、控制以及包括复位、时钟、引脚控制和线路接口功能在内的每一个成帧器状态的ds3144寄存器。 表1. ds3144线路接口寄存器映射 addr. register bit 7 bit 6 bit 5 bit 4 bit 3 bit 2 bit 1 bit 0
01h mc1 lotcmc zcsd bin mecu aecu tua1 disable rst
02h mc2 ostcs tcclk n/a n/a n/a dlb llb plb
03h mc3 tdenms tsofc toheni tohi tsofi ticlki tdati tdeni
04h mc4 rdenms roofi rlosi rdath rsofi roclki rdati rdeni
05h mc5 rnegi rposi rclki tnegh tposh tnegi tposi tclki
06h isr1 n/a n/a n/a n/a int4 int3 int2 int1
08h msr lorc lotc t3e3 feac hdlc bert covf n/a
09h msrl lorcl lotcl n/a n/a n/a n/a covfl ostl
oah msrie lorcie lotcie t3e3ie feacie hdlcie bertie covfie ostie
注：有下划线的位是只读位。标有n/a的位是未定义位。未定义位是为将来功能升级保留的，必须写为逻辑 0并且在读取的时候忽略。 表2所示为ds3144 ds3/e3成帧器寄存器。在此寄存器地址映射中，带下划线的位是只读位。标有n/a的位是未定义位。未定义位是为将来功能升级保留的，必须写为逻辑 0并在读取的时候忽略。 表2中的寄存器对应于最高级配置、控制以及ds3和e3模式下的每一个成帧器的状态。 表2. ds3144 ds3/e3成帧器寄存器映射 addr. register bit 7 bit 6 bit 5 bit 4 bit 3 bit 2 bit 1 bit 0
10 t3e3cr1 e3snc1 e3snc0 t3idle trai tais tpt cben ds3m
11 t3e3cr2 fresync n/a tfebe afebed ecc fecc1 fecc0 e3cve
12 t3e3eic meims fbeic1 fbeic0 fbei t3cpbei t3pbei exzi bpvi
18 t3e3sr n/a n/a sef t3idle rai ais oof los
19 t3e3srl cofal n/a sefl t3idlel rail aisl oofl losl
1a t3e3srie cofaie n/a sefie t3idleie raiie aisie oofie losie
1b t3e3ir rua1 t3aic e3sn n/a exzl mbel fbel zscdl
20 bpvcr1 bpv7 bpv6 bpv5 bpv4 bpv3 bpv2 bpv1 bpv0
21 bpvcr2 bpv15 bpv14 bpv13 bpv12 bpv11 bpv10 bpv9 bpv8
22 exzcr1 exz7 exz6 exz5 exz4 exz3 exz2 exz1 exz0
23 exzcr2 exz15 exz14 exz13 exz12 exz11 exz10 exz9 exz8
24 fecr1 fe7 fe6 fe5 fe4 fe3 fe2 fe1 fe0
25 fecr2 fe15 fe14 fe13 fe12 fe11 fe10 fe9 fe8
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27 pcr2 pe15 pe14 pe13 pe12 pe11 pe10 pe9 pe8
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2b febecr2 febe15 febe14 febe13 febe12 febe11 febe10 febe9 febe8
ds3154可以工作在硬件模式或者cpu总线模式。 在硬件模式下，将输入引脚置为高或低就可以进行所有配置。所有的状态信息在状态输出引脚得以体现。硬件模式下内部寄存器不可访问。hw引脚被拉高时(hw = 1)器件配置为硬件模式。 在cpu总线模式下，大多数硬件模式下的配置引脚和状态引脚被重新分配成地址、数据和控制线，它们与8位微处理器总线接口。hw引脚置低(hw = 0)时器件配置为cpu总线模式。 除了hw引脚外，硬件模式下的配置引脚和状态引脚在cpu总线模式下都有相应的寄存器位。硬件模式引脚和cpu总线模式寄存器位有相同的名称和功能，不同的是所有寄存器位都是高有效。表3为ds3154的寄存器映射，可以用来与ds3144进行接口连接。 表3. ds3154的寄存器映射 addr. register bit 7 bit 6 bit 5 bit 4 bit 3 bit 2 bit 1 bit 0
00h gcr1 e3m sts llb rlb tdsa tdsb - rst
01h tcr1 - tbin tcinv tja tpd tts tlbo -
02h rcr1 itu rbin rcinv rja rpd rts rmon rcvud
03h sr1 - - tdm prbs - - rlol rlos
04h srl1 - - tdml prbsl pberl rcvl rloll rlosl
05h srie1 - - tdmie prbsie pberie rcvie rlolie rlosie
06h rcvl1 rcv[7] rcv[6] rcv[5] rcv[4] rcv[3] rcv[2] rcv[1] rcv[0]
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在成帧器和liu之间实现接口ds3144器件总是开启上电复位功能。复位之后，除了rdath和tua1被设置位1外，所有的读/写控制寄存器位都被复位至0。有关器件复位的工作细节可以从数据资料中获得(www.maxim-ic.com.cn/ds3144)。器件复位以后，ds3144需要配置为ds3或e3。任何模式下，mc1寄存器中的tua1位和mc4寄存器中的rdath位必须清零。复位时这些位被置为1以便在发送liu接口(tpos/tneg)和接收系统接口(rdat)产生未成帧的全1 (e3 ais)信号。 复位之后，缺省的ds3144 liu接口格式为带有b3zs/hdb3编、解码的双极性(pos/neg)格式。为了将复位之后的成帧器工作格式改为不带b3zs/hdb3编、解码的二进制(nrz)格式(编、解码在成帧器中关闭，但在liu中应开启)，mc1寄存器中的bin位需要设置为1。 成帧器接口格式与ds3154 b3zs/hdb3解码器数据可以以二进制或双极性格式输出。为了选择双极性接口格式，rbin引脚需要在硬件模式下置低。在cpu总线模式下，rbin配置位需要清零。 在双极性格式下，b3zs/hdb3解码器被关闭，恢复的数据经过缓存在rpos和rneg输出。rpos = 1时表示接收到正极性脉冲，rneg = 1时表示接收到负极性脉冲。 在双极性接口格式下，接收器简单的让接收数据通过而不进行bpv或exz检查。为了选择二进制接口格式，rbin引脚应该在硬件模式下置高。在cpu总线模式下，rbin配置位需置1。 在二进制格式下，b3zs/hbd3解码器开启，对恢复数据进行解码，并在rdat引脚以二进制数输出。rlcv引脚可以标记出代码违反。 为了支持与各种相邻元件的接口，rclk的极性可以反转。通常，数据在rclk的下降沿从rpos/rdat和rneg/rlcv引脚输出。为了在rclk的上升沿从这些引脚输出数据，rcinv引脚需要在硬件模式下置高，或者在cpu总线模式下将rcinv配置位设置为1。 rclk、rpos/rdat和rneg/rlcv引脚具有三态模式，支持保护开关和冗余liu应用。这种三态性能支持两个或更多个liu线或在一起，由系统处理器选择其中一个为有效工作。为了使rclk、rpos/rdat和rneg/rlcv成为三态，将rts引脚置高或rts配置位置1。图1所示为dallas semiconductor成帧器ds3144与dallas semiconductor liu ds3154的功能框图。
图1. 成帧器和liu的功能框图 总结关于设计成帧器和liu之间硬件接口的更多帮助信息，请参考ds3144dk数据资料，可以在线获得www.maxim-ic.com.cn/ds3144dk。 关于dallas semiconductor成帧器和liu之间与/或接口连接工作情况的更多问题请通过电子邮件 telecom.support@dalsemi.com联系dallas semiconductor telecommunications应用支持小组(english only)或者打电话至972-371-6555 (english only)。
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