新思科技宣布推出最新版本IC Validator物理验证解决方案
业界首创的弹性cpu调配技术可将物理验证签核的成本降低40％
机器学习驱动的根本原因分析可加快设计的收敛
相较于传统的lvs检查方法，创新的explorer lvs可提高30倍速度，同时内存使用降低30倍
新思科技（synopsys）近日宣布推出最新版本ic validator物理验证解决方案，该解决方案包含多项创新技术，可加快前沿应用推向市场的时间。ic validator独特的弹性cpu调配技术可为本地和云环境的物理签核节省多达40％的计算时间。另一项创新技术是机器学习驱动的根本原因分析，可自动识别关键的设计规则检查（drc）问题，从而更快地实现drc的收敛。此外，与传统lvs技术相比，explorer lvs可使soc的运行时间提高30倍且调试速度得到数量级的提升。
“设计规模不断扩大、制造复杂性不断升级，处于前沿设计的客户日益面临设计收敛的挑战，因此及时的物理验证收敛对于满足严苛的流片时间至关重要。新思科技ic validator的创新功能将为开发者提供更高的性能、更高的生产率并加速芯片上市的时间。”
——raja tabet
芯片设计集团高级副总裁
新思科技
作为新思科技fusion design platform和custom design platform的重要组成部分， ic validator是一款全面且具有高度可扩展性的物理验证解决方案。该解决方案包括drc、lvs、可编程式电学规则检查（perc）、虚拟金属填充和dfm等增强功能。ic validator采用智能内存感知负载调度和均衡技术，具有高性能和高度可扩展性等特点，可最大限度地利用主流硬件。此外，它可以在多台机器上同时使用多线程和分布式处理，并且可扩展到1000多个cpu，优势显著。 新思科技fusion design platform中的ic validator验证可实现快速drc检查、自动修复、时序的填充和签核、以及与star rc集成，从而可加快收敛速度。ic validator的实时drc检查技术可为新思科技custom design platform按需实现实时drc监测。
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