在FPGA中实现MCU内核的快速运行
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有时，微控制器本身可以完全吸收设计的所有功能要求。对于绝大多数嵌入式系统设计而言，编程良好，高度集成的嵌入式处理器是工程师可以使用的成本效益，功效，速度快的解决方案。当原始性能至关重要时，捕获的逻辑专用硬件可实现性能。例如，定序器可以比软件中实现的相同逻辑快一个数量级。由于分立逻辑器件占用大量空间和功率，因此添加fpga是一种可行的替代方案。在许多情况下，fpga和微控制器的组合是一个很好的解决方案。当微控制器在fpga的逻辑中实现时，可以实现更密集的解决方案。作为硬编码的宏，或者在每个新设计中被替换和布线的软宏，整个微控制器吸收到fpga的房子不仅可以产生的密度，而且可以产生的灵活性，特别是如果你足够勇敢地修改以提高性能。本文着眼于在现有fpga中快速运行的微核。这些可以从各种来源获得，包括开放和封闭，和ip许可。比原始版本更好可以使用传统架构和专有架构，每种架构都有优势。传统内核与传统微处理器兼容，并提供熟悉的体系结构。您公司生产的产品可以使用已经过测试和验证的代码。当需要下一代产品甚至是新的改进模型时，组织良好且可靠的代码库的可重用性可以节省大量时间。几种流行的内核已经以原始逻辑形式实现了各种各样的fpga系列包括诸如microchip pic，intel 8051，atmel avr，motorola 6502，intel 8080和zilog z80微控制器等处理器。一个不那么明显的优点是能够改进初始化建筑。如果时间和资源允许，可以克服缺点，因为您可以修改设计。例如，非常流行的8051架构初采用有序架构，每条指令需要12个时钟周期。的传统实现可以反映初始功能，或者可以实现更现代的风格，减少每条指令的时钟周期数。改进的8051 ip内核也可用于跨平台开发。 r8051xc2-bf?可用于asic或xilinx和altera fpga;它通过添加第二个数据指针（初始设计的缺点）和jtag调试接口（图1）改进了初始设计。
图1：传统的商业可用实现通常会改进初始的离散设计。这个8051内核每个指令运行一个时钟，并添加jtag和第二个数据指针。arm内核虽然许多设计可以使用8位内核，但现代功能可能需要更高的总线宽度来简化处理。如果您正在操作24位宽的图形数据，则单个32位传输比三个8位传输更有效。的32位架构也许是arm?cortex?，令人惊讶的是，它已成为fpga实现的流行且受到良好支持的架构。从面积和功耗角度来看，arm cortex非常高效。可扩展的架构得到众多工具和开发套件的很好支持，以及外围设备，内存管理，数学和dsp功能的开源代码。arm内核的一个很好的特性是它们不属于一个fpga制造商，可以在不同制造商的设备上实现。这意味着随着设计的发展或需求的变化，您不会被锁定在一个供应商中。另一个好处是，架构可以从更简单，功能更少的cortex m0扩展到非常高端的多核a8和a9风格。此外，还具有经过赛道验证的驱动程序和堆栈，可用于高端外设，如usb，以太网，wi-fi，zigbee，蓝牙等。xilinx系列产品是嵌入式微核的大支持者，而arm架构也不例外。像xc5vlx50-1ffg676c这样的器件是xilinxvirtex?5系列的一部分，它是一个非常大，密集，高端的fpga的例子，它可以在芯片上安装一个快速而密集的系统。 550 mhz器件具有440个i/o和超过46，000个逻辑模块，不仅支持arm内核功能，还支持高达72位宽的存储器宽度，流水线操作，fifo，具有高达16.4 mbits内部块存储器的双端口存储器和dsp功能。microsemi是另一家提供arm内核支持的fpga制造商，proasic3系列是一款的目标技术，具有令人印象深刻的低端到高端逻辑，i/o，ram和门数15，000到3，000，000。一个很好的例子是a3pe3000-fgg484具有341个i/o和516 kbits的内部ram。altera具有可比较的部件，如ep3sl50f780c4n，它同样支持arm处理器，并为ddr，ddr2，ddr3，sdram提供内存支持更多，多24个模块化i/o bank，448 i/o（系列中多744个）。作为stratix?iii系列的成员，altera可以访问altera mega-function合作伙伴计划（ampp），以获取可用的外设，内核和支持。 altera还通过其altera megacore功能支持多种知识产权（图2）。
图2：高端32位arm架构是许多fpga的流行。该altera版本增加了多核调试和跟踪功能，简化了单个fpga内多个实例化处理器内核的设计。专有内核除了行业标准的微控制器内核外，fpga制造商还提供专有内核，这些内核具有非常高的逻辑效率，可扩展至8至32位的性能水平。这些供应商的关键不是在不需要的功能和外围设备上浪费逻辑;经常缩减，实现了裸机处理单元，以提供基本的可编程性和fpga内部大型逻辑池的接口。这不仅可以让内核快速运行，而且还可以保持它们足够小，以便在soc内部创建自己的双核，四核甚至八核处理器。xilinx指定blaze这样的内核，可以同时使用picoblaze和microblaze口味。 picoblaze是一种8位risc架构，具有高达240 mhz的性能。它主要设计用于vhdl设计流程，并作为vhdl源文件提供。一旦在13个不同的xilinx系列中实现，它就不需要外部元件，完全在主机部分内部运行。支持的系列包括kinetex-7，artix-7，virtex（4，5，6，7，ii-pro） ）和spartan?（3和6）。从资源和复杂性的角度来看，picoblaze是spartan（双关语）。它具有一个16 x字节宽的通用数据寄存器，1k可编程片上程序存储器（在fpga配置期间自动加载），一个带有carry和zero指示器标志的字节宽运算逻辑单元（alu），64字节内部暂存器ram，256个输入和256个输出端口，便于扩展和增强。另一方面，它具有可预测的性能，每条指令总是两个时钟周期，高达240 mhz（或virtex-4中的100 mips） fpga）和88 mhz（或spartan-3 fpga中的44 mips）。 picoblaze对xilinx用户提供，并附带汇编程序和vhdl源代码。高端是xilinx microblaze。这是一个32位risc harvard架构软核处理器内核，具有32个通用32位寄存器，alu，针对嵌入式应用优化的丰富指令集，三级mmu/mpu支持等。灵活性该（图3）允许您选择性能优化的五级流水线，使用kinetix-7系列（例如xc7k70t-1fbg676c）或3级流水线区域优化版本可实现高达317 dmips在xintex-7或virtex-6和7系列器件（如xc6vlx130t-1ffg784c）上仍然可以达到令人尊敬的264 dmips。
图3：用于xilinx fpga的专有32位microblaze内核有条件编译指令允许你添加你需要的块，并消除你不保存逻辑和提高密度的块。altera还提供了一个名为nios的专有内核，现在是第二代nios ii版本（图4） 。作为业界使用广泛的软处理器，它具有功率灵敏度和安全关键（do-254）兼容性的实时性能。
图4：altera的第二代nios ii内核被誉为fpga中使用广泛且支持的ip内核，并带来了许多开发和调试功能。六级流水线nios内核可以实现少至600个逻辑单元和特征向量中断控制，紧密内存和dsp耦合，以及添加自定义指令（多256个）的能力。它可以使用内存管理单元（mmu），并在开源和商业支持的版本中支持嵌入式linux。可行的替代方案您的设计细节将决定您是应该选择硬宏还是软宏。硬宏占用fpga内部的特定位置和资源，但硬编码宏的特性更好，可以实现更好的性能。软宏也可以实现良好的性能，特别是如果你足够勇敢修改，改进，或平行他们。一如既往，良好的设计实践将产生结果。总之，当需要尽可能高的密度和/或性能时，选择fpga内部的软处理器而不是传统的微控制器及其所有支持电路可能在灵活性，效率，性能，功耗和空间方面，这是一个更好的解决方案。
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有时，微控制器本身可以完全吸收设计的所有功能要求。对于绝大多数嵌入式系统设计而言，编程良好，高度集成的嵌入式处理器是工程师可以使用的成本效益，功效，速度快的解决方案。当原始性能至关重要时，捕获的逻辑专用硬件可实现性能。例如，定序器可以比软件中实现的相同逻辑快一个数量级。由于分立逻辑器件占用大量空间和功率，因此添加fpga是一种可行的替代方案。在许多情况下，fpga和微控制器的组合是一个很好的解决方案。当微控制器在fpga的逻辑中实现时，可以实现更密集的解决方案。作为硬编码的宏，或者在每个新设计中被替换和布线的软宏，整个微控制器吸收到fpga的房子不仅可以产生的密度，而且可以产生的灵活性，特别是如果你足够勇敢地修改以提高性能。本文着眼于在现有fpga中快速运行的微核。这些可以从各种来源获得，包括开放和封闭，和ip许可。比原始版本更好可以使用传统架构和专有架构，每种架构都有优势。传统内核与传统微处理器兼容，并提供熟悉的体系结构。您公司生产的产品可以使用已经过测试和验证的代码。当需要下一代产品甚至是新的改进模型时，组织良好且可靠的代码库的可重用性可以节省大量时间。几种流行的内核已经以原始逻辑形式实现了各种各样的fpga系列包括诸如microchip pic，intel 8051，atmel avr，motorola 6502，intel 8080和zilog z80微控制器等处理器。一个不那么明显的优点是能够改进初始化建筑。如果时间和资源允许，可以克服缺点，因为您可以修改设计。例如，非常流行的8051架构初采用有序架构，每条指令需要12个时钟周期。的传统实现可以反映初始功能，或者可以实现更现代的风格，减少每条指令的时钟周期数。改进的8051 ip内核也可用于跨平台开发。 r8051xc2-bf?可用于asic或xilinx和altera fpga;它通过添加第二个数据指针（初始设计的缺点）和jtag调试接口（图1）改进了初始设计。
图1：传统的商业可用实现通常会改进初始的离散设计。这个8051内核每个指令运行一个时钟，并添加jtag和第二个数据指针。arm内核虽然许多设计可以使用8位内核，但现代功能可能需要更高的总线宽度来简化处理。如果您正在操作24位宽的图形数据，则单个32位传输比三个8位传输更有效。的32位架构也许是arm?cortex?，令人惊讶的是，它已成为fpga实现的流行且受到良好支持的架构。从面积和功耗角度来看，arm cortex非常高效。可扩展的架构得到众多工具和开发套件的很好支持，以及外围设备，内存管理，数学和dsp功能的开源代码。arm内核的一个很好的特性是它们不属于一个fpga制造商，可以在不同制造商的设备上实现。这意味着随着设计的发展或需求的变化，您不会被锁定在一个供应商中。另一个好处是，架构可以从更简单，功能更少的cortex m0扩展到非常高端的多核a8和a9风格。此外，还具有经过赛道验证的驱动程序和堆栈，可用于高端外设，如usb，以太网，wi-fi，zigbee，蓝牙等。xilinx系列产品是嵌入式微核的大支持者，而arm架构也不例外。像xc5vlx50-1ffg676c这样的器件是xilinxvirtex?5系列的一部分，它是一个非常大，密集，高端的fpga的例子，它可以在芯片上安装一个快速而密集的系统。 550 mhz器件具有440个i/o和超过46，000个逻辑模块，不仅支持arm内核功能，还支持高达72位宽的存储器宽度，流水线操作，fifo，具有高达16.4 mbits内部块存储器的双端口存储器和dsp功能。microsemi是另一家提供arm内核支持的fpga制造商，proasic3系列是一款的目标技术，具有令人印象深刻的低端到高端逻辑，i/o，ram和门数15，000到3，000，000。一个很好的例子是a3pe3000-fgg484具有341个i/o和516 kbits的内部ram。altera具有可比较的部件，如ep3sl50f780c4n，它同样支持arm处理器，并为ddr，ddr2，ddr3，sdram提供内存支持更多，多24个模块化i/o bank，448 i/o（系列中多744个）。作为stratix?iii系列的成员，altera可以访问altera mega-function合作伙伴计划（ampp），以获取可用的外设，内核和支持。 altera还通过其altera megacore功能支持多种知识产权（图2）。
图2：高端32位arm架构是许多fpga的流行。该altera版本增加了多核调试和跟踪功能，简化了单个fpga内多个实例化处理器内核的设计。专有内核除了行业标准的微控制器内核外，fpga制造商还提供专有内核，这些内核具有非常高的逻辑效率，可扩展至8至32位的性能水平。这些供应商的关键不是在不需要的功能和外围设备上浪费逻辑;经常缩减，实现了裸机处理单元，以提供基本的可编程性和fpga内部大型逻辑池的接口。这不仅可以让内核快速运行，而且还可以保持它们足够小，以便在soc内部创建自己的双核，四核甚至八核处理器。xilinx指定blaze这样的内核，可以同时使用picoblaze和microblaze口味。 picoblaze是一种8位risc架构，具有高达240 mhz的性能。它主要设计用于vhdl设计流程，并作为vhdl源文件提供。一旦在13个不同的xilinx系列中实现，它就不需要外部元件，完全在主机部分内部运行。支持的系列包括kinetex-7，artix-7，virtex（4，5，6，7，ii-pro） ）和spartan?（3和6）。从资源和复杂性的角度来看，picoblaze是spartan（双关语）。它具有一个16 x字节宽的通用数据寄存器，1k可编程片上程序存储器（在fpga配置期间自动加载），一个带有carry和zero指示器标志的字节宽运算逻辑单元（alu），64字节内部暂存器ram，256个输入和256个输出端口，便于扩展和增强。另一方面，它具有可预测的性能，每条指令总是两个时钟周期，高达240 mhz（或virtex-4中的100 mips） fpga）和88 mhz（或spartan-3 fpga中的44 mips）。 picoblaze对xilinx用户提供，并附带汇编程序和vhdl源代码。高端是xilinx microblaze。这是一个32位risc harvard架构软核处理器内核，具有32个通用32位寄存器，alu，针对嵌入式应用优化的丰富指令集，三级mmu/mpu支持等。灵活性该（图3）允许您选择性能优化的五级流水线，使用kinetix-7系列（例如xc7k70t-1fbg676c）或3级流水线区域优化版本可实现高达317 dmips在xintex-7或virtex-6和7系列器件（如xc6vlx130t-1ffg784c）上仍然可以达到令人尊敬的264 dmips。
图3：用于xilinx fpga的专有32位microblaze内核有条件编译指令允许你添加你需要的块，并消除你不保存逻辑和提高密度的块。altera还提供了一个名为nios的专有内核，现在是第二代nios ii版本（图4） 。作为业界使用广泛的软处理器，它具有功率灵敏度和安全关键（do-254）兼容性的实时性能。
图4：altera的第二代nios ii内核被誉为fpga中使用广泛且支持的ip内核，并带来了许多开发和调试功能。六级流水线nios内核可以实现少至600个逻辑单元和特征向量中断控制，紧密内存和dsp耦合，以及添加自定义指令（多256个）的能力。它可以使用内存管理单元（mmu），并在开源和商业支持的版本中支持嵌入式linux。可行的替代方案您的设计细节将决定您是应该选择硬宏还是软宏。硬宏占用fpga内部的特定位置和资源，但硬编码宏的特性更好，可以实现更好的性能。软宏也可以实现良好的性能，特别是如果你足够勇敢修改，改进，或平行他们。一如既往，良好的设计实践将产生结果。总之，当需要尽可能高的密度和/或性能时，选择fpga内部的软处理器而不是传统的微控制器及其所有支持电路可能在灵活性，效率，性能，功耗和空间方面，这是一个更好的解决方案。
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